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軟件無線電

  • ZigBee開發(fā)套件內(nèi)容

    ZigBee開發(fā)套件內(nèi)容開發(fā)套件

    標簽: ZigBee 開發(fā)套件

    上傳時間: 2013-11-04

    上傳用戶:jinyao

  • SF-CY3 FPGA套件開發(fā)指南Ver6.00 (by特權同學)

    SF-CY3 FPGA套件開發(fā)指南Ver6.00 (by特權同學)

    標簽: SF-CY FPGA 6.00 Ver

    上傳時間: 2014-01-25

    上傳用戶:ewtrwrtwe

  • EDA技術實用教程VHDL版本課件

    EDA技術實用教程VHDL版本課件

    標簽: VHDL EDA 實用教程 版本

    上傳時間: 2013-10-10

    上傳用戶:ruan2570406

  • 夏宇聞老師優(yōu)秀的verilog教程課件

          本資料是關于夏宇聞老師優(yōu)秀的verilog教程課件,其中包括verilog講稿PPT、verilog課件、verilog例題等。

    標簽: verilog 教程

    上傳時間: 2013-11-21

    上傳用戶:電子世界

  • 《EDA原理及應用》(何賓教授)實驗課件

          本資料是《EDA原理及應用》一書的配套實驗課件,一共有18個實驗。大家可以參考著自己做!當然做完后也可以到電子發(fā)燒友網(wǎng)站FPGA技術聯(lián)盟QQ群(263281510)討論討論...

    標簽: EDA 實驗

    上傳時間: 2013-11-10

    上傳用戶:rlgl123

  • 《EDA原理及應用》(何賓教授)課件 PPT

      第1章-EDA設計導論   第2章-可編程邏輯器件設計方法   第3章-VHDL語言基礎   第4章-數(shù)字邏輯單元設計   第5章-VHDL高級設計技術   第6章-基于HDL和原理圖的設計輸入   第7章-設計綜合和行為仿真   第8章-設計實現(xiàn)和時序仿真   第9章-設計下載和調試   第10章-設計示例(數(shù)字鐘、UART、數(shù)字電壓表)     點擊鏈接,【《EDA原理及應用》(何賓教授)實驗課件下載 】

    標簽: EDA

    上傳時間: 2013-11-10

    上傳用戶:zhangliming420

  • cpld開發(fā)套件光盤說明

    cpld開發(fā)套件光盤說明

    標簽: cpld 開發(fā)套件 光盤

    上傳時間: 2013-10-24

    上傳用戶:hfmm633

  • FPGA電子課件_共8課

    學習FPGA的課件,內(nèi)容含有軟件的介紹,Altera和Xilinx芯片的介紹,以及VHDL的編程風格。和一些實例講解。

    標簽: FPGA 電子課件

    上傳時間: 2013-11-10

    上傳用戶:胡岸888

  • PCB LAYOUT設計規(guī)范手冊

      PCB Layout Rule Rev1.70, 規(guī)範內(nèi)容如附件所示, 其中分為:   (1) ”PCB LAYOUT 基本規(guī)範”:為R&D Layout時必須遵守的事項, 否則SMT,DIP,裁板時無法生產(chǎn).   (2) “錫偷LAYOUT RULE建議規(guī)範”: 加適合的錫偷可降低短路及錫球.   (3) “PCB LAYOUT 建議規(guī)範”:為製造單位為提高量產(chǎn)良率,建議R&D在design階段即加入PCB Layout.   (4) ”零件選用建議規(guī)範”: Connector零件在未來應用逐漸廣泛, 又是SMT生產(chǎn)時是偏移及置件不良的主因,故製造希望R&D及採購在購買異形零件時能顧慮製造的需求, 提高自動置件的比例.

    標簽: LAYOUT PCB 設計規(guī)范

    上傳時間: 2013-11-03

    上傳用戶:tzl1975

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-11-17

    上傳用戶:cjf0304

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