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  • 清華大學華成英教授的模擬電子技術基礎課件

    模擬電子技術基礎課件

    標簽: 清華大學 模擬電子 技術基礎

    上傳時間: 2013-10-13

    上傳用戶:blans

  • 華成英課件復習與考試

    華成英課件復習與考試。

    標簽:

    上傳時間: 2013-11-21

    上傳用戶:chendawei

  • 拉扎維模擬CMOS集成電路設計(前十章全部課件)

    拉扎維的前十章課件,初學者看看

    標簽: CMOS 模擬 集成電路設計

    上傳時間: 2013-11-12

    上傳用戶:spman

  • 微電腦型數學演算式隔離傳送器

    特點: 精確度0.1%滿刻度 可作各式數學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A|/ 16 BIT類比輸出功能 輸入與輸出絕緣耐壓2仟伏特/1分鐘(input/output/power) 寬范圍交直流兩用電源設計 尺寸小,穩定性高

    標簽: 微電腦 數學演算 隔離傳送器

    上傳時間: 2014-12-23

    上傳用戶:ydd3625

  • 復旦cmos學習課件(模擬集成電路設計原理)

    這是在網上找了好久的課件,比較不錯,上面還有我的筆記,主要講解模擬集成電路設計原理。

    標簽: cmos 模擬集成電路 設計原理

    上傳時間: 2013-11-07

    上傳用戶:huyiming139

  • 語音識別組件轉化為控件的方法

    在使用一些專用開發工具如Authorware時,常遇到不支持COM組件調用的問題。文中介紹了將COM組件和ActiveX控件的轉化方法以解決這種問題。根據組件的函數和數據成員在控件中添加相應的屬性、方法和事件來設計控件。文中以一個語音識別組件來詳細說明轉化方法和流程。最后,在Authorware工具中調用語音識別控件并能夠識別出文本。

    標簽: 語音識別 控件 轉化

    上傳時間: 2013-11-03

    上傳用戶:XLHrest

  • 數字電路基礎課件

    數字電路基礎課件

    標簽: 數字電路基礎

    上傳時間: 2013-11-20

    上傳用戶:dgann

  • 數電Verilog相關課件

    數電Verilog相關課件

    標簽: Verilog 數電

    上傳時間: 2013-10-23

    上傳用戶:wangzeng

  • 北大數字集成電路基礎課件

    數字電路基礎課件PDF

    標簽: 數字集成 電路基礎

    上傳時間: 2013-10-08

    上傳用戶:csgcd001

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

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