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輪機(jī)(jī)模擬器

  • 使用C#程式語言開發(fā)

    使用C#程式語言開發(fā),並執(zhí)行於.NET Framework下;是研習(xí)「蟻拓尋優(yōu)法」不可或缺的軟體工具。系統(tǒng)使用ACO (Ant Colony Optimization)演算公式模擬螞蟻的覓食行徑抉擇。使用者可以設(shè)定費(fèi)洛蒙和食物氣味強(qiáng)度等相關(guān)參數(shù)以及動(dòng)態(tài)設(shè)定障礙物的位置和形狀,研習(xí)螞蟻覓食的最短路徑形成過程。研習(xí)各種參數(shù)設(shè)定對螞蟻覓食行為的影響,了解費(fèi)落蒙機(jī)制對蟻拓尋優(yōu)化法的影響。本系統(tǒng)可支援柔性計(jì)算教學(xué),研習(xí)蟻拓優(yōu)化法中人工螞蟻的隨機(jī)搜尋模式和啟發(fā)式法則設(shè)計(jì)原理。

    標(biāo)簽: 程式

    上傳時(shí)間: 2013-12-24

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  • J-LINK下載器

    首先下載軟件,解壓軟件,安裝在程序中找到SEGGER,選里面的J-FLASH,進(jìn)入界面,剛開始的那個(gè)界面可以忽略,不用建project也可以;單擊菜單欄的“Options---Project settings”打開設(shè)置,進(jìn)行jlink配置;正在General選項(xiàng),選擇“USB”,一般都是默認(rèn)配置,確認(rèn)一下即可;然后在CPU選項(xiàng),選擇芯片型號,先選擇“Device”才能選擇芯片型號,芯片型號,要根據(jù)你使用的芯片進(jìn)行選擇;在Target interface選項(xiàng) 里面選擇SWD模式;首先Target里面選“Connection”連接目標(biāo)芯片,然后 Target--Auto進(jìn)行程序燒寫;首先Target里面選擇“Connection”連接目標(biāo)芯片,然后 Target--Auto進(jìn)行程序燒寫.SEGGER J-Links are the most widely used line of debug probes available today. They've proven their value for more than 10 years in embedded development. This popularity stems from the unparalleled performance, extensive feature set, large number of supported CPUs, and compatibility with all popular development environments.

    標(biāo)簽: JLINK

    上傳時(shí)間: 2022-03-22

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  • 中央空調(diào)溫度模糊集散控制系統(tǒng)設(shè)計(jì).rar

    集散控制系統(tǒng)(Distributing Control System,縮寫DCS)是以多個(gè)微處理機(jī)為基礎(chǔ)利用現(xiàn)代網(wǎng)絡(luò)技術(shù)、現(xiàn)代控制技術(shù)、圖形顯示技術(shù)等實(shí)現(xiàn)對分散控制系統(tǒng)的調(diào)節(jié)、監(jiān)視的控制技術(shù)。DCS具有功能分散,故障分散的優(yōu)點(diǎn),適合于上位機(jī)對多個(gè)下位機(jī)的管理和監(jiān)控。本文將DCS技術(shù)應(yīng)用到中央空調(diào)上,設(shè)計(jì)了中央空調(diào)的溫度模糊集散控制系統(tǒng)。 本系統(tǒng)在整體結(jié)構(gòu)上采用集散控制的方案。一臺控制計(jì)算機(jī)(上位機(jī))對各個(gè)空調(diào)房間的風(fēng)機(jī)和水泵進(jìn)行集中管理,若干臺下位機(jī)下放分散到現(xiàn)場實(shí)現(xiàn)分布式控制,上位機(jī)和各個(gè)下位機(jī)之間用控制網(wǎng)絡(luò)互連以實(shí)現(xiàn)相互之間的信息傳遞。 在控制策略上,針對被控量溫度的大慣性、時(shí)變性的特點(diǎn),本文設(shè)計(jì)了溫度的二維模糊控制策略,該策略是基于專家和有經(jīng)驗(yàn)的操作人員的經(jīng)驗(yàn)進(jìn)行調(diào)控的智能控制系統(tǒng)。模糊控制是以查詢模糊控制規(guī)則表的形式實(shí)現(xiàn),模糊控制表可以隨著人們的經(jīng)驗(yàn)和知識的增長日益完善。 根據(jù)總體方案,設(shè)計(jì)下位機(jī)即開關(guān)磁阻電機(jī)(SRM)控制節(jié)點(diǎn)和信號采集節(jié)點(diǎn)的軟、硬件。主要工作包括SRM的就地和遠(yuǎn)程兩種控制方式的實(shí)現(xiàn)、模/數(shù)和數(shù)/模轉(zhuǎn)換器的控制、模擬電壓的采集、溫度傳感器的選型、CAN網(wǎng)絡(luò)通信的硬、軟件,以及下位機(jī)的主程序的設(shè)計(jì)和調(diào)試等。 完成上述工作后,采用溫度開環(huán)和閉環(huán)分別進(jìn)行了試驗(yàn)。通過實(shí)驗(yàn)證明,所設(shè)計(jì)方案的可行性。最后對中央空調(diào)溫度控制系統(tǒng)的運(yùn)行性能進(jìn)行了總結(jié),對下一步用于該系統(tǒng)的研究與開發(fā)具有一定的參考價(jià)值。

    標(biāo)簽: 中央空調(diào) 溫度 模糊集

    上傳時(shí)間: 2013-04-24

    上傳用戶:yangzhiwei

  • 基于FPGA的全數(shù)字中頻接收機(jī)的研究與實(shí)現(xiàn).rar

    本論文基于直接擴(kuò)頻通信的理論設(shè)計(jì)了一種全數(shù)字的中頻接收機(jī),使用Xilinx公司的FPGA芯片xc3s400作為接收機(jī)的主芯片,實(shí)現(xiàn)中頻數(shù)字信號的下變頻,基帶解調(diào),PN碼的捕獲及跟蹤環(huán)路的設(shè)計(jì)并給出了它們的具體設(shè)計(jì)步驟及RTL級邏輯電路圖。本文對于數(shù)字下變頻器的設(shè)計(jì)、數(shù)字抑制載波恢復(fù)環(huán)的設(shè)計(jì)進(jìn)行了詳細(xì)的論述,還使用Matlab中的Simulink對本接收機(jī)系統(tǒng)所要使用的全數(shù)字Costas環(huán)進(jìn)行了功能仿真并給出了仿真結(jié)果。 本文使用高速模數(shù)轉(zhuǎn)換器AD9601對中頻模擬信號進(jìn)行采樣,最后再用高速數(shù)模轉(zhuǎn)換器AD9740還原出原始信息,并給出了它們與核心芯片xc3s400的接口設(shè)計(jì)方法及原理電路圖。

    標(biāo)簽: FPGA 全數(shù)字 中頻接收機(jī)

    上傳時(shí)間: 2013-07-30

    上傳用戶:weiwolkt

  • 16bit音頻過采樣DAC的FPGA設(shè)計(jì)實(shí)現(xiàn).rar

    基于∑-△噪聲整形技術(shù)和過采樣技術(shù)的數(shù)模轉(zhuǎn)換器(DAC)可以可靠地把數(shù)字信號轉(zhuǎn)換成為高精度的模擬信號。采用這一結(jié)構(gòu)進(jìn)行數(shù)模轉(zhuǎn)換具有諸多優(yōu)點(diǎn),例如極低的失配噪聲和高的可靠性,便于作為IP模塊嵌入到其他芯片系統(tǒng)中等,更重要的是可以得到其他DAC結(jié)構(gòu)所無法達(dá)到的精度和動(dòng)態(tài)范圍。在高精度測量、音頻轉(zhuǎn)換、汽車電子等領(lǐng)域有著廣泛的應(yīng)用價(jià)值。 由于非線性和不穩(wěn)定性的存在,高階∑-△調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn)存在較大的難度。本設(shè)計(jì)綜合大量文獻(xiàn)中的經(jīng)驗(yàn)原則和方法,首先闡述了∑-△調(diào)制器的一般原理,并討論了一般結(jié)構(gòu)調(diào)制器的設(shè)計(jì)過程,然后描述了穩(wěn)定的高階高精度調(diào)制器的設(shè)計(jì)流程。根據(jù)市場需求,設(shè)定了整個(gè)設(shè)計(jì)方案的性能指標(biāo),并據(jù)此設(shè)計(jì)了達(dá)到16bit精度和滿量程輸入范圍的三階128倍過采樣調(diào)制器。 本設(shè)計(jì)采用∑-△結(jié)構(gòu),根據(jù)系統(tǒng)要求設(shè)計(jì)了量化器位數(shù)、調(diào)制器過采樣比和階數(shù)。在分析高階單環(huán)路調(diào)制器穩(wěn)定性的基礎(chǔ)上,成功設(shè)計(jì)了六位量化三階單環(huán)路調(diào)制器結(jié)構(gòu)。在16比特的輸入信號下,達(dá)到了90dB左右的信噪比。該設(shè)計(jì)已經(jīng)在Cyclone系列FPGA器件下得到硬件實(shí)現(xiàn)和驗(yàn)證,并實(shí)現(xiàn)了實(shí)時(shí)音頻驗(yàn)證。測試表明,該DAC模塊輸出信號的信噪比能滿足16比特?cái)?shù)據(jù)轉(zhuǎn)換應(yīng)用的分辨率要求,并具備良好的兼容性和通用性。 本設(shè)計(jì)可作為IP核廣泛地在其他系統(tǒng)中進(jìn)行復(fù)用,具有很強(qiáng)的應(yīng)用性和一定的創(chuàng)新性。

    標(biāo)簽: FPGA bit DAC

    上傳時(shí)間: 2013-07-10

    上傳用戶:chuandalong

  • TLC5615(中文).rar

    這是12位串行數(shù)模轉(zhuǎn)換器,中文數(shù)據(jù)手冊。傳上來供大家分享。

    標(biāo)簽: 5615 TLC

    上傳時(shí)間: 2013-04-24

    上傳用戶:talenthn

  • 軟件無線電調(diào)制解調(diào)系統(tǒng)的研究及其FPGA實(shí)現(xiàn)

    軟件無線電是二十世紀(jì)九十年代提出的一種實(shí)現(xiàn)無線通信的體系結(jié)構(gòu),被認(rèn)為是繼模擬通信、數(shù)字通信之后的第三代無線電通信技術(shù)。它的中心思想是:構(gòu)造一個(gè)開放性、標(biāo)準(zhǔn)化、模塊化的通用硬件平臺,并使寬帶模數(shù)和數(shù)模轉(zhuǎn)換器盡可能靠近天線,從而將各種功能,如工作頻段、調(diào)制解調(diào)類型、數(shù)據(jù)格式、加密模式、通信協(xié)議等用軟件來完成。 本論文首先介紹了軟件無線電的基本原理和三種結(jié)構(gòu)形式,綜述了軟件無線電的幾項(xiàng)關(guān)鍵技術(shù)及其最新研究進(jìn)展。其中調(diào)制解調(diào)模塊是軟件無線電系統(tǒng)中的重要部分,集中體現(xiàn)了軟件無線電最顯著的優(yōu)點(diǎn)——靈活性。目前這一部分的技術(shù)實(shí)現(xiàn)手段多種多樣。隨著近幾年來芯片制造工藝的飛速發(fā)展,可編程器件FPGA以其高速的處理性能、高容量和靈活的可重構(gòu)能力,成為實(shí)現(xiàn)軟件無線電技術(shù)的重要手段。 本論文調(diào)制解調(diào)系統(tǒng)的設(shè)計(jì),選擇有代表性的16QAM和QPSK兩種方式作為研究對象,采用SystemView軟件作為系統(tǒng)級開發(fā)工具進(jìn)行集成化設(shè)計(jì)。在實(shí)現(xiàn)系統(tǒng)仿真和FPGA整體規(guī)劃后,著重分析用VHDL實(shí)現(xiàn)其中關(guān)鍵模塊以及利用嵌入FPGA的CPU核控制調(diào)制解調(diào)方式轉(zhuǎn)換的方法。同時(shí),在設(shè)計(jì)中成功地調(diào)用了Xilinx公司的IP核,實(shí)現(xiàn)了設(shè)計(jì)復(fù)用。由于FPGA內(nèi)部邏輯可以根據(jù)需要進(jìn)行重構(gòu),因而硬件的調(diào)試和升級變得很容易,而內(nèi)嵌CPU使信號處理過程可以用軟件進(jìn)行控制,充分體現(xiàn)了軟件無線電的靈活性。 通過本論文的研究,初步驗(yàn)證了在FPGA內(nèi)實(shí)現(xiàn)數(shù)字調(diào)制解調(diào)過程及控制的技術(shù)可行性和應(yīng)用的靈活性,并對將來的擴(kuò)展問題進(jìn)行了研究和討論,為實(shí)現(xiàn)完整的軟件無線電系統(tǒng)奠定了基礎(chǔ)。

    標(biāo)簽: FPGA 軟件無線電 調(diào)制解調(diào)

    上傳時(shí)間: 2013-06-10

    上傳用戶:xhz1993

  • 軟件無線電調(diào)制解調(diào)系統(tǒng)的研究及其FPGA實(shí)現(xiàn)

    軟件無線電是二十世紀(jì)九十年代提出的一種實(shí)現(xiàn)無線通信的體系結(jié)構(gòu),被認(rèn)為是繼模擬通信、數(shù)字通信之后的第三代無線電通信技術(shù)。它的中心思想是:構(gòu)造一個(gè)開放性、標(biāo)準(zhǔn)化、模塊化的通用硬件平臺,并使寬帶模數(shù)和數(shù)模轉(zhuǎn)換器盡可能靠近天線,從而將各種功能,如工作頻段、調(diào)制解調(diào)類型、數(shù)據(jù)格式、加密模式、通信協(xié)議等用軟件來完成。 本論文首先介紹了軟件無線電的基本原理和三種結(jié)構(gòu)形式,綜述了軟件無線電的幾項(xiàng)關(guān)鍵技術(shù)及其最新研究進(jìn)展。其中調(diào)制解調(diào)模塊是軟件無線電系統(tǒng)中的重要部分,集中體現(xiàn)了軟件無線電最顯著的優(yōu)點(diǎn)——靈活性。目前這一部分的技術(shù)實(shí)現(xiàn)手段多種多樣。隨著近幾年來芯片制造工藝的飛速發(fā)展,可編程器件FPGA以其高速的處理性能、高容量和靈活的可重構(gòu)能力,成為實(shí)現(xiàn)軟件無線電技術(shù)的重要手段。 本論文調(diào)制解調(diào)系統(tǒng)的設(shè)計(jì),選擇有代表性的16QAM和QPSK兩種方式作為研究對象,采用SystemView軟件作為系統(tǒng)級開發(fā)工具進(jìn)行集成化設(shè)計(jì)。在實(shí)現(xiàn)系統(tǒng)仿真和FPGA整體規(guī)劃后,著重分析用VHDL實(shí)現(xiàn)其中關(guān)鍵模塊以及利用嵌入FPGA的CPU核控制調(diào)制解調(diào)方式轉(zhuǎn)換的方法。同時(shí),在設(shè)計(jì)中成功地調(diào)用了Xilinx公司的IP核,實(shí)現(xiàn)了設(shè)計(jì)復(fù)用。由于FPGA內(nèi)部邏輯可以根據(jù)需要進(jìn)行重構(gòu),因而硬件的調(diào)試和升級變得很容易,而內(nèi)嵌CPU使信號處理過程可以用軟件進(jìn)行控制,充分體現(xiàn)了軟件無線電的靈活性。 通過本論文的研究,初步驗(yàn)證了在FPGA內(nèi)實(shí)現(xiàn)數(shù)字調(diào)制解調(diào)過程及控制的技術(shù)可行性和應(yīng)用的靈活性,并對將來的擴(kuò)展問題進(jìn)行了研究和討論,為實(shí)現(xiàn)完整的軟件無線電系統(tǒng)奠定了基礎(chǔ)。

    標(biāo)簽: FPGA 軟件無線電 調(diào)制解調(diào)

    上傳時(shí)間: 2013-04-24

    上傳用戶:libenshu01

  • 可重構(gòu)24bit音頻過采樣DAC的FPGA

    基于過采樣和∑-△噪聲整形技術(shù)的DAC能夠可靠地把數(shù)字信號轉(zhuǎn)換為高精度的模擬信號(大于等于16位)。采用這一架構(gòu)進(jìn)行數(shù)模轉(zhuǎn)換具有諸多優(yōu)點(diǎn),例如極低的失配噪聲和更高的可靠性,便于實(shí)現(xiàn)嵌入式集成等,最重要的是可以得到其他DAC結(jié)構(gòu)所無法達(dá)到的精度和動(dòng)態(tài)范圍。在高精度測量,音頻轉(zhuǎn)換,汽車電子等領(lǐng)域有著廣泛的應(yīng)用價(jià)值。 本文采用∑-△結(jié)構(gòu)以FPGA方式實(shí)現(xiàn)了一個(gè)具有高精度的數(shù)模轉(zhuǎn)換器,在24比特的輸入信號下,達(dá)到了約150dB的信噪比。作為一個(gè)靈活的音頻DAC實(shí)現(xiàn)方案。該DAC可以對CD/DVD/HDCD/SACD等多種制式下的音頻信號進(jìn)行處理,接受并轉(zhuǎn)換采樣率為32/44.1/48/88.2/96/192kHz,字長為16/18/20/24比特的PCM數(shù)據(jù),具備良好的兼容性和通用性。 由于非線性和不穩(wěn)定性的存在,高階∑-△調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn)存在較大的難度。本文綜合大量文獻(xiàn)中的經(jīng)驗(yàn)原則和方法,闡述了穩(wěn)定的高階高精度調(diào)制器的設(shè)計(jì)流程;并據(jù)此設(shè)計(jì)了達(dá)到24bit精度和滿量程輸入范圍的的5階128倍調(diào)制器。本文創(chuàng)新性地提出了∑-△調(diào)制器的一種高效率流水線實(shí)現(xiàn)結(jié)構(gòu)。分析表明,與其他常見的∑-△調(diào)制器實(shí)現(xiàn)結(jié)構(gòu)相比,本方案具有結(jié)構(gòu)簡單、運(yùn)算單元少等優(yōu)點(diǎn);此外在同樣信號采樣率下,調(diào)制器所需的時(shí)鐘頻率大大降低。 文中的過采樣濾波模塊采用三級半帶濾波器和一個(gè)可變CIC濾波器級聯(lián)組成,可以達(dá)到最高128倍的過采樣比,同時(shí)具有良好的通帶和阻帶特性。在半帶濾波器的設(shè)計(jì)中采用了CSD編碼,使結(jié)構(gòu)得到了充分的簡化。 本文提出的過采樣DAC方案具有可重配置結(jié)構(gòu),讓使用者能夠方便地控制過采樣比和調(diào)制器階數(shù)。通過積分梳狀濾波器的配置,能夠獲得32/64/128倍的不同過采樣比,從而實(shí)現(xiàn)對于32~192kHz多種采樣率輸入的處理。在不同輸入字長情況下,通過調(diào)制器的重構(gòu),則可以將調(diào)制器由高精度的5階模式改變?yōu)楣母偷?階模式,滿足不同分辨率信號輸入時(shí)的不同精度要求。這是本文的另一創(chuàng)新之處。 目前,該過采樣DAC已經(jīng)在XilinxVirtexⅡ系列FPGA器件下得到硬件實(shí)現(xiàn)和驗(yàn)證。測試表明,對于從32kHz到192kHz的不同輸入信號,該DAC模塊輸出1比特碼流的帶內(nèi)信噪比均能滿足24比特?cái)?shù)據(jù)轉(zhuǎn)換應(yīng)用的分辨率要求。

    標(biāo)簽: FPGA bit DAC 24

    上傳時(shí)間: 2013-07-08

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  • PCF8591模數(shù)數(shù)模轉(zhuǎn)換器的應(yīng)用

    PCF8591數(shù)碼資料

    標(biāo)簽: 8591 PCF 模數(shù) 數(shù)模轉(zhuǎn)換器

    上傳時(shí)間: 2013-11-21

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