隨著世界經(jīng)濟(jì)的高速發(fā)展、人口的增長和科技的進(jìn)步，傳統(tǒng)能源的消耗量越來越大，這就帶來了一系列能源的耗盡和環(huán)境污染問題。太陽能作為一種優(yōu)越的可再生能源而受到世界各國的重視并具有較大發(fā)展?jié)摿Α榱诉M(jìn)一步提高系統(tǒng)的性能，實(shí)現(xiàn)系統(tǒng)的優(yōu)化及可靠運(yùn)行，本文研究獨(dú)立運(yùn)行光伏發(fā)電系統(tǒng)的結(jié)構(gòu)、工作原理和控制策略。相對并網(wǎng)系統(tǒng)，這對于國家正大力發(fā)展的西部太陽能資源開發(fā)來說是具有現(xiàn)實(shí)意義的。 首先，本文詳細(xì)介紹了光伏發(fā)電的國內(nèi)外研究背景，光伏電池的種類、發(fā)電原理及輸出特性，并介紹了獨(dú)立運(yùn)行光伏發(fā)電系統(tǒng)的組成、運(yùn)行原理和應(yīng)用，在此基礎(chǔ)上論述了光伏系統(tǒng)常用的DC/DC變換電路，負(fù)載最大功率跟蹤（MPPT）的方法等人們普遍關(guān)注的問題。融合了上述原理技術(shù)，設(shè)計一個功率為25W的獨(dú)立運(yùn)行光伏發(fā)電系統(tǒng)。 其次，為減小傳統(tǒng)的固定步長的擾動法進(jìn)行最大功率跟蹤的步長大振蕩大，步長小跟蹤速度慢的缺陷，本文提出了電壓自適應(yīng)最大功率跟蹤算法，其原理是引入了不同的步長系數(shù)，根據(jù)功率變量值的大小，確定合適的控制步長進(jìn)行電壓參考值的給定，并在MATLAB環(huán)境下利用Simulink工具搭建模型進(jìn)行仿真，仿真結(jié)果驗證了此種跟蹤方法具有快速性、穩(wěn)定性和準(zhǔn)確性等優(yōu)點(diǎn)。 最后，搭建硬件電路，通過對電池板的不同安裝角度測量得到的數(shù)據(jù)，得出不同季節(jié)在大連地區(qū)安裝的不同最佳角度值。設(shè)計了25W的獨(dú)立運(yùn)行光伏發(fā)電系統(tǒng)的主電路及其控制電路，包括光伏電池的選擇，Boost主電路參數(shù)、控制電路部分、驅(qū)動電路及其檢測電路各模塊分別進(jìn)行了詳細(xì)的探討；對獨(dú)立系統(tǒng)的儲能裝置蓄電池的充放電電路進(jìn)行了設(shè)計，利用單片機(jī)dsPIC30F3011控制電路同時實(shí)現(xiàn)了最大功率跟蹤和蓄電池的充電電壓、放電極限電壓及充電電流的控制，可防止過充過放現(xiàn)象的發(fā)生，從而實(shí)現(xiàn)獨(dú)立光伏發(fā)電系統(tǒng)的可靠運(yùn)行。
標(biāo)簽： 獨(dú)立 光伏發(fā)電系統(tǒng) 運(yùn)行
上傳時間： 2013-04-24
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斷路器是電力系統(tǒng)中重要的控制和保護(hù)設(shè)備，對維護(hù)電力系統(tǒng)的安全、穩(wěn)定和可靠運(yùn)行起著重要的作用。如何使斷路器高度智能化，并且更安全和可靠，是電力系統(tǒng)保護(hù)的發(fā)展要求，也是本論文研究的目的。 本文在深入研究了智能斷路器國內(nèi)外發(fā)展?fàn)顩r的基礎(chǔ)上，精心設(shè)計了以數(shù)字信號處理器DSP和復(fù)雜可編程邏輯器件CPLD為核心的系統(tǒng)硬件。DSP是智能斷路器測控單元的核心器件，它實(shí)現(xiàn)斷路器的各種保護(hù)、報警、顯示與控制功能。CPLD完成狀態(tài)量的監(jiān)測，以及各種邏輯信號的輸出。兩種器件相互配合使得斷路器系統(tǒng)更加智能化。研究了斷路器測控單元的測量原理及保護(hù)算法，并進(jìn)行了具體的硬件和軟件模塊的設(shè)計，旨在實(shí)現(xiàn)斷路器的智能保護(hù)、遠(yuǎn)程控制和集中管理。本設(shè)計以TI公司的DSP芯片TMS320LF2407為核心。硬件設(shè)計主要包括信號調(diào)理模塊設(shè)計、信號采樣模塊設(shè)計、保護(hù)執(zhí)行模塊設(shè)計、CPLD模塊設(shè)計和輸入輸出模塊設(shè)計。并且利用TMS320LF2407本身具有的CAN2.0模塊，通過CAN總線實(shí)現(xiàn)斷路器和上位機(jī)的通信，實(shí)現(xiàn)遙測、遙調(diào)、遙控、遙信等“四遙”功能。軟件采用模塊化設(shè)計，每一個模塊相對獨(dú)立，完成某個特定功能，便于維護(hù)和添加新功能，并且調(diào)試靈活方便。文中給出了主程序及各個子程序的流程圖，其中子程序有數(shù)據(jù)采集子程序、FFT計算子程序、液晶顯示子程序、短路瞬時保護(hù)子程序、過載長延時保護(hù)子程序、接地故障保護(hù)子程序和短路短延時保護(hù)子程序等。并且設(shè)計中充分考慮了斷路器工作環(huán)境的惡劣性，分析了各種干擾的來源，并針對各種干擾采取了對應(yīng)的軟件和硬件的抗干擾措施。最后，為了驗證全波傅氏算法能否滿足電網(wǎng)數(shù)據(jù)處理精度的要求，利用MATLAB搭建仿真平臺，對其進(jìn)行了仿真。結(jié)果表明全波傅氏算法能達(dá)到系統(tǒng)的要求。
標(biāo)簽： 智能斷路器 關(guān)鍵技術(shù)
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現(xiàn)場可編程門陣列(FPGA，F(xiàn)ield Programmable Gate Array)是可編程邏輯器件的一種，它的出現(xiàn)是隨著微電子技術(shù)的發(fā)展，設(shè)計與制造集成電路的任務(wù)已不完全由半導(dǎo)體廠商來獨(dú)立承擔(dān)。系統(tǒng)設(shè)計師們更愿意自己設(shè)計專用集成電路(ASIC，Application Specific Integrated Circuit)．芯片，而且希望ASIC的設(shè)計周期盡可能短，最好是在實(shí)驗室里就能設(shè)計出合適的ASIC芯片，并且立即投入實(shí)際應(yīng)用之中。現(xiàn)在，F(xiàn)PGA已廣泛地運(yùn)用于通信領(lǐng)域、消費(fèi)類電子和車用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個大模塊之一，它的主要作用是提供封裝引腳到CLB之間的接口，將外部信號引入FPGA內(nèi)部進(jìn)行邏輯功能的實(shí)現(xiàn)并把結(jié)果輸出給外部電路，并且根據(jù)需要可以進(jìn)行配置來支持多種不同的接口標(biāo)準(zhǔn)。FPGA允許使用者通過不同編程來配置實(shí)現(xiàn)各種邏輯功能，在IO端口中它可以通過選擇配置方式來兼容不同信號標(biāo)準(zhǔn)的I/O緩沖器電路。總體而言，可選的I/O資源的特性包括：IO標(biāo)準(zhǔn)的選擇、輸出驅(qū)動能力的編程控制、擺率選擇、輸入延遲和維持時間控制等。 本文是關(guān)于FPGA中多標(biāo)準(zhǔn)兼容可編程輸入輸出電路(Input/Output Block)的設(shè)計和實(shí)現(xiàn)，該課題是成都華微電子系統(tǒng)有限公司FPGA大項目中的一子項，目的為在更新的工藝水平上設(shè)計出能夠兼容單端標(biāo)準(zhǔn)的I/O電路模塊；同時針對以前設(shè)計的I/O模塊不支持雙端標(biāo)準(zhǔn)的缺點(diǎn)，要求新的電路模塊中擴(kuò)展出雙端標(biāo)準(zhǔn)的部分。文中以低壓雙端差分標(biāo)準(zhǔn)(LVDS)為代表構(gòu)建雙端標(biāo)準(zhǔn)收發(fā)轉(zhuǎn)換電路，與單端標(biāo)準(zhǔn)比較，LVDS具有很多優(yōu)點(diǎn)： (1)LVDS傳輸?shù)男盘枖[幅小，從而功耗低，一般差分線上電流不超過4mA，負(fù)載阻抗為100Ω。這一特征使它適合做并行數(shù)據(jù)傳輸。 (2)LVDS信號擺幅小，從而使得該結(jié)構(gòu)可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號電壓可以從0V到2.4V變化，單端信號擺幅為400mV，這樣允許輸入共模電壓從0.2V到2.2V范圍內(nèi)變化，也就是說LVDS允許收發(fā)兩端地電勢有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝，輔助Xilinx公司FPGA開發(fā)軟件ISE，設(shè)計完成了可以用于Virtex系列各低端型號FPGA的IOB結(jié)構(gòu)，它有靈活的可配置性和出色的適應(yīng)能力，能支持大量的I/O標(biāo)準(zhǔn)，其中包括單端標(biāo)準(zhǔn)，也包括雙端標(biāo)準(zhǔn)如LVDS等。它具有適應(yīng)性的優(yōu)點(diǎn)、可選的特性和考慮到被文件描述的硬件結(jié)構(gòu)特征，這些特點(diǎn)可以改進(jìn)和簡化系統(tǒng)級的設(shè)計，為最終的產(chǎn)品設(shè)計和生產(chǎn)打下基礎(chǔ)。設(shè)計中對包括20種IO標(biāo)準(zhǔn)在內(nèi)的各電器參數(shù)按照用戶手冊描述進(jìn)行仿真驗證，性能參數(shù)已達(dá)到預(yù)期標(biāo)準(zhǔn)。
標(biāo)簽： FPGA 標(biāo)準(zhǔn) 可編程
上傳時間： 2013-05-15
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本文研究的視頻處理系統(tǒng)是上海市科委技術(shù)攻關(guān)基金項目“計算機(jī)視覺及其芯片化實(shí)現(xiàn)”的一部分，主要完成計算機(jī)視覺系統(tǒng)的一些基本工作，即視頻圖像的采集、預(yù)處理和顯示等。 視頻圖像采集和預(yù)處理系統(tǒng)以Xilinx公司Virtex-ⅡPro系列的FPGA為核心控制器件，結(jié)合視頻模數(shù)轉(zhuǎn)換芯片和VGA顯示器，完成視頻圖像的實(shí)時采集、預(yù)處理和顯示。采集和顯示部分作為同外界交流信息的渠道，是構(gòu)成計算機(jī)視覺系統(tǒng)必不可少的一部分；圖像預(yù)處理則是計算機(jī)視覺系統(tǒng)進(jìn)行高層處理的基礎(chǔ)，優(yōu)秀的預(yù)處理算法能有效改善圖像質(zhì)量，提高系統(tǒng)分析判斷的準(zhǔn)確性。 本文在介紹基于FPGA的視頻采集、預(yù)處理系統(tǒng)整體架構(gòu)的基礎(chǔ)上，圍繞以下四個方面展開了工作： 1.研究并給出了兩種基于FPGA的設(shè)計方案用于實(shí)現(xiàn)YCrCb色度空間到RGB色度空間的轉(zhuǎn)換； 2.針對采集的視頻圖像，根據(jù)VGA顯示的要求，給出了一種實(shí)現(xiàn)圖像去隔行的方案； 3.分析了一系列圖像濾波的預(yù)處理算法，如均值濾波、中值濾波和自適應(yīng)濾波等，在比較和總結(jié)各算法特點(diǎn)的基礎(chǔ)上，提出了一種新的適用于處理混合噪聲的濾波算法：混合自適應(yīng)濾波法； 4.根據(jù)算法特點(diǎn)設(shè)計了多種采用FPGA實(shí)現(xiàn)的圖像濾波算法，并對硬件算法進(jìn)行RTL級的功能仿真和驗證，還給出了各種濾波算法的實(shí)驗結(jié)果，在此基礎(chǔ)上對各種算法的效果進(jìn)行直觀的比較。 文中，預(yù)處理算法的實(shí)現(xiàn)充分利用了FPGA的片內(nèi)資源，體現(xiàn)了FPGA在圖像處理方面的特點(diǎn)及優(yōu)勢。同時，視頻采集和顯示的控制模塊也由同一FPGA芯片實(shí)現(xiàn)，從而簡化了系統(tǒng)整體結(jié)構(gòu)。視頻采集和預(yù)處理系統(tǒng)在FPGA上的成功實(shí)現(xiàn)為“計算機(jī)視覺及其芯片化實(shí)現(xiàn)”奠定了必要的基礎(chǔ)、提供了一定理論依據(jù)。
標(biāo)簽： FPGA 視頻圖像
上傳時間： 2013-07-26
上傳用戶：alia
ARM嵌入式技術(shù)在工業(yè)和生活中正得到越來越廣泛的應(yīng)用，為了適應(yīng)技術(shù)的發(fā)展和社會的需求，滿足為社會培養(yǎng)創(chuàng)新型人才的需要，高校通信類和電子類專業(yè)開設(shè)ARM嵌入式技術(shù)相關(guān)課程及其實(shí)驗課程將成為趨勢。在課程中設(shè)置合理實(shí)驗，可以有效提高學(xué)生的動手能力和培養(yǎng)創(chuàng)新性思維，幫助學(xué)生更快、更好地掌握理論和應(yīng)用技術(shù)。 論文設(shè)計的ARM嵌入式教學(xué)實(shí)驗系統(tǒng)包括一塊適合普通高校嵌入式技術(shù)實(shí)驗課程教學(xué)的實(shí)驗開發(fā)板及其配套的實(shí)驗。該實(shí)驗系統(tǒng)針對一般高校所開設(shè)的ARM嵌入式技術(shù)相關(guān)課程的要求而設(shè)計，配套實(shí)驗符合教學(xué)大綱及實(shí)驗課時的要求。 論文設(shè)計的實(shí)驗開發(fā)板主要組成模塊有：最小系統(tǒng)，包括控制器模塊、電源模塊、復(fù)位模塊、Flash ROM模塊、SDRAM模塊、JTAG接口等；擴(kuò)展接口，包括LED、鍵盤、RS232串口、I2C接口、液晶模塊、以太網(wǎng)模塊等。實(shí)驗開發(fā)板采用S3C4510B網(wǎng)絡(luò)控制芯片用作控制和信號處理，使用網(wǎng)絡(luò)接口芯片DM9161和隔離變壓器H1102完成網(wǎng)絡(luò)接入，使用AM29LV160和HY57V641620HG構(gòu)建16位存儲單元，使用AT24C01和PCF8583來構(gòu)建I2C接口，使用MAX232完成TTL電平轉(zhuǎn)換以擴(kuò)展RS232串口，并擴(kuò)展鍵盤和LCD實(shí)現(xiàn)人機(jī)交互。實(shí)驗開發(fā)板的硬件設(shè)計充分考慮了一般高校實(shí)驗室的條件和需求，能夠較好地將成本控制在150元左右，有利于在有限的條件下為每個學(xué)生盡可能的創(chuàng)造動手制作PCB的實(shí)驗條件。實(shí)驗板的接口設(shè)計能夠讓學(xué)生較為方便地開展實(shí)驗，并考慮了實(shí)驗板擴(kuò)展和二次開發(fā)的需要。 論文設(shè)計的實(shí)驗系統(tǒng)配套實(shí)驗主要有基礎(chǔ)實(shí)驗、擴(kuò)展實(shí)驗和設(shè)計實(shí)驗。基礎(chǔ)實(shí)驗主要幫助學(xué)生熟悉嵌入式系統(tǒng)的片內(nèi)資源和特殊功能寄存器的配置方法，對整個嵌入式系統(tǒng)的架構(gòu)有一定的理解，能編程完成一些簡單的控制功能；擴(kuò)展實(shí)驗主要幫助學(xué)生建立嵌入式系統(tǒng)開發(fā)和設(shè)計的基本理念，能夠設(shè)計和實(shí)現(xiàn)常見的外設(shè)驅(qū)動程序，能夠進(jìn)行操作系統(tǒng)的配置和移植，能夠自行對實(shí)驗板進(jìn)行一定程度的擴(kuò)展；設(shè)計實(shí)驗?zāi)軌驇椭鷮W(xué)生提高嵌入式系統(tǒng)的設(shè)計開發(fā)能力，使學(xué)生能根據(jù)需要設(shè)計出實(shí)現(xiàn)一定功能的擴(kuò)展模塊，從而使實(shí)驗板擴(kuò)展成實(shí)現(xiàn)具體功能的工業(yè)產(chǎn)品。基礎(chǔ)實(shí)驗包括ADS集成環(huán)境實(shí)驗、鍵盤實(shí)驗（GPIO輸入）、LED實(shí)驗（GPIO輸出）、定時器實(shí)驗、外部中斷實(shí)驗、UART串口通信實(shí)驗、I2C接口實(shí)驗、液晶顯示實(shí)驗；擴(kuò)展實(shí)驗包括建立交叉編譯環(huán)境實(shí)驗、操作系統(tǒng)編譯實(shí)驗、操作系統(tǒng)移植實(shí)驗、以太網(wǎng)通信實(shí)驗、TFTP實(shí)驗、WEB訪問實(shí)驗；設(shè)計實(shí)驗包括TCP/IP協(xié)議棧實(shí)驗、Web服務(wù)器實(shí)驗。學(xué)生通過完成基礎(chǔ)實(shí)驗、擴(kuò)展實(shí)驗和設(shè)計實(shí)驗來達(dá)到教學(xué)大綱的要求，并可以在此基礎(chǔ)上進(jìn)行更深入的創(chuàng)新性開發(fā)實(shí)驗，可以滿足一般高校嵌入式技術(shù)實(shí)驗課程教學(xué)的需要。 論文介紹了嵌入式交叉編譯環(huán)境的建立以及實(shí)驗開發(fā)板設(shè)計完成后進(jìn)行的調(diào)試。實(shí)驗開發(fā)板移植的嵌入式操作系統(tǒng)為uClinux，采用的Bootloader為U-boot。論文還簡單介紹了實(shí)驗系統(tǒng)的擴(kuò)展方案和二次開發(fā)方案，并對嵌入式新技術(shù)的發(fā)展做了粗淺的探討。 論文所做的工作以科學(xué)發(fā)展觀為指導(dǎo)，是對普通高校ARM嵌入式技術(shù)實(shí)驗課程設(shè)計的一次有益探索。
標(biāo)簽： ARM 嵌入式 教學(xué)實(shí)驗系統(tǒng)
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近幾年來，隨著國內(nèi)經(jīng)濟(jì)的迅速發(fā)展，社會用電需求不斷擴(kuò)大。但由于電網(wǎng)建設(shè)長期滯后于市場和經(jīng)濟(jì)的發(fā)展，電力短缺的問題日益嚴(yán)重。因此，在電力緊缺已成事實(shí)的情況下，電力公司開始重視起負(fù)荷管理系統(tǒng)。思想觀念也從“拉閘限電”轉(zhuǎn)變?yōu)椤坝行蛴秒姟㈠e峰用電”，從“負(fù)荷控制”轉(zhuǎn)變?yōu)椤斑h(yuǎn)方抄表、異常監(jiān)測和用電服務(wù)”。 電力負(fù)荷管理系統(tǒng)是以計算機(jī)應(yīng)用技術(shù)、現(xiàn)代通信技術(shù)、電力自動控制技術(shù)為基礎(chǔ)的信息采集、處理和實(shí)時監(jiān)控系統(tǒng)。由系統(tǒng)主站、客戶端負(fù)荷管理終端和主站與終端間的通信信道組成。通過有效的負(fù)荷管理，可以有效控制高峰負(fù)荷、移峰填谷、緩解日益擴(kuò)大的“峰谷差”所帶來的低用電效率，也對提高電力負(fù)荷的經(jīng)濟(jì)運(yùn)行、減少電力供應(yīng)側(cè)的運(yùn)行成本、解決大面積的電荒問題都具有現(xiàn)實(shí)和長遠(yuǎn)的好處。 論文簡要介紹了電力負(fù)荷管理系統(tǒng)的發(fā)展歷史以及電力負(fù)荷管理終端的目前發(fā)展技術(shù)，詳細(xì)介紹了針對國內(nèi)電力市場的需求，提出的電力負(fù)荷管理終端的總體設(shè)計方案和詳細(xì)的電路設(shè)計。 論文最后結(jié)合目前國內(nèi)電力負(fù)荷管理終端的入網(wǎng)測試檢驗，對各種試驗的難點(diǎn)進(jìn)行分析及采取解決措施進(jìn)行介紹，并對部分用戶提出的特殊指標(biāo)提出了解決方案。
標(biāo)簽： ARM 電力負(fù)荷 終端設(shè)計
上傳時間： 2013-05-18
上傳用戶：shus521
標(biāo)簽： FPGA 視頻圖像 采集
上傳用戶：我好難過
Max+plusⅡ是Altera公司提供的FPGA/CPLD開發(fā)集成環(huán)境，Altera是世界上最大可編程邏輯器件的供應(yīng)商之一。Max+plusⅡ界面友好，使用便捷，被譽(yù)為業(yè)界最易用易學(xué)的EDA軟件。在Max+plusⅡ上可以完成設(shè)計輸入、元件適配、時序仿真和功能仿真、編程下載整個流程，它提供了一種與結(jié)構(gòu)無關(guān)的設(shè)計環(huán)境，是設(shè)計者能方便地進(jìn)行設(shè)計輸入、快速處理和器件編程。
標(biāo)簽： 10.230 PLUSII MAX
上傳時間： 2013-07-31
上傳用戶：小強(qiáng)mmmm
ispLEVER2.0是一套完整的EDA軟件。設(shè)計輸入可采用原理圖、硬件描述語言、混合輸入三種方式。能對所設(shè)計的數(shù)字電子系統(tǒng)進(jìn)行功能仿真和時序仿真。編譯器是此軟件的核心，能進(jìn)行邏輯優(yōu)化，將邏輯映射到器件中去，自動完成布局與布線并生成編程所需要的熔絲圖件。軟件支持原有Lattice公司的GAL、ispLSI、MACH、ispGDX、ORCA2、ORCA3、ORCA4和最新的ispMACH器件。Xilinx.ISE.Design.Suite（北京市電子設(shè)計競賽指定軟件）
標(biāo)簽： ispLEVER2
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"目前WinCE5.0的開發(fā)工具主要有以下幾種:Platform Builder5.0、EVC4.0+SP4、Visual Studio2005。其中Platform Builder主要用于定制WinCE操作系統(tǒng)，它也可以用來編寫驅(qū)動程序和應(yīng)用程序。EVC顧名思義就是嵌入式版的VC，它主要用來開發(fā)應(yīng)用程序，當(dāng)然也可用來編寫驅(qū)動程序。Visual Studio2005是微軟的集大成開發(fā)工具。它能用來定制WinCE6.0的操作系統(tǒng)，也可以用來開發(fā)應(yīng)用和驅(qū)動程序。"
標(biāo)簽： wince 5.0
上傳時間： 2013-07-28
上傳用戶：gengxiaochao
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