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  • 數(shù)字信號處理選擇指南pdf

    德州儀器 (TI) 處理器幾乎能滿足您所能想到的各種應(yīng)用需求。我們陣營強(qiáng)大的處理器系列擁有各種價位、性能及功耗的產(chǎn)品可供選擇,能滿足幾乎任何數(shù)字電子設(shè)計的要求。利用 TI 廣博的系統(tǒng)專業(yè)知識、針對外設(shè)設(shè)計的全方位支持以及隨時可方便獲得的全套軟件與配套模擬組件,您能夠?qū)崿F(xiàn)無窮無盡的設(shè)計方案。德州儀器 2008 年第二季度 數(shù)字信號處理選擇指南TI 數(shù)字信號處理技術(shù)介紹1Ô數(shù)字媒體處理器OMAP應(yīng)用處理器C6000數(shù)字信號處理器C5000數(shù)字信號處理器C2000數(shù)字信號處理器MSP430微控制器音頻汽車通信工業(yè)醫(yī)療安全監(jiān)控視頻無線主要特性完整的定制型視頻解決方案低功耗與高性能高性能低功耗與高性能結(jié)合高性能與高集成度可實(shí)現(xiàn)更環(huán)保的工業(yè)應(yīng)用超低功耗達(dá)芬奇數(shù)字媒體處理器:針對數(shù)字視頻而精心優(yōu)化達(dá)芬奇 (DaVinci) 技術(shù)包括可擴(kuò)展的可編程信號處理片上系統(tǒng) (SoC)、加速器與外設(shè),專為滿足各種視頻終端設(shè)備在性價比與特性方面的要求進(jìn)行了優(yōu)化。最新的 OMAP™ 應(yīng)用處理器:最佳的通用多媒體與圖形功能TI 高度可擴(kuò)展的 OMAP 平臺能夠以任何單芯片組合實(shí)現(xiàn)業(yè)界通用多媒體與圖形處理功能的最佳組合。最新推出的四款 OMAP35x 器件的目標(biāo)應(yīng)用非常廣泛,其中包括便攜式導(dǎo)航設(shè)備、因特網(wǎng)設(shè)備、便攜式媒體播放器以及個人醫(yī)療設(shè)備等。最高性能:TMS320C6000™ DSP平臺C6000™ DSP 平臺可提供業(yè)界最高性能的定點(diǎn)與浮點(diǎn) DSP,理想適用于視頻、影像、寬帶基礎(chǔ)局端以及高性能音頻等應(yīng)用領(lǐng)域。低功耗與高性能相結(jié)合:TMS320C5000™ DSP 平臺C5000™ DSP 平臺不僅可提供業(yè)界最低的待機(jī)功耗,同時還支持高級自動化電源管理,能夠充分滿足諸如數(shù)字音樂播放器、VoIP、免提終端附件、GPS 接收機(jī)以及便攜式醫(yī)療設(shè)備等個人及便攜式產(chǎn)品的需求。結(jié)合類似 MCU 的控制功能與DSP 的高性能:TMS320C2000™數(shù)字信號控制器C2000™ 數(shù)字信號控制器 (DSC) 平臺融合了控制外設(shè)的集成功能與微控制器 (MCU) 的易用性,以及 TI 先進(jìn)DSP 技術(shù)的處理能力和 C 語言編程效率。C2000 DSC 理想適用于嵌入式工業(yè)應(yīng)用,如數(shù)字馬達(dá)控制、數(shù)字電源以及智能傳感器等。MSP430 超低功耗微控制器平臺TI MSP430 系列超低功耗 16 位 RISC 混合信號處理器可為電池供電的測量應(yīng)用提供具有終極性能的解決方案。TI充分發(fā)揮自身在混合信號與數(shù)字技術(shù)領(lǐng)域卓越的領(lǐng)先優(yōu)勢, 推出的MSP430 使系統(tǒng)設(shè)計人員不僅能夠同時實(shí)現(xiàn)與模擬信號、傳感器與數(shù)字組件的接口相連,而且還能實(shí)現(xiàn)無與倫比的低功耗。輕松易用的軟件與開發(fā)工具對于加速 DSP 產(chǎn)品開發(fā)而言,TMS320™ DSP 獲得了 eXpressDSP™ 軟件與開發(fā)工具的支持,其中包括Code Composer Studio™ IDE、DSP/BIOS™內(nèi)核、TMS320 DSP 算法標(biāo)準(zhǔn)以及眾多可重復(fù)使用的模塊化軟件等,均來自業(yè)界最大規(guī)模開發(fā)商網(wǎng)絡(luò)。配套模擬產(chǎn)品TI 可提供各種配套的數(shù)據(jù)轉(zhuǎn)換器、電源管理、放大器、接口與邏輯產(chǎn)品,能夠充分滿足您設(shè)計的整體需求。

    標(biāo)簽: 數(shù)字信號處理 選擇指南

    上傳時間: 2013-10-14

    上傳用戶:jasson5678

  • Xilinx UltraScale:為您未來架構(gòu)而打造的新一代架構(gòu)

      Xilinx UltraScale™ 架構(gòu)針對要求最嚴(yán)苛的應(yīng)用,提供了前所未有的ASIC級的系統(tǒng)級集成和容量。    UltraScale架構(gòu)是業(yè)界首次在All Programmable架構(gòu)中應(yīng)用最先進(jìn)的ASIC架構(gòu)優(yōu)化。該架構(gòu)能從20nm平面FET結(jié)構(gòu)擴(kuò)展至16nm鰭式FET晶體管技術(shù)甚至更高的技術(shù),同 時還能從單芯片擴(kuò)展到3D IC。借助Xilinx Vivado®設(shè)計套件的分析型協(xié)同優(yōu)化,UltraScale架構(gòu)可以提供海量數(shù)據(jù)的路由功能,同時還能智能地解決先進(jìn)工藝節(jié)點(diǎn)上的頭號系統(tǒng)性能瓶頸。 這種協(xié)同設(shè)計可以在不降低性能的前提下達(dá)到實(shí)現(xiàn)超過90%的利用率。   UltraScale架構(gòu)的突破包括:   • 幾乎可以在晶片的任何位置戰(zhàn)略性地布置類似于ASIC的系統(tǒng)時鐘,從而將時鐘歪斜降低達(dá)50%   • 系統(tǒng)架構(gòu)中有大量并行總線,無需再使用會造成時延的流水線,從而可提高系統(tǒng)速度和容量   • 甚至在要求資源利用率達(dá)到90%及以上的系統(tǒng)中,也能消除潛在的時序收斂問題和互連瓶頸   • 可憑借3D IC集成能力構(gòu)建更大型器件,并在工藝技術(shù)方面領(lǐng)先當(dāng)前行業(yè)標(biāo)準(zhǔn)整整一代   • 能在更低的系統(tǒng)功耗預(yù)算范圍內(nèi)顯著提高系統(tǒng)性能,包括多Gb串行收發(fā)器、I/O以及存儲器帶寬   • 顯著增強(qiáng)DSP與包處理性能   賽靈思UltraScale架構(gòu)為超大容量解決方案設(shè)計人員開啟了一個全新的領(lǐng)域。

    標(biāo)簽: UltraScale Xilinx 架構(gòu)

    上傳時間: 2013-11-17

    上傳用戶:皇族傳媒

  • SF-CY3 FPGA套件開發(fā)指南Ver6.00 (by特權(quán)同學(xué))

    SF-CY3 FPGA套件開發(fā)指南Ver6.00 (by特權(quán)同學(xué))

    標(biāo)簽: SF-CY FPGA 6.00 Ver

    上傳時間: 2013-10-22

    上傳用戶:songnanhua

  • EDA技術(shù)實(shí)用教程VHDL版本課件

    EDA技術(shù)實(shí)用教程VHDL版本課件

    標(biāo)簽: VHDL EDA 實(shí)用教程 版本

    上傳時間: 2013-11-22

    上傳用戶:iswlkje

  • 通用FPGA架構(gòu)匯總

    通用FPGA架構(gòu)匯總

    標(biāo)簽: FPGA 架構(gòu)

    上傳時間: 2013-11-21

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  • 夏宇聞老師優(yōu)秀的verilog教程課件

          本資料是關(guān)于夏宇聞老師優(yōu)秀的verilog教程課件,其中包括verilog講稿PPT、verilog課件、verilog例題等。

    標(biāo)簽: verilog 教程

    上傳時間: 2013-10-24

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  • 《EDA原理及應(yīng)用》(何賓教授)實(shí)驗(yàn)課件

          本資料是《EDA原理及應(yīng)用》一書的配套實(shí)驗(yàn)課件,一共有18個實(shí)驗(yàn)。大家可以參考著自己做!當(dāng)然做完后也可以到電子發(fā)燒友網(wǎng)站FPGA技術(shù)聯(lián)盟QQ群(263281510)討論討論...

    標(biāo)簽: EDA 實(shí)驗(yàn)

    上傳時間: 2013-10-20

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  • 《EDA原理及應(yīng)用》(何賓教授)課件 PPT

      第1章-EDA設(shè)計導(dǎo)論   第2章-可編程邏輯器件設(shè)計方法   第3章-VHDL語言基礎(chǔ)   第4章-數(shù)字邏輯單元設(shè)計   第5章-VHDL高級設(shè)計技術(shù)   第6章-基于HDL和原理圖的設(shè)計輸入   第7章-設(shè)計綜合和行為仿真   第8章-設(shè)計實(shí)現(xiàn)和時序仿真   第9章-設(shè)計下載和調(diào)試   第10章-設(shè)計示例(數(shù)字鐘、UART、數(shù)字電壓表)     點(diǎn)擊鏈接,【《EDA原理及應(yīng)用》(何賓教授)實(shí)驗(yàn)課件下載 】

    標(biāo)簽: EDA

    上傳時間: 2013-12-20

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  • cpld開發(fā)套件光盤說明

    cpld開發(fā)套件光盤說明

    標(biāo)簽: cpld 開發(fā)套件 光盤

    上傳時間: 2013-11-17

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  • 用VerilogHDL實(shí)現(xiàn)基于FPGA的通用分頻器的設(shè)計

    用VerilogHDL實(shí)現(xiàn)基于FPGA的通用分頻器的設(shè)計

    標(biāo)簽: VerilogHDL FPGA 分頻器

    上傳時間: 2013-10-28

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