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  • 基于FPGA的軟件無線電DDC設計

    軟件無線電DDC(數字下變頻)系統(tǒng)作為前端ADC與后端通用DSP器件之間的橋梁,通過降低數據流的速率,把低速數據送給后端通用DSP器件進行處理,其性能的優(yōu)劣將對整個軟件無線電系統(tǒng)的穩(wěn)定性產生直接影響。采用專用DDC芯片完成數字下變頻,雖然具有抽取比大、性能穩(wěn)定等優(yōu)點,但價格昂貴,靈活性不強,不能充分體現(xiàn)軟件無線電的優(yōu)勢。FPGA工藝發(fā)展迅速,處理能力大大增強,相對于ASIC、DSP來說具有吞吐量高、開發(fā)周期短、可實現(xiàn)在線重構等諸多優(yōu)勢。正因為這些優(yōu)點,使得FPGA在軟件無線電的研究和開發(fā)中起著越來越重要的作用。 本次設計的目標是在一塊FPGA芯片上實現(xiàn)單通道數字下變頻系統(tǒng)。現(xiàn)階段主要對軟件無線電數字下變頻器的FPGA實現(xiàn)方法進行了研究分析,重點完成了其主要模塊的設計和仿真以及初步的系統(tǒng)級驗證。 論文首先對軟件無線電數字下變頻的國內外現(xiàn)狀進行了分析,然后對FPGA實現(xiàn)數字下變頻設計的優(yōu)勢作了闡述。在對軟件無線電理論基礎、數字信號處理的相關知識深入研究的基礎上重點研究軟件無線電數字下變頻技術。對數字下變頻的NCO、混頻、CIC、HB、FIR模塊的實現(xiàn)方法進行深入研究,在:MATLAB中設定整體系統(tǒng)方案、完成模塊劃分和接口定義,并對部分模塊建立數學模型并仿真、對模塊的性能進行優(yōu)化。從數字下變頻的系統(tǒng)層次上考慮了各模塊彼此問的性能制約,從而選擇合理配置、優(yōu)化系統(tǒng)結構以獲得模塊間的性能均衡和系統(tǒng)性能的最優(yōu)化。最后通過使用編寫'Verilog程序和調用部分lP Core相結合的方法完成數字下變頻各個模塊的設計并完成仿真和調試。結果表明設計的思想和結構是正確的,在下一步工作中主要完成系統(tǒng)的板級調試。

    標簽: FPGA DDC 軟件無線電

    上傳時間: 2013-04-24

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  • 基于FPGA的PCIE1接口設計與實現(xiàn)

    隨著現(xiàn)代計算機技術、微電子技術的進一步結合和發(fā)展,可編程邏輯技術已成為當前電子設計領域中最具活力和發(fā)展前途的技術。通過采用FPGA/EDA技術,對通信卡的PCI接口、E1接口、外部邏輯電路進行集成,并利用目前通用計算機強大的數字信息處理能力,可大大簡化CTI硬件的設計,降低制造成本,提高系統(tǒng)可靠性。 據此,本論文提出了基于FPGA/EDA技術的PCI-E1接口設計方法,文中對PCI總線接口、E1接口及兩接口的互連等相關技術進行了深入分析,對各功能模塊和系統(tǒng)進行了VHDL建模與仿真。 同時,論文還介紹了基于ALTERACyclone系列FPGA芯片的PCI-E1接口硬件平臺的設計原理和基于DriverWorks的WDM驅動程序的設計方法。 本論文涉及的軟件、硬件系統(tǒng)已經開發(fā)、調試完成。測試結果表明:1、論文所研究的PCI接口(主/從設備)在進行配置讀/寫、I/O讀寫、存儲器讀寫及總線的猝發(fā)數據傳送等操作中,各項性能符合PCI2.3規(guī)范的要求。 2、論文所研究的E1接口支持成幀和不成幀兩種傳輸方式:在成幀模式下,信息的有效傳送速率為31×64Kbit/s;在不成幀的模式下,信息的有效傳送速率為2.048Mbit/s。E1輸出口各項參數符合CCITT相關規(guī)范要求。 3、論文所研究的PCI-E1接口在與現(xiàn)網設備、模塊的對接測試中,性能穩(wěn)定。基于本論文的產品已經正式發(fā)布。國內部分廠家已對該產品進行了多方面的綜合測試,并計劃將其應用到實際的生產和研究中。 本論文對于CTI硬件的設計是一項嘗試和革新。測試和應用證明該方法行之有效,符合設計目標,具有較廣闊的應用前景。

    標簽: PCIE1 FPGA 接口設計

    上傳時間: 2013-04-24

    上傳用戶:lixinxiang

  • 基于FPGA的短波數字信號調制解調

    在衛(wèi)星通信、移動通信技術快速發(fā)展的今天,短波這一最古老和傳統(tǒng)的通信方式不僅沒有被淘汰,還在快速發(fā)展。其通信距離遠、設備簡單以及移動方便等優(yōu)點被廣泛應用于無線通信領域。 數字調制技術作為通信領域中極為重要的一個方面,也得到了迅速發(fā)展。全數字調制解調技術的使用使各類現(xiàn)代調制解調技術融合一體,目前國內多速率/多制式調制解調大多基于通用.DSP實現(xiàn),支持的速率比較低。由于運算量大和硬件參數的限制,采用通用DSP無法勝任高速率調制解調的任務。現(xiàn)代FPGA可以提供支持以低系統(tǒng)丌銷、低成本實現(xiàn)高速乘.累加超前進位鏈的DSP算法。本文采用理論與實踐相結合的方式研究基于FPGA技術來實現(xiàn)短波數字信號的調制解調。通過對具體的FPGA系統(tǒng)設計與調試,將理論應用到實際中。 本文通過具體的EPlC60240C8芯片作為處理器的FPGA實驗板,研究了短波數字信號調制解調的設計與丌發(fā)過程。分析了現(xiàn)代通信的各種調制方式.誤碼率。得出了不同的調制方式的優(yōu)劣性。最后重點提出了QPSK的調制解調方法。給出了Qf'SK的調制解調框圖、QPSK的SystemView系統(tǒng)仿真、VHDL程序進行調制解調,在OUARTUS上進行仿真。然后設計AD/DA輸入輸出電路,對短波數字信號進行調制解調。通過設計的AD/DA電路輸入短波數字信號進行調制解調,然后輸出原始的模擬信號。文中還對比了其他的調制解調方式,通過對比,發(fā)現(xiàn)不同的調制解調方式對短波信號的影響。最后,通過比較FPGA與DSP在處理高速率、大容量的數字信號,得出不同的結論。展示了FPGA在這方面的優(yōu)越性。

    標簽: FPGA 短波 數字信號 調制解調

    上傳時間: 2013-06-05

    上傳用戶:362279997

  • 基于FPGA的高速實時數字存儲示波器

    數字存儲示波器(DSO)上世紀八十年代開始出現(xiàn),由于當時它的帶寬和分辨率較低,實時性較差,沒有具備模擬示波器的某些特點,因此并沒有受到人們的重視。隨著數字電路、大規(guī)模集成電路及微處理器技術的發(fā)展,尤其是高速模/數(A/D)轉換器及半導體存儲器(RAM)的發(fā)展,數字存儲示波器的采樣速率和實時性能得到了很大的提高,在工程測量中,越來越多的工程師用DSO來替代模擬示波器。 本文介紹了一款雙通道采樣速率達1GHz,分辨率為8Bits,實時帶寬為200MHz數字存儲示波器的研制。通過對具體功能和技術指標的分析,提出了FPGA+ARM架構的技術方案。然后,本文分模塊詳細敘述了整機系統(tǒng)中部分模塊,包括前端高速A/D轉換器和FPGA的硬件模塊設計,數據處理模塊軟件的設計,以及DSO的GPIB擴展接口邏輯模塊的設計。 本文在分析了傳統(tǒng)DSO架構的基礎上,提出了本系統(tǒng)的設計思想和實現(xiàn)方案。在高速A/D選擇上,國家半導體公司2005年推出的雙通道采樣速率達500MHz高速A/D轉換器芯片ADC08D500,利用其雙邊沿采樣模式(DES)實現(xiàn)對單通道1GHz的采樣速率,并且用Xilinx公司Spraten-3E系列FPGA作為數據緩沖單元和存儲單元,提高了系統(tǒng)的集成度和穩(wěn)定性。其中,F(xiàn)PGA緩沖單元完成對不同時基情況下多通道數據的抽取,處理單元完成對數據正弦內插的計算,而DSO中其余數據處理功能包括數字濾波和FFT設計在后端的ARM內完成。DSO中常用的GPIB接口放在FPGA內集成,不僅充分利用了FPGA內豐富的邏輯資源,而且降低了整機成本,也減少了電路規(guī)模。 最后,利用ChipscopePro工具對采樣系統(tǒng)進行調試,并分析了數據中的壞數據產生的原因,提出了解決方案, 并給出了FPGA接收高速A/D的正確數據。

    標簽: FPGA 高速實時數 字存儲 示波器

    上傳時間: 2013-07-07

    上傳用戶:asdkin

  • 高速實時圖像采集和處理系統(tǒng)的研究

    光斑質心檢測系統(tǒng)是APT精跟蹤伺服系統(tǒng)的關鍵技術之一,目前的光斑檢測系統(tǒng)大多是基于PC機的,存在著高速實時性、穩(wěn)定性問題。在總結各種檢測算法的基礎上,本文提出了基于FPGA的圖像處理算法,實現(xiàn)了激光光斑中心的高速實時檢測。 文中主要采用3×3窗口模塊和自適應閾值模塊,先對CCD輸入數據進行處理,判斷光斑的范圍,然后再運用光斑的質心算法對光斑所占的像元進行運算,得出光斑位置的脫靶量,最后用VGA格式將圖像顯示在LCD上。本文達到了的3000幀/s的脫靶量幀速,精度為2urad的技術指標,實現(xiàn)了高速率、高精度的精跟蹤要求。

    標簽: 實時圖像采集 處理系統(tǒng)

    上傳時間: 2013-04-24

    上傳用戶:林魚2016

  • 基于FPGA的數字中頻處理技術研究

    軟件無線電是無線電領域研究的熱點。現(xiàn)階段限于硬件的發(fā)展水平,大多采用寬帶中頻帶通采樣數字化結構,數字中頻技術就成為實現(xiàn)該結構的關鍵技術。目前FPGA器件在數字信號處理技術的實現(xiàn)方面發(fā)揮著越來越重要的作用。本文目的正是要把這兩者相結合,使數字中頻處理在FPGA中得到實現(xiàn),滿足具體的應用要求。 首先,對軟件無線電體系和數字中頻處理結構進行了研究;其次,在信號采樣理論、多速率數字信號處理理論、濾波器設計理論、FPGA硬件數字算法等理論的基礎上,結合本文的應用需要,提出了適合于FPGA實現(xiàn)的數字化中頻處理的系統(tǒng)方案:采用多相結構來高效的實現(xiàn)抽取,并用FIR濾波器作為低通抗混疊濾波器來實現(xiàn)6倍抽取的抗混疊濾波。對系統(tǒng)進行了Matlab仿真,以驗證系統(tǒng)方案的可行性。再次,具體通過Vefilog編程在FPGA中硬件實現(xiàn)該數字中頻系統(tǒng)。其中包括混頻器模塊、抽取濾波器模塊、信號產生器模塊。 最后對該系統(tǒng)進行了軟件仿真和硬件功能驗證,結果表明數字中頻系統(tǒng)性能達到了設計要求。

    標簽: FPGA 數字中頻處理 技術研究

    上傳時間: 2013-07-26

    上傳用戶:zhouli

  • 基于FPGA實現(xiàn)非均勻劃分信道

    軟件無線電已成為無線通信非常關鍵的技術之一。其基本思想是將寬帶A/D、D/A盡可能靠近天線,在一個開放式、模塊化的通用硬件平臺上用盡可能多的軟件來實現(xiàn)無線電臺的各種功能。 本文所討論的多相濾波器組信道化接收機(PPCR)及信道非均勻劃分,即是應用了軟件無線電理念的一種新技術。該技術針對傳統(tǒng)無線電接收機存在的結構不靈活、系統(tǒng)升級困難、同時處理多信號能力弱及系統(tǒng)規(guī)模過大等問題,應用現(xiàn)代多速率信號處理理論對之進行了改進。改進后的軟件無線電PPCR.具有全概率接收能力,能對信號進行下變頻并降低其采樣率處理,實現(xiàn)后資源耗費較低,而且依托現(xiàn)場可編程門陣列(FPGA)建立的平臺是開放式的,在需要時可在不改變硬件系統(tǒng)的情況下通過軟件更改系統(tǒng)的功能,極大地提高了系統(tǒng)的靈活性。諸多的優(yōu)點使其具有十分廣泛的應用前景,也成為當前研究熱點之一。 本文首先介紹了課題的應用背景,并深入討論了軟件無線電的基本理論:信號采樣理論及多速率信號處理理論,介紹了應用PPCR的采樣處理過程,給出了推導PPCR的數學模型,并在此基礎上分析闡述了信道非均勻劃分的原理。 在本文的系統(tǒng)仿真及實現(xiàn)部分,首先介紹了應用現(xiàn)代DSP開發(fā)工具DSPBuilder進行開發(fā)的設計流程,然后對應用DSP Builder來設計PPCR中的主要模塊一多相濾波器組及快速傅立葉變換模塊做了詳細闡述,最后對系統(tǒng)仿真及實現(xiàn)過程的實驗結果圖進行了分析。 本文主要是在實驗室階段對算法在硬件實現(xiàn)上進行研究。成果可以作為后續(xù)應用研究的基礎,對各種應用軟件無線電理念的通信系統(tǒng)都具有一定的參考價值。

    標簽: FPGA 信道

    上傳時間: 2013-06-17

    上傳用戶:xfbs821

  • 跳頻信號檢測與接收系統(tǒng)

    擴展頻譜通信技術,它的突出優(yōu)點是保密性好,抗干擾性強.隨著通信系統(tǒng)與現(xiàn)代計算機軟、硬件技術與微電子技術發(fā)展,越來越多的通信系統(tǒng)構建于這種技術之上.在實際擴頻通信系統(tǒng)工程中,用得比較普遍的是直擴方式和跳頻方式,它們的不同在于直擴是采取隱藏的方式對抗干擾,而跳頻采取躲避的方式. 西方國家早在20世紀50年代就開始對跳頻通信進行研究,在上個世紀末的幾次局部戰(zhàn)爭中,跳頻電臺得到了普遍的應用.跳頻通信的發(fā)展促進了其對抗技術的發(fā)展,目前,世界主要幾個軍事先進的國家,已經研究出高性能的跳頻通信對抗設備,國內這方面的發(fā)展相對國外差距比較大. 未來戰(zhàn)爭是科學技術的斗爭,研究跳頻通信對抗勢在必行.基于這種目的,本文研究和設計了跳頻檢測的FPGA實現(xiàn),利用基于時頻分析的處理方法,完成了跳頻信號檢測的FPGA實現(xiàn),通過測試,表明系統(tǒng)達到了設計要求,可以滿足實際的需要.主要內容包括: 1.概述了跳頻檢測接收研究的發(fā)展動態(tài),闡述了擴展頻譜通信及短時傅立葉變換的原理. 2.分析了基于快速傅立葉變換(FFT)處理跳頻信號,檢測跳頻的可行性,利用FFT檢測頻譜的原理,合理使用頻譜采樣策略,做到了增加頻譜利用率,提高了檢測概率和分析信噪比;利用抽取內插技術完成數據速率的轉換,使其滿足后續(xù)信號的處理要求;利用同相和正交的DDC實現(xiàn)結構,完成對跳頻信號的解跳. 3.設計完成了跳頻信號檢測與接收系統(tǒng)的FPGA實現(xiàn),其主要包括:數據速率變換的實現(xiàn),FIR低通濾波器的實現(xiàn),快速傅立葉變換(FFT)的實現(xiàn),下變頻的實現(xiàn)等.在濾波器的實現(xiàn)中,提出了兩種設計方法:基于常系數乘法器和分布式算法濾波器,分析了上述兩種方法的優(yōu)缺點,選擇用分布式算法實現(xiàn)設計中的低通濾波器;在快速傅立葉變換實現(xiàn)中,分析了基2和基4的算法結構,并分別實現(xiàn)了基2和基4的算法,滿足了不同場合對處理器的要求.在下變頻的設計中,使用濾波器的多相結構完成抽取的實現(xiàn),并使用低通濾波器使信號帶寬滿足指標的要求.此外,設計中還包括雙端口RAM的實現(xiàn),比較模塊的實現(xiàn)、數據緩存模塊和串并轉換模塊的實現(xiàn). 4.介紹了實現(xiàn)系統(tǒng)的硬件平臺.

    標簽: 跳頻信號 檢測 接收系統(tǒng)

    上傳時間: 2013-04-24

    上傳用戶:zttztt2005

  • 用FPGA實現(xiàn)8051內核及外設I2C接口

    8051處理器自誕生起近30年來,一直都是嵌入式應用的主流處理器,不同規(guī)模的805l處理器涵蓋了從低成本到高性能、從低密度到高密度的產品。該處理器極具靈活性,可讓開發(fā)者自行定義部分指令,量身訂制所需的功能模塊和外設接口,而且有標準版和經濟版等多種版本可供選擇,可讓設計人員各取所需,實現(xiàn)更高性價比的結構。如此多的優(yōu)越性使得8051處理器牢固地占據著龐大的應用市場,因此研究和發(fā)展8051及與其兼容的接口具有極大的應用前景。在眾多8051的外設接口中,I2C總線接口扮演著重要的角色。通用的12C接口器件,如帶12C總線的RAM,ROM,AD/DA,LCD驅動器等,越來越多地應用于計算機及自動控制系統(tǒng)中。因此,本論文的根本目的就是針對如何在8051內核上擴展I2C外設接口進行較深入的研究。 本課題項目采用可編程技術來開發(fā)805l核以及12C接口。由于8051內核指令集相容,我們能借助在現(xiàn)有架構方面的經驗,發(fā)揮現(xiàn)有的大量代碼和工具的優(yōu)勢,較快地完成設計。在8051核模塊里,我們主要實現(xiàn)中央處理器、程序存儲器、數據存儲器、定時/計數器、并行接口、串行接口和中斷系統(tǒng)等七大單元及數據總線、地址總線和控制總線等三大總線,這些都是標準8051核所具有的模塊。在其之上我們再嵌入12C的串行通信模塊,采用自下而上的方法,逐次實現(xiàn)一位的收發(fā)、一個字節(jié)的收發(fā)、一個命令的收發(fā),直至實現(xiàn)I2C的整個通信協(xié)議。 8051核及I2C總線的研究通過可編程邏輯器件和一塊外圍I2C從設備TMPl01來驗證。本課題的最終目的是可編程邏輯器件實現(xiàn)的8051核成功并高效地控制擴展的12C接口與從設備TMPl01通信。 用EP2C35F672C6芯片開發(fā)的12C接口,數據的傳輸速率由該芯片嵌入8051微處理的時鐘頻率決定。經測試其傳輸速率可達普通速率和快速速率。 目前集成了該12C接口的8051核已經在工作中投入使用,主要用于POS設備的用戶數據加密及對設備溫度的實時控制。雖然該設備尚未大批量投產,但它已成功通過PCI(PaymentCardIndustry)協(xié)會認證。

    標簽: FPGA 8051 I2C 內核

    上傳時間: 2013-06-18

    上傳用戶:731140412

  • 自適應濾波器算法設計及其FPGA實現(xiàn)

    自適應濾波器是智能天線技術中核心部分-自適應波束成形器的關鍵技術,算法的高效穩(wěn)定性及硬件時鐘速率的快慢是判斷波束成形器性能優(yōu)劣的主要標準。 首先選取工程領域最常用的自適應橫向LMS濾波算法作為研究對象,提出了利用最小均方誤差意義下自適應濾波器的輸出信號與主通道噪聲信號的等效關系,得到濾波器最佳自適應參數的方法。并分析了在平穩(wěn)和非平穩(wěn)環(huán)境噪聲下,濾波器的收斂速度、權系數穩(wěn)定性、跟蹤輸入信號的能力和信噪比的改善等特性。 在分析梯度自適應格型算法的基礎上,提出利用最佳反射系數的收斂性和穩(wěn)定性,得到了梯度自適應格型濾波器的定步長改進方法;并以改進的梯度自適應格型和線性組合器組成梯度自適應格型聯(lián)合處理算法,在同樣環(huán)境噪聲下,相比自適應橫向LMS算法,其各項性能指標都得到了極大地改善,而且有利于節(jié)省硬件資源。 設計了自適應橫向LMS濾波器和梯度自適應格型聯(lián)合處理濾波器的電路模型,并用馳豫超前技術對兩類濾波器進行了流水線優(yōu)化。利用Altera公司的CycloneⅡ系列EP2C5T144C6芯片和多種EDA工具,完成了濾波器的FPGA硬件設計與仿真實現(xiàn)。并以FPGA實現(xiàn)的3節(jié)梯度自適應格型聯(lián)合處理器為核心,設計了一種TD-SCDMA系統(tǒng)的自適應波束成形器,分析表明可以很好地利用系統(tǒng)提供的參考信號對下行波束進行自適應成形。

    標簽: FPGA 自適應濾波器 算法設計

    上傳時間: 2013-07-16

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