本文主要的研究為對轉永磁無刷直流電動機控制問題，對轉永磁無刷直流電動機在艦船、水下航行器等對轉推進系統中有著廣泛的應用前景。它具有無刷直流電動機的一切優點：功率密度大、調速性能好、運行效率高、結構簡單、運行可靠、維護方便等等。其與普通的永磁無刷直流電動機的差別僅僅在于原來靜止的電樞部分和旋轉的永磁體部分都可以相對于靜止部分旋轉，即有兩個轉子，根據作用力與反作用力的原理，兩個轉子受到的電磁轉矩在任意時刻都是大小相等、方向相反的。因此兩個轉子必將沿著相反的方向旋轉。 論文主要工作和創新點如下： 1)介紹了對轉永磁無刷直流電機與普通永磁無刷直流電機的區別、優點及應用，詳細分析了其工作原理，并建立對轉永磁無刷直流電機本體的數學模型，接著利用MATLAB/Simulink建立對轉永磁無刷直流電機的仿真模型。 2)研究了無位置傳感器對轉永磁無刷直流電機的控制方法。采用基于DSP的三次諧波過零點檢測方法來檢測電機轉子的位置與轉速，采用數字鎖相環對三次諧波過零點進行90°延遲： 3)控制系統采用雙閉環控制，即速度環與電流環來組成調速控制系統，其中速度環采用了基于改進的BP神經網絡PID自適應控制，電流環采用滯環控制，并對整個系統進行仿真。 4)在仿真研究的基礎上，本文進行了以TMS320I~F2407A的DSP芯片為控制核心的無位置傳感器對轉永磁無刷直流電機數字控制系統的軟硬件設計。
上傳時間： 2013-04-24
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圖書－電子技術學習方法和分析思路輕松入門，很不錯的一本書，對電路分析很有用的。
上傳時間： 2013-05-16
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高性能ADC產品的出現，給混合信號測試領域帶來前所未有的挑戰。并行ADC測試方案實現了多個ADC測試過程的并行化和實時化，減少了單個ADC的平均測試時間，從而降低ADC測試成本。 本文實現了基于FPGA的ADC并行測試方法。在閱讀相關文獻的基礎上，總結了常用ADC參數測試方法和測試流程。使用FPGA實現時域參數評估算法和頻域參數評估算法，并對2個ADC在不同樣本數條件下進行并行測試。 通過在FPGA內部實現ADC測試時域算法和頻域算法相結合的方法來搭建測試系統，完成音頻編解碼器WM8731L的控制模式接口、音頻數據接口、ADC測試時域算法和頻域算法的FPGA實現。整個測試系統使用Angilent 33220A任意信號發生器提供模擬激勵信號，共用一個FPGA內部實現的采樣時鐘控制模塊。并行測試系統將WM8731.L片內的兩個獨立ADC的串行輸出數據分流成左右兩通道，并對其進行串并轉換。然后對左右兩個通道分別配置一個FFT算法模塊和時域算法模塊，并行地實現了ADC參數的評估算法。 在樣本數分別為128和4096的實驗條件下，對WM8731L片內2個被測.ADC并行地進行參數評估，被測參數包括增益GAIN、偏移量OFFSET、信噪比SNR、信號與噪聲諧波失真比SINAD、總諧波失真THD等5個常用參數。實驗結果表明，通過在FPGA內配置2個獨立的參數計算模塊，可并行地實現對2個相同ADC的參數評估，減小單個ADC的平均測試時間。 FPGA片內實時評估算法的實現節省了測試樣本傳輸至自動測試機PC端的時間。而且只需將HDL代碼多次復制，就可實現多個被測ADC在同一時刻并行地被評估，配置靈活。基于FPGA的ADC并行測試方法易于實現，具有可行性，但由于噪聲的影響，測試精度有待進一步提高。該方法可用于自動測試機的混合信號選項卡或測試子系統。 關鍵詞：ADC測試；并行；參數評估；FPGA；FFT
上傳時間： 2013-07-11
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Linux內核在S3C2440上移植的方法
上傳時間： 2013-07-12
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在圖像處理、數據傳輸、雷達接收等現代信號處理領域，對信號處理的穩定性、實時性和靈活性都有很高的要求。FIR數字濾波器因其線性相位特性滿足了現代信號處理領域對濾波器的高性能要求，成為應用最廣泛的數字濾波器之一。高密度的FPGA兼顧實時性和靈活性，為FIR數字濾波器的實現提供了強大的硬件支持。 現今FIR數字濾波器的FPGA實現方法中最常用的是基于DA的實現方法和基于CSD編碼的實現方法，本文對這兩種實現方法進行了深入的探討，并進行了一定的改進。本論文所做的主要工作和創新如下： 1、對FIR數字濾波器的硬件實現方法進行了理論研究，其中著重對并行FIR數字濾波器的實現方法進行了深入探討并提出了一個改進的實現方法：基于CSD-DA的改進實現方法。這個實現方法在一定情況下比單純的基于CSD編碼的實現方法和基于DA的實現方法都要節約芯片面積。 2、經過電路建模和數學推導提出了“CSD-DA擇優比較法”。該比較法可以從基于CSD編碼的實現方法、基于DA的實現方法以及基于CSD-DA的改進實現方法中較精確的選擇出最佳實現方法。 3、用Cyclone EPEC6Q240C8芯片和音頻編解碼芯片TLV320AIC23B實現了一個可以濾除音頻信號中高頻噪聲的音頻FIR數字低通濾波器。
上傳時間： 2013-06-07
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本研究針對目標識別等系統中由于載機轉動而使目標圖像發生旋轉，給測量及人眼觀察帶來的影響，因此需要對目標圖像進行實時的反旋轉處理，對目前出現的消像旋技術進行分析和比較，選擇從電子學消旋方法出發，研究圖像消像旋的方法，并給出了基于FPGA的實時消像旋系統的完整結構和相應的算法設計。 本文在對電子圖像消旋原理的深入分析的基礎上，設計并利用Visual C++6.0軟件仿真實現了一種優化的快速旋轉算法，再利用后插值處理保證了圖像的質量；構建了以ACEX EP1K100為核心的數字圖像實時消像旋系統，利用VHDL硬件描述語言實現了整個消像旋算法的FPGA設計。該系統利用高速相機和Camera Link接口傳輸圖像，提高了系統的運行速度。利用QuartusII和Matlab軟件對整個算法設計進行混合仿真實驗。實驗結果表明，該系統能夠成功地對采集到的灰度圖像進行消像旋處理，旋轉后的圖像清晰穩定，像素誤差小于一個像素，而且對于視頻信號只有一幀的延時不到20ms，達到系統參數要求。
上傳時間： 2013-07-04
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介紹了10種經典的軟件濾波方法的優缺點和應用方法
上傳時間： 2013-04-24
上傳用戶：saharawalker
抑制電子電路噪聲的方法，希望對大家有用，看看吧
上傳時間： 2013-06-17
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在工業控制領域，多種現場總線標準共存的局面從客觀上促進了工業以太網技術的迅速發展，國際上已經出現了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業以太網協議。將傳統的商用以太網應用于工業控制系統的現場設備層的最大障礙是以太網的非實時性，而實現現場設備間的高精度時鐘同步是保證以太網高實時性的前提和基礎。 IEEE 1588定義了一個能夠在測量和控制系統中實現高精度時鐘同步的協議——精確時間協議(Precision Time Protocol)。PTP協議集成了網絡通訊、局部計算和分布式對象等多項技術，適用于所有通過支持多播的局域網進行通訊的分布式系統，特別適合于以太網，但不局限于以太網。PTP協議能夠使異質系統中各類不同精確度、分辨率和穩定性的時鐘同步起來，占用最少的網絡和局部計算資源，在最好情況下能達到系統級的亞微級的同步精度。 基于PC機軟件的時鐘同步方法，如NTP協議，由于其實現機理的限制，其同步精度最好只能達到毫秒級；基于嵌入式軟件的時鐘同步方法，將時鐘同步模塊放在操作系統的驅動層，其同步精度能夠達到微秒級。現場設備間微秒級的同步精度雖然已經能滿足大多數工業控制系統對設備時鐘同步的要求，但是對于運動控制等需求高精度定時的系統來說，這仍然不夠?；谇度胧杰浖臅r鐘同步方法受限于操作系統中斷響應延遲時間不一致、晶振頻率漂移等因素，很難達到亞微秒級的同步精度。 本文設計并實現了一種基于FPGA的時鐘同步方法，以IEEE 1588作為時鐘同步協議，以Ethernet作為底層通訊網絡，以嵌入式軟件形式實現TCP/IP通訊，以數字電路形式實現時鐘同步模塊。這種方法充分利用了FPGA的特點，通過準確捕獲報文時間戳和動態補償晶振頻率漂移等手段，相對于嵌入式軟件時鐘同步方法實現了更高精度的時鐘同步，并通過實驗驗證了在以集線器互連的10Mbps以太網上能夠達到亞微秒級的同步精度。
上傳時間： 2013-08-04
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JPEG 2000是為適應不斷發展的圖像壓縮應用而出現的新的靜止圖像壓縮標準，小波變換是JEPG 2000核心算法之一。小波變換是一種可達到時(空)域或頻率域局部化的時頻域或空頻域分析方法，其多尺度分解特性符合人類的視覺機制，更加適用于圖像信息的處理。提升小波變換是一類不采用傅立葉變換做為主要分析工具的小波變換新方法，提升小波變換的提出大大簡化了小波變換的計算，使其在實時信號處理領域得到廣泛的應用。通過提升的方法很容易構造一般的整數小波變換，由于圖像一般用位數較低的整數表示，整數小波變換可以將為整數序列的圖像矩陣映射成整數小波系數矩陣，這就大大簡化了小波變換的硬件電路設計。在當今數字化和信息化時代背景下，研究具有高速硬件處理功能的可變程邏輯器件在圖像壓縮算法領域的應用已經成為當今研究的熱點。 本文旨在探討和研制基于FPGA的小波變換模塊的可能性和方法。本文采用Xilinx公司的Spartan-Ⅲ系列芯片，根據JPEG 2000推薦無損提升小波算法和有損提升小波算法，設計圖像壓縮系統的小波變換模塊。主要工作如下： 第一部分介紹了傳統小波分析理論和提升小波分析理論。包括連續小波時頻局域性的特征，離散小波變換系數的意義，多分辨分析引出的構造小波基的系統方法和計算離散小波的快速算法等。重點放在介紹正交小波和雙正交小波的構造方法，并介紹了數字圖像在小波域的特點。討論了提升小波變換的基本思想，討論了用提升方法構造小波基以及傳統小波變換的提升實現，討論了整數小波變換。 第二部分介紹了FPGA結構及其設計流程。介紹了FPGA/CPLD器件的特征、發展趨勢及FPGA/CPLD基本結構，然后重點介紹了本文用到的Xilinx公司Spartan-Ⅲ系列芯片的結構特點，以及Xilinx的FPGA開發軟件ISE，最后介紹了硬件描述語言VHDL語言的特點。 最后一部分是本論文研究的主要內容，即JPEG 2000中最核心的算法-提升格式小波變換的一維變換模塊設計和二維變換模塊設計。一維提升小波變換模塊采用兩種不同的電路結構進行設計-低速低功耗的串行流水線結構和高速高功耗的并行陣列結構。同樣，二維小波變換模塊也采用了兩種不同的電路結構進行設計-低速低功耗的折疊結構和高速高功耗的串行結構。 文章對提升小波變換的FPGA實現中的大量細節問題進行了討論，給出了每種結構提升小波變換模塊的電路原理圖，并對原理圖進行了仿真測試，仿真測試結果不僅表明了模塊功能的正確性，而且表明不同小波模塊可以滿足相應領域的實際要求。
上傳時間： 2013-06-08
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