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  • 偽隨機序列發生器的FPGA設計與實現

    偽隨機序列 (Pseudo-Random Sequence,PRS)廣泛應用于密碼學、擴頻通信、雷達、導航等領域,其設計和分析一直是國際上的研究熱點。混沌序列作為一種性能優良的偽隨機序列,近年來受到越來越多的關注。尋找一種性能更為良好的混沌偽隨機序列(ChaosPseudo Random Sequence,CPRS)并且完成其硬件實現,在理論研究與工程應用上都是十分有價值的。基于切延遲橢圓反射腔映射混沌系統(Tangent-Delay Ellipse Reflecting Cavity map System,TD-ERCS)已被理論分析和測試證明具有良好的密碼學性質。本文介紹了一種基于TD-ERCS構造偽隨機序列發生器 (Pseudo Random SequenceGenerator,PRSG)的新方法;并基于這種方法,提出了以現場可編程門陣列 (Field Programmable Gate Array,FPGA)為平臺的硬件設計實現方案,采用硬件描述語言 (VHSIC Hardware DescriptionLanguage,VHDL )完成了整個系統的設計,通過了仿真與適配,完成了硬件調試;詳細地論述了系統總體框架及內部模塊設計,重點介紹了TD-ERCS算法實現單元的設計,并在系統中設計加入了異步串行接口,完善了整個系統的模塊化,可使系統嵌入到現有的各類密碼系統與設備中;基于FDELPHI編程環境,完成了計算機應用軟件的設計,為使用基于TD-ERCS開發的PRSG硬件產品提供了人機交互界面,也為分析與測試硬件系統產生的CPRS提供了方便;同時依據美國國家標準與技術研究院 (National Institute of Standards andTechnology,NIST)提出的偽隨機序列性能指標,對軟件與硬件系統產生的CPRS進行了標準測試,軟件方法所得序列各項性能指標完全合格,硬件FPGA所得序列僅三項測試未能通過,其原因有待進一步研究。

    標簽: FPGA 偽隨機序列 發生器

    上傳時間: 2013-06-20

    上傳用戶:heart520beat

  • MAX+PLUSII 10.230

    Max+plusⅡ是Altera公司提供的FPGA/CPLD開發集成環境,Altera是世界上最大可編程邏輯器件的供應商之一。Max+plusⅡ界面友好,使用便捷,被譽為業界最易用易學的EDA軟件。在Max+plusⅡ上可以完成設計輸入、元件適配、時序仿真和功能仿真、編程下載整個流程,它提供了一種與結構無關的設計環境,是設計者能方便地進行設計輸入、快速處理和器件編程。

    標簽: 10.230 PLUSII MAX

    上傳時間: 2013-07-31

    上傳用戶:小強mmmm

  • 可重構24bit音頻過采樣DAC的FPGA

    基于過采樣和∑-△噪聲整形技術的DAC能夠可靠地把數字信號轉換為高精度的模擬信號(大于等于16位)。采用這一架構進行數模轉換具有諸多優點,例如極低的失配噪聲和更高的可靠性,便于實現嵌入式集成等,最重要的是可以得到其他DAC結構所無法達到的精度和動態范圍。在高精度測量,音頻轉換,汽車電子等領域有著廣泛的應用價值。 本文采用∑-△結構以FPGA方式實現了一個具有高精度的數模轉換器,在24比特的輸入信號下,達到了約150dB的信噪比。作為一個靈活的音頻DAC實現方案。該DAC可以對CD/DVD/HDCD/SACD等多種制式下的音頻信號進行處理,接受并轉換采樣率為32/44.1/48/88.2/96/192kHz,字長為16/18/20/24比特的PCM數據,具備良好的兼容性和通用性。 由于非線性和不穩定性的存在,高階∑-△調制器的設計與實現存在較大的難度。本文綜合大量文獻中的經驗原則和方法,闡述了穩定的高階高精度調制器的設計流程;并據此設計了達到24bit精度和滿量程輸入范圍的的5階128倍調制器。本文創新性地提出了∑-△調制器的一種高效率流水線實現結構。分析表明,與其他常見的∑-△調制器實現結構相比,本方案具有結構簡單、運算單元少等優點;此外在同樣信號采樣率下,調制器所需的時鐘頻率大大降低。 文中的過采樣濾波模塊采用三級半帶濾波器和一個可變CIC濾波器級聯組成,可以達到最高128倍的過采樣比,同時具有良好的通帶和阻帶特性。在半帶濾波器的設計中采用了CSD編碼,使結構得到了充分的簡化。 本文提出的過采樣DAC方案具有可重配置結構,讓使用者能夠方便地控制過采樣比和調制器階數。通過積分梳狀濾波器的配置,能夠獲得32/64/128倍的不同過采樣比,從而實現對于32~192kHz多種采樣率輸入的處理。在不同輸入字長情況下,通過調制器的重構,則可以將調制器由高精度的5階模式改變為功耗更低的3階模式,滿足不同分辨率信號輸入時的不同精度要求。這是本文的另一創新之處。 目前,該過采樣DAC已經在XilinxVirtexⅡ系列FPGA器件下得到硬件實現和驗證。測試表明,對于從32kHz到192kHz的不同輸入信號,該DAC模塊輸出1比特碼流的帶內信噪比均能滿足24比特數據轉換應用的分辨率要求。

    標簽: FPGA bit DAC 24

    上傳時間: 2013-07-08

    上傳用戶:從此走出陰霾

  • 基于DSP+FPGA結構圖像處理系統設計與實現

    · 摘要:  為了實現視頻圖像的實時處理,采用基于DSP+FPGA的線性流水陣列結構,用現場可編程門陣列FPGA對采集的視頻數字圖像做預處理,并結合大規模可編程邏輯陣列CPLD進行邏輯控制,實現了視頻圖像的采集和目標提取的視頻數字圖像處理系統.介紹了該視頻圖像處理系統的硬件組成、工作原理和各種視頻跟蹤算法的應用.該系統與計算機聯結,配以適當的圖像處理軟件和開發系統,即可形成一個通

    標簽: FPGA DSP 圖像處理 系統設計

    上傳時間: 2013-06-17

    上傳用戶:dancnc

  • 電子制作第六期 2010年

    電子制作第六期,書刊配的光盤,原版,圖像高清晰

    標簽: 2010 電子制作

    上傳時間: 2013-06-21

    上傳用戶:sxdtlqqjl

  • 觸摸屏生產流程

    介紹觸摸屏的蝕刻加工及生產過程、測試過程、檢驗流程及成品出貨等整個流程詳細介紹,配以流程圖說明.

    標簽: 觸摸屏 生產流程

    上傳時間: 2013-04-24

    上傳用戶:hjkhjk

  • 共模電感濾波器設計

      摘要:為改善傳統EMI 濾波器的濾波性能,分析并采用了合成扼流圈來替代傳統分立扼流圈,并根據濾 波器阻抗失配原理,通過分析L ISN 網絡與噪聲源的阻抗特性,分別對共差模等效電路進行分析與設計,提出 了基于合成扼流圈的開關電源EMI 濾波器設計方法。試驗結果證明,此方法是有效的,并已成功地應用在燃 料電池轎車用DC/ DC 變換器的控制電路板設計中。 關鍵詞:開關電源;電磁干擾;合成扼流圈;共模電感

    標簽: 共模電感 濾波器設計

    上傳時間: 2013-06-09

    上傳用戶:萬有引力

  • ARM+MP3+USB HOST 開發板

    ·ARM+MP3+USB HOST 開發板(at91sam7s64+vs1003b+ch375v) 1.atmel出品的at91sam7s64作為主控芯片 2.外配vs1003b作為mp3/wma解碼器 3.ch375v作usb主機芯片, 4.支持接口 5.sd card,mmc card 6.cf card 7.u盤 8.ide port(連接硬盤,光驅) 9.液晶 10.可通過串口,usb下載程

    標簽: nbsp HOST ARM USB

    上傳時間: 2013-05-29

    上傳用戶:Yukiseop

  • 龍門智能中醫處方軟件1.0

    "'龍門'智能中醫處方平臺"是由龍門中醫軟件工作室開發的免費軟件,1.0版包括如下功能:a生成、管理中醫處方.b根據《藥典》對用藥劑量、配伍禁忌進行檢查c調用方劑一千四百余首;根據病名查看中醫內、婦、兒、外科教科書281種疾病的常見分型及治療方法.d支持用戶錄入自擬方及自己的證治經驗;等等。注意:運行此軟件需要先下載安裝access runtime 2007,這是微軟提供的一款免費軟件。詳情請看:http://zhan.renren.com/longmensoft

    標簽: 1.0 軟件

    上傳時間: 2013-08-01

    上傳用戶:誰偷了我的麥兜

  • 開關電源基本原理介紹

    開關電源基本原理與設計介紹,臺達的資料,很好的

    標簽: 開關 電源基本

    上傳時間: 2013-04-24

    上傳用戶:cursor

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