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開發研究

  • MBOK擴頻調制技術及基于FPGA的實現研究

      本文首先對目前使用比較多的幾種擴頻調制方式:BPSK調制方式、QPSK調制方式、CCK調制方式、MBOK調制方式進行了介紹,并從誤碼率、處理增益、頻帶利用率等方面對它們進行了比較,重點討論了MBOK調制方式的優越性能。然后研究了MBOK調制方式的擴頻和解擴方案,包括高速數據進行串并轉換、擴頻、偽碼同步、解擴等。最后,以Altera公司的MAXPLUSⅡ開發系統為平臺,對系統的各個部分進行了模塊化設計,并進行了軟件仿真,仿真結果表明,設計達到了預定的要求?! ?/p>

    標簽: MBOK FPGA 擴頻 實現研究

    上傳時間: 2013-05-15

    上傳用戶:dancnc

  • 基于運動補償的去隔行系統的研究與FPGA設計

    本文采用基于運動補償的算法,對去隔行系統及其FPGA設計作了深入的研究.該系統包括三個關鍵模塊運動估計模塊是去隔行系統的設計重點,設計為雙向運動估計,采用菱形快速搜索算法,主要分為計算和控制兩大部分.計算部分為SAD計算模塊,采用累加樹和流水線技術;控制部分根據菱形搜索算法的第三步搜索的特點,對比較模塊、SAD暫存器等模塊做了具體的設計.對于運動補償模塊采用雙向補償的算法,補償精度為半像素.根據半像素點的位置將運動補償計算分為四個狀態,并通過對四個狀態計算特點的分析設計了加法器的結構復用.同時基于視頻數據處理的需要,設計了四個具有雙體存儲結構的內部緩存器,由FPGA內部的嵌入式陣列塊實現.根據運動估計模塊和運動補償模塊的計算特點,分別對緩存器的結構、讀寫時序和列序號控制進行設計,有效提高了數據的存取效率.本文對于這三個去隔行系統的關鍵模塊都給出了RTL級設計和模塊的功能仿真,并在最后一章中給出了去隔行系統的FPGA設計.

    標簽: FPGA 補償 去隔行

    上傳時間: 2013-06-11

    上傳用戶:han_zh

  • 面向特種LCD圖像處理方法與FPGA實現研究

    本文研究特種LCD的圖像處理方法和FPGA實現方案,并研制出基于FPGA的若干實際應用系統,有效地解決目前存在的問題。本文主要研究內容為:  (1)給出一種基于彩色空間變換的色彩調整方法,在YCrCb空間內實現亮度和色度分離,避免了RGB空間兩者同時變化造成偏色和失真的現象,并在FPGA內采用流水線結構改進3階矩陣運算的邏輯結構,節省出2/3的邏輯資源,提高了模塊的最高運行速度。  (2)研究利用FPGA實現圖像實時縮放處理的方法,選擇能夠滿足特種LCD要求的雙線性插值法作為研究對象,實時計算插值系數dx和dy,并采用流水線結構進行插值計算,僅使用FPGA中的3個雙端口RAM來緩沖圖像數據,沒有外擴大容量幀存儲器,降低了成本,提高特種LCD的系統兼容性?! ?3)設計一種針對特種LCD更為簡捷、有效的隔行轉逐行掃描的實現方案,即利用圖像實時縮放的方法,把一場圖像縮放到LCD的分辨率,實現復合視頻圖像在LCD的“滿屏”顯示,改善現有特種LCD在顯示隔行掃描的復合視頻信號時,遇到圖像信息丟失或顯示效果不佳的問題。  (4)設計出一種基于字符和位圖的數字OSD控制核,合理使用分布式RAM和塊RAM兩種邏輯資源來存儲字符和位圖信息,OSD圖像由數字邏輯自動合成,編程簡單靈活,使特種LCD的參數調整更加方便?! ?5)研制成功基于FPGA的特種LCD顯示控制板,能顯示三種分辨率640×480,800×600,1024×768的圖像信號;支持寬范圍的亮度、對比度、顯示位置等參數的實時調整,并提供全功能的透明OSD菜單進行指示。  (6)研制成功基于FPGA的特種LCD圖像調節板,用于對某型號機載特種LCD進行改造,增加寬范圍的亮度、對比度、圖像顯示位置的實時調整功能,提供無信號輸入檢測與OSD指示功能,提高圖像顯示的性能,通過了環境溫度試驗與性能測試,并已裝機?! ?7)研制成功基于DSP和FPGA的圖像采集顯示板,實現了對全分辨率復合視頻信號進行25幀/秒的實時采集和顯示,在DSP內使用“三幀”輪換的圖像數據緩沖方法提高了系統的實時處理能力,使之能夠完成一定復雜度的實時圖像處理。

    標簽: FPGA LCD 圖像 處理方法

    上傳時間: 2013-06-12

    上傳用戶:ivan-mtk

  • 802.3快速以太網MAC層研究及其在FPGA的實現

    本文主要闡述基于FPGA對IEEE802.3快速以太網MAC層功能的實現.首先介紹了以太網協議以及快速以太網接入無源光網EPON的原理,然后重點闡述了MAC層的FPGA設計、仿真及測試.先總體介紹了對整個MAC系統的內部結構、模塊劃分,再對各個模塊的設計進行了詳細的描述,接著介紹了開發環境和驗證工具,之后給出了測試方案,驗證數據、實現結果及時序仿真波形圖.最后是對下一步將設計的MAC IP應用于EPON的MAC層協議進行了研究分析,通過數學推導和實例給出了MPCP的DBA算法,并討論了在MAC核中添加MPCP協議的實現方法.

    標簽: 802.3 FPGA MAC 快速以太網

    上傳時間: 2013-06-10

    上傳用戶:時代將軍

  • 基于DSP與FPGA的智能絞車系統研究

    在測井過程中,由于測井深度直接影響到其它測井信息的準確性,所以精確的測井深度變得越來越重要。本文針對現有絞車系統的不足(CPU為單片機決定其精度不高、缺少完善的深度校正系統等),首次將DSP與FPGA應用到測井絞車系統中,充分利用FPGA硬件資源豐富、速度快及DSP軟件設計靈活的特點,使系統硬件、軟件結構更加合理,功能得到增強,性價比進一步提高,從而優化了整個系統,為今后絞車設計提供了新的方法和途徑。 本文相對其它絞車系統的設計,主要特點有:設計了比較完善的深度校正模塊(深度脈沖校正、根據磁記號與磁定位信號的校正、由張力等原因引起的電纜形變的校正)。將打標和測量一體化。設計了方便的通信接口(校正后的深度脈沖及DSP通過RS232與主測井儀的通信)。使用DSP作為CPU并且配合FPGA作預處理從而提高了測量深度的準確性。電路采用了可編程邏輯器件,提高了電路工作的可靠性,減小了電路板面積。另外,本文在研究電纜絞車系統的同時,對測井的地面信號處理也進行了初步的研究,主要是對趨膚效應的校正做了初步的研究。 本文所完成的是一個完整的測量與打標系統,通過室內與現場實驗,得出該系統具有高精度、高智能化等優點。最后,本文對該系統的發展方向作了展望。

    標簽: FPGA DSP 絞車 系統研究

    上傳時間: 2013-07-08

    上傳用戶:星仔

  • 基于FPGA的工業X-CT二代掃描控制系統研究

    工業X-CT(X-ray Computed Tomography)無損檢測技術是以不損傷或者破壞被檢測對象的一種高新檢測技術,被譽為最佳的無損檢測手段,在無損檢測領域日益受到人們的青睞。近年來,各國都在投入大量的人力、物力對其進行研究與開發。 目前,工業CT主要采用第二代和第三代掃描方式。在工業CT第三代掃描方式中,掃描系統僅作“旋轉”運動,控制系統比較簡單。對此,我國已取得了可喜的成績。然而,對工業CT系統中的二代掃描運動控制系統,即針對“平移+旋轉”運動的控制系統的研究,我國已有采用,但與發達國家相比,還存在較大的差距。二代掃描方式與其它掃描方式相比,具有對被檢物的尺寸沒有要求,且能夠對感興趣的檢測區域進行局部掃描的獨特優點。同時X光源的射線出束角較?。ㄒ话阈∮?0°),因此在工業X-CT系統主要采用二代掃描運動控制。有鑒于此,本論文結合有關科研項目,開展了工業X-CT二代掃描控制系統的研究。 論文首先介紹了工業X-CT系統的工作原理和各種掃描運動控制方式的特點,闡述了開展二代掃描控制的研究目的和意義。其次,根據二代掃描控制的特點,提出了“在優先滿足工業X-CT二代掃描控制的基礎上,力求實現對工業X-CT掃描運動的通用控制,使其能同時支持一、三代掃描方式”的設計思想。據此,研究確立了基于單片機AT89LV52及FPGA芯片EP1C3T100C8的運動控制架構,以實現二代掃描控制系統的設計方案。論文詳細介紹了可編程邏輯器件FPGA的工作原理和開發流程,并對其相關開發環境QuartusII4.1作了闡述。結合運動控制系統的硬件設計,詳細介紹了各功能模塊的具體設計過程,給出了相關的設計原理框圖和實際運行波形。并制作了相應的PCB板,調試了整個硬件控制系統。最后,論文還詳細研究了利用VisualC++6.0來完成上位機控制軟件的設計,給出了運動控制主界面及掃描運動控制功能軟件設計的流程圖。 論文對整個運動控制系統采用的經濟型的開環控制技術所帶來的不利影響,分析研究了增加步進電機的細分數以提高掃描精度的可能性,并對所研究的控制系統在調試過程中出現的一些問題及解決方案作了簡要的分析,提出了一些完善方法。

    標簽: FPGA X-CT 工業 掃描控制

    上傳時間: 2013-04-24

    上傳用戶:stella2015

  • 基于FPGA的高速IPSec協議實現技術研究

    隨著國際互聯網絡的迅猛發展,網絡應用的不斷豐富,Intenret已經從最初以學術交流為目的而演變為商業行為,網絡安全性需求日益增加,高速網絡安全保密成為關注的焦點,在安全得到保障的情況下,為了滿足網速無限制的追求,高速網絡硬件加密設備也必將成為需求熱點。另一方面,IPSec協議被廣泛的應用于防火墻和安全網關中,但對IPSec協議的處理會大大增加網關的負載,成為千兆網實現的瓶頸。本文便是針對上述現狀,研究基于高性能FPGA實現千兆IPSec協議的設計技術。 目前,國外IPSec協議實現已經芯片化,達到幾千兆的速率,但是國內產品多以軟件實現,速度難以提高。本文采用的基于FPGA的IPSec技術方案,采用硬件實現隧道模式下的IPSec協議,為IP分組及其上層協議數據提供機密性、數據完整性驗證以及數據源驗證等安全服務。在以VPN為實施方案的基礎上,構建了以KDIPSec為設備原型以IPSec協議為出發點的千兆網絡系統環境模型,從硬件體系結構到各個模塊的劃分以及各個模塊實現的功能這幾個方面描述了KDIPSec實現技術,最后描述了一些關鍵模塊的FPGA設計和和仿真。所有處理模塊均在Xilinx公司的FPGA芯片中實現,處理速率超過1Gb/s。

    標簽: IPSec FPGA 協議 實現技術

    上傳時間: 2013-07-03

    上傳用戶:wfl_yy

  • JPEG2000二維離散小波變換快速算法研究和FPGA實現

    相對于JPEG中二維離散余弦變換(2DDCT)來說,在JPEG2000標準中,二維離散小波變換(2DDWT)是其圖像壓縮系統的核心變換。在很多需要進行實時處理圖像的系統中,如數碼相機、遙感遙測、衛星通信、多媒體通信、便攜式攝像機、移動通信等系統,需要用芯片實現圖像的編解碼壓縮過程。雖然有許多研究工作者對圖像處理的小波變換進行了研究,但大都只偏重算法研究,對算法硬件實現時的復雜性考慮較少,對圖像處理的小波變換硬件實現的研究也較少?! ”疚尼槍D像處理的小波變換算法及其硬件實現進行了研究。對文獻[13]提出的“內嵌延拓提升小波變換”(Combiningthedata-extensionprocedureintothelifting-basedDWTcore)快速算法進行仔細分析,提出一種基于提升方式的5/3小波變換適合硬件實現的算法,在MATLAB中仿真驗證了該算法,證明其是正確的。并設計了該算法的硬件結構,在MATLAT的Simulink中進行仿真,對該結構進行VHDL語言的寄存器傳輸級(RTL)描述與仿真,成功綜合到Altera公司的FPGA器件中進行驗證通過。本算法與傳統的小波變換的邊界處理方法比較:由于將其邊界延拓過程內嵌于小波變換模塊中,使該硬件結構無需額外的邊界延拓過程,減少小波變換過程中對內存的讀寫量,從而達到減少內存使用量,降低功耗,提高硬件利用率和運算速度的特點。本算法與文獻[13]提出的算法相比較:無需增加額外的硬件計算模塊,又具有在硬件實現時不改變原來的提升小波算法的規則性結構的特點。這種小波變換硬件芯片的實現不僅適用于JPEG2000的5/3無損小波變換,當然也可用于其它各種實時圖像壓縮處理硬件系統。

    標簽: JPEG 2000 FPGA 二維

    上傳時間: 2013-06-13

    上傳用戶:jhksyghr

  • 高分辨率合成孔徑雷達視頻模擬器FPGA實現技術研究

    在合成孔徑雷達的研究和研制工作中,合成孔徑雷達模擬技術具有十分重要的作用。本文以440MHz帶寬線性調頻信號,采樣頻率500MHz高分辨合成孔徑雷達視頻模擬器為研究對象。首先對模擬器的幾項主要技術進行分析,在對點目標回波信號模型分析研究的基礎上,對點目標原始回波數據進行模擬并做了成像驗證,從而為硬件實現提供了正確的信號模型;針對傳統的“波形存儲直讀法”方案,即在計算機平臺上用模擬軟件產生原始回波數據并存儲,再通過計算機接口實現數據傳輸,最后完成數模轉換產生視頻信號這一過程,分析指出該方案在實現高分辨率時的速度和容量瓶頸?! ♂槍唧w的設計要求,圍繞速度和容量問題,本文著眼于高分辨率SAR模擬器的FPGA實現研究,指出FPGA實時生成點目標原始回波數據是其實現的核心;針對這一核心問題,充分利用現代VLSI設計中的流水線技術與并行陣列技術以及FPGA的優良性能和豐富資源,在時間上采用同步流水結構、空間上采用并行陣列形式,將速度和容量問題統一為數據的高速生成問題;給出了系統總體設計思想,該方案不需要大容量存儲器單元,大大減少模擬器復雜度;對原始回波數據實時生成模塊的各主要單元給出了結構并進行了仿真,結果表明FPGA可以滿足課題設計要求;同時,對該模擬器片上系統的實現、增強人機交互性,給出了人機界面的設計思路。  分析指出了點目標原始回波數據實時生成模塊通過并行擴展即可實現多點目標的原始回波數據實時生成;最后對復雜場景目標模擬器的實現進行了構思,指出了傳統方案在改進的基礎上實現高分辨率視頻模擬器的可行性。本文首次提出以FPGA實現高分辨率合成孔徑雷達原始回波數據實時生成的思想,為國內業界在此方向做了一些理論和實踐上的有益探索,對于國內高分辨率合成孔徑雷達的研制具有一定的實際意義。

    標簽: FPGA 高分辨率 合成孔徑 雷達視頻

    上傳時間: 2013-04-24

    上傳用戶:阿四AIR

  • 嵌入式USB總線器件端處理器的FPGA實現研究

      本文提出了一種適合于嵌入式SoC的USB器件端處理器的硬件實現結構。并主要研究了USB器件端處理器的RTL級實現及FPGA原型驗證、和ASIC實現研究,包括從模型建立、算法仿真、各個模塊的RTL級設計及仿真、FPGA的下載測試和ASIC的綜合分析。它的速度滿足預定的48MHz,等效門面積不超過1萬門,完全可應用于SOC設計中。  本文重點對嵌入式USB器件端處理器的FPGA實現作了研究。為了準確測試本處理器的運行情況,本文應用串口傳遞測試數據入FPGA開發板,測試模塊讀入測試數據,發送入PC機的主機端。通過NI-VISA充當軟件端,檢驗測試數據的正確。     

    標簽: FPGA USB 嵌入式 器件

    上傳時間: 2013-07-24

    上傳用戶:1079836864

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