應用于煤礦、石化等易燃易爆環境的電子設備必須滿足防爆的要求，本質安全型是最佳的防爆形式。本質安全型開關電源具有重量輕、體積小、制造工藝簡單、成本低、安全性能高等優點，因而具有廣闊的發展前景。單端反激變換器是開關變換器的一種基本的拓撲結構，在實際中應用比較廣泛，因此對單端反激變換器進行本質安全特性分析是本質安全開關電源設計的重要基礎。本質安全型開關變換器的設計，主要是對變換器中的儲能元件進行設計，即變換器中的電感和輸出濾波電容進行設計。 本文對變換器的靜態特性進行了深入分析，指出反激變換器存在三種工作模式：CISM-CCM、IISM-CCM和DCM：得出了變換器工作在整個動態范圍內的最大輸出紋波電壓、最大電感電流和最大輸出短路釋放能量。對單端反激變換器的本質安全特性進行了分析，得出輸出本質安全型單端反激變換器的非爆炸判斷方法，并通過安全火花試驗裝置對變換器進行爆炸性試驗，驗證了輸出本安判據的正確性。得出輸出本質安全型單端反激變換器的設計方法，以同時滿足輸出紋波電壓和輸出本安要求作為約束條件，得到了本質安全型單端反激變換器電感、電容參數的設計范圍。給出了具體實例，并進行仿真和試驗研究，仿真和實驗結果驗證了理論分析的正確性和設計方法的可行性。
上傳時間： 2013-06-25
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斷路器是電力系統中重要的控制和保護設備，對維護電力系統的安全、穩定和可靠運行起著重要的作用。如何使斷路器高度智能化，并且更安全和可靠，是電力系統保護的發展要求，也是本論文研究的目的。 本文在深入研究了智能斷路器國內外發展狀況的基礎上，精心設計了以數字信號處理器DSP和復雜可編程邏輯器件CPLD為核心的系統硬件。DSP是智能斷路器測控單元的核心器件，它實現斷路器的各種保護、報警、顯示與控制功能。CPLD完成狀態量的監測，以及各種邏輯信號的輸出。兩種器件相互配合使得斷路器系統更加智能化。研究了斷路器測控單元的測量原理及保護算法，并進行了具體的硬件和軟件模塊的設計，旨在實現斷路器的智能保護、遠程控制和集中管理。本設計以TI公司的DSP芯片TMS320LF2407為核心。硬件設計主要包括信號調理模塊設計、信號采樣模塊設計、保護執行模塊設計、CPLD模塊設計和輸入輸出模塊設計。并且利用TMS320LF2407本身具有的CAN2.0模塊，通過CAN總線實現斷路器和上位機的通信，實現遙測、遙調、遙控、遙信等“四遙”功能。軟件采用模塊化設計，每一個模塊相對獨立，完成某個特定功能，便于維護和添加新功能，并且調試靈活方便。文中給出了主程序及各個子程序的流程圖，其中子程序有數據采集子程序、FFT計算子程序、液晶顯示子程序、短路瞬時保護子程序、過載長延時保護子程序、接地故障保護子程序和短路短延時保護子程序等。并且設計中充分考慮了斷路器工作環境的惡劣性，分析了各種干擾的來源，并針對各種干擾采取了對應的軟件和硬件的抗干擾措施。最后，為了驗證全波傅氏算法能否滿足電網數據處理精度的要求，利用MATLAB搭建仿真平臺，對其進行了仿真。結果表明全波傅氏算法能達到系統的要求。
上傳時間： 2013-04-24
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電力系統分析教材，作者 王錫凡 科學出版社 2003年出版
上傳時間： 2013-06-15
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MCS-51 單片機 監控 程序 源代碼 分析
上傳時間： 2013-06-15
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圖書－電子技術學習方法和分析思路輕松入門，很不錯的一本書，對電路分析很有用的。
上傳時間： 2013-05-16
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隨著圖像處理技術的不斷發展，圖像處理技術在國民經濟和社會生活的各個方面都得到了廣泛的運用。與此同時，人們對圖像處理的要求也越來越高。傳統的數字圖像處理器件主要有專用集成芯片（Application Specific Integrated Circuit）和數字信號處理器（Digital Signal Process）。進入20世紀以來，伴隨著半導體技術的發展，現場可編程門陣列FPGA以其應用靈活、集成度高、功能強大、設計周期短、開發成本低的特點，越來越多地被應用在圖像處理領域。大量實踐證明，FPGA的并行處理能力與流水線作業能顯著地提高圖像處理的速度，因此基于FPGA的圖像處理系統有著廣闊的發展前景。 本文研究的是一個在嵌入式視頻監控系統下的圖像預處理子系統。首先實現了一個通用可重復配置的圖像處理算法研究硬件平臺，完成圖像的采集、接收、處理、存儲、輸出等功能。由于FPGA本身具有完全的可重復配置性，所以該架構的硬件平臺可以很方便的升級和重復配置。其次在該平臺上，本文使用Verilog HDL硬件語言在FPGA芯片上實現了多種圖像預處理算法。在實現過程中，為了充分發揮FPGA在并行處理方面的強大功能，本文對算法做了一定的改進，使其盡量能使用并行處理的方式來完成。實驗結果表明，本圖像預處理系統能在毫秒級高速地完成多種圖像算法，完全能夠滿足視頻監控系統50幀/秒的輸出要求。 最后根據視頻監控系統在實際運用中出現的噪聲類型多樣化的情況，我們設計了一種基于反饋理論的圖像處理效果控制模塊。該模塊能通過對處理后圖像峰值信噪比（PSNR）的分析，控制FPGA對下一幅圖像的噪聲采用更有針對性的圖像處理方法。
上傳時間： 2013-05-20
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UBoot源碼分析及在S3C2440的移植過程
上傳時間： 2013-04-24
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互聯網、移動通信、星基導航是21世紀信息社會的三大支柱產業，而GPS系統的技術水平和發展歷程代表著全世界衛星導航系統的發展狀況。目前，我國已經成為GPS的使用大國，衛星導航產業鏈也已基本形成。然而，我們對GPS核心技術(即如何捕獲衛星信號并保持對信號的跟蹤)的研究還不夠深入，我國GPS產品的核心部分多數還是靠進口。因此，對GPS核心技術的研究是非常緊迫的。 本文首先介紹了GPS的定位原理，之后闡述了GPS接收機的基本原理一直接擴頻通信和GPS信號的結構與特性。從這些方面出發研究接收機基帶處理器的捕獲與跟蹤設計方案。 設計過程中，先詳細分析了滑動相關的捕獲算法和基于FFT的快速捕獲算法，并利用matlab進行了驗證。由于前者靈活性好且可捕獲到高精度的碼相位和載波頻率，適合于本文的硬件接收機，所以本文確定了滑動相關的捕獲方案。 接著分析了跟蹤環路的特點，跟蹤模塊采用碼跟蹤環和載波跟蹤環耦合的方法實現。由于GPS系統通常工作在非常低的信噪比環境中，而非相干環在低信噪比下環路跟蹤性能較好，所以碼跟蹤環采用非相干(DDLL)環實現。這種跟蹤環路采用的鑒相器是能量鑒相器，對數據的調制和載波相位都不敏感，鑒相器不會產生不確定量。由于輸入信號存在180°相位翻轉，而COSTAS鎖相環允許數據調制，對I支路和Q支路信號的180°相位翻轉不敏感，所以載波跟蹤環采用COSTAS鎖相環實現。上述算法在matlab環境下得到了驗證。 基帶處理器電路的主要模塊在Quartus II8.0開發平臺上利用VHDL硬件描述語言實現。然后利用EDA仿真工具ModelSim-Altera6.1g進行了邏輯仿真。本設計滿足系統功能和性能的要求，可以直接用于實時GPS接收機系統的設計中，為自主設計GPS接收機奠定了基礎。 最后，由于在弱電磁環境下，捕獲失鎖后32PPS信號會丟失。所以設計了一個能授時和守時的算法去得到與GPS時同步的精確授時秒信號。并且實現了這個算法。
上傳時間： 2013-04-24
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這是我們的電路分析課件，希望能幫到正在學將要學想要學這門課的同志們
標簽： 電路分析基礎
上傳時間： 2013-06-10
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當今，移動通信正處于向第四代通信系統發展的階段，OFDM技術作為第四代數字移動通信(4G)系統的關鍵技術之一，被包括LTE在內的眾多準4G協議所采用。IDFT/DFT作為OFDM系統中的關鍵功能模塊，其精度對基帶解調性能產生著重大的影響，尤其對LTE上行所采用的SC_FDMA更是如此。為了使定點化IDFT/DFT達到較好的性能，本文采用數字自動增益控制(DAGC)技術，以解決過大輸入信號動態范圍所造成的IDFT/DFT輸出信噪比(SNR)惡化問題。 首先，本文簡單介紹了較為成熟的AAGC(模擬AGC)技術，并重點關注近年來為了改善其性能而興起的數字化AGC技術，它們主要用于壓縮ADC輸入動態范圍以防止其飽和。針對基帶處理中具有累加特性的定點化IDFT/DFT技術，進一步分析了AAGC技術和基帶DAGC在實施對象，實現方法等上的異同點，指出了基帶DAGC的必要性。 其次，根據LTE協議，搭建了從調制到解調的基帶PUSCH處理鏈路，并針對基于DFT的信道估計方法的缺點，使用簡單的兩點替換實現了優化，通過高斯信道下的MATLAB仿真，證明其可以達到理想效果。仿真結果還表明，在不考慮同步問題的高斯信道下，本文所搭建的基帶處理鏈路，采用64QAM進行調制，也能達到在SNR高于17dB時，硬判譯碼結果為極低誤碼率(BER)的效果。 再次，在所搭建鏈路的基礎上，通過理論分析和MATLAB仿真，證明了包括時域和頻域DAGC在內的基帶DAGC具有穩定接收鏈路解調性能的作用。同時，通過對幾種DAGC算法的比較后，得到的一套適用于實現的基帶DAGC算法，可以使IDFT/DFT的輸出SNR處于最佳范圍，從而滿足LTE系統基帶解調的要求。針對時域和頻域DAGC的差異，分別選定移位和加法，以及查表的方式進行基帶DAGC算法的實現。 最后，本文對選定的基帶DAGC算法進行了FPGA設計，仿真、綜合和上板結果說明，時域和頻域DAGC實現方法占用資源較少，容易進行集成，能夠達到的最高工作頻率較高，完全滿足基帶處理的速率要求，可以流水處理每一個IQ數據，使之滿足基帶解調性能。
上傳時間： 2013-05-17
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