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集成技術

  • ESD Protection in CMOS ICs

    在互補式金氧半(CMOS)積體電路中,隨著量產製程的演進,元件的尺寸已縮減到深次微 米(deep-submicron)階段,以增進積體電路(IC)的性能及運算速度,以及降低每顆晶片的製造 成本。但隨著元件尺寸的縮減,卻出現一些可靠度的問題。 在次微米技術中,為了克服所謂熱載子(Hot-Carrier)問題而發展出 LDD(Lightly-Doped Drain) 製程與結構; 為了降低 CMOS 元件汲極(drain)與源極(source)的寄生電阻(sheet resistance) Rs 與 Rd,而發展出 Silicide 製程; 為了降低 CMOS 元件閘級的寄生電阻 Rg,而發展出 Polycide 製 程 ; 在更進步的製程中把 Silicide 與 Polycide 一起製造,而發展出所謂 Salicide 製程

    標簽: Protection CMOS ESD ICs in

    上傳時間: 2020-06-05

    上傳用戶:shancjb

  • 高速電路設計 詳細基礎理論知識

    設計高速電路必須考慮高速訊 號所引發的電磁干擾、阻抗匹配及串音等效應,所以訊號完整性 (signal  integrity)將是考量設計電路優劣的一項重要指標,電路日異複雜必須仰賴可 靠的軟體來幫忙分析這些複雜的效應,才比較可能獲得高品質且可靠的設計, 因此熟悉軟體的使用也將是重要的研究項目之一。另外了解高速訊號所引發之 各種效應(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設計的重點之一。目前高速示波器的功能越來越多,使用上很複雜,必須事先 進修學習,否則無法全盤了解儀器之功能,因而無法有效發揮儀器的量測功能。 其次就是高速訊號量測與介面的一些測試規範也必須熟悉,像眼圖分析,探針 效應,抖動(jitter)測量規範及高速串列介面量測規範等實務技術,必須充分 了解研究學習,進而才可設計出優良之教學教材及教具。

    標簽: 高速電路

    上傳時間: 2021-11-02

    上傳用戶:jiabin

  • 金路網絡硬盤====特首快傳系統 (Tso upload system 1.0) 使用ASP腳本編寫,大量使用類封裝,全面集成優化aspuplaod3.0批量上傳

    金路網絡硬盤====特首快傳系統 (Tso upload system 1.0) 使用ASP腳本編寫,大量使用類封裝,全面集成優化aspuplaod3.0批量上傳,只需服務器支技aspupload3即可使內部網絡可以達到數十Mb的上傳速度,并無須客戶端下載任何安裝插件。

    標簽: aspuplaod upload system Tso

    上傳時間: 2017-01-12

    上傳用戶:fnhhs

  • 三層結構下反求工程CAD/CAM/CAE系統集成

    三層結構下反求工程CAD/CAM/CAE系統集成

    標簽: 三層結構 工程 系統集成

    上傳時間: 2013-07-24

    上傳用戶:eeworm

  • 集成運算放大器應用手冊

    集成運算放大器應用手冊

    標簽: 集成運算放大器 應用手冊

    上傳時間: 2013-05-15

    上傳用戶:eeworm

  • 集成鎖相環路 原理 特性 應用

    集成鎖相環路 原理 特性 應用

    標簽: 集成 鎖相環路

    上傳時間: 2013-05-29

    上傳用戶:eeworm

  • 語音與數據集成網絡

    語音與數據集成網絡

    標簽: 語音 數據集成網絡

    上傳時間: 2013-07-02

    上傳用戶:eeworm

  • 集成傳感器

    集成傳感器

    標簽: 集成傳感器

    上傳時間: 2013-06-08

    上傳用戶:eeworm

  • 集成運算放大器應用電路集

    集成運算放大器應用電路集

    標簽: 集成運算放大器 應用電路

    上傳時間: 2013-06-15

    上傳用戶:eeworm

  • 新型特種集成電源及應用

    新型特種集成電源及應用

    標簽: 集成電源

    上傳時間: 2013-05-28

    上傳用戶:eeworm

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