為了能實時監控無人機的狀態和提高無人機的安全可靠性，本設計利用FPGA高速率、豐富的片上資源和靈活的設計接口，設計了一套無人機多路監控系統。該監控系統具備了將處于無人機不同位置的攝像機所采集的視頻信息，傳送給地面站控制設備，并在同一臺顯示器上實現同步顯示的功能。仿真結果表明，該系統可以很好的保證監控視頻的實時性、和高清度，確保無人機完成偵查任務。
上傳時間： 2013-10-24
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簡單實用的VHDL程序實例集,可供初學者學習!
上傳時間： 2013-10-30
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PCB線寬和電流關系公式 先計算Track的截面積，大部分PCB的銅箔厚度為35um（即 1oz）它乘上線寬就是截面積，注意換算成平方毫米。 有一個電流密度經驗值，為15~25安培/平方毫米。把它稱上截面積就得到通流容量。 I=KT（0.44）A（0.75）， 括號里面是指數， K為修正系數，一般覆銅線在內層時取0.024，在外層時取0.048 T為最大溫升，單位為攝氏度（銅的熔點是1060℃） A為覆銅截面積，單位為square mil. I為容許的最大電流，單位為安培。 一般 10mil=0.010inch=0.254mm 1A ， 250mil=6.35mm 8.3A ？倍數關系，與公式不符 ？
上傳時間： 2013-11-12
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系統結構如 圖 1所示 ， 從 系統 結 構圖可 以看 出 ， 系統主要包括視頻信 號輸入模塊 ， 視頻信號處 理模 塊和視頻信號輸出模塊等 3個部分組成。各個模塊主要功能為： 視頻輸入模塊 將 采 集 的 多路 視 頻 信 號 轉 換成 數 字 信 號 送 到F P GA； 視頻處理模塊主要有F P GA 完成 ，根據 需要 對輸入 的數字視頻信號進行處理 ； 視頻輸 出模塊將 F P GA處理后的信號轉換成模擬信號輸出到顯示器。
上傳時間： 2013-11-09
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伺服舵機作為基本的輸出執行機構廣泛應用于 遙控航模以及人形機器人的控制中。舵機是一種位 置伺服的驅動器，其控制信號是PWM信號.，利 用占空比的變化改變舵機的位置，也可使用FPGA、 模擬電路、單片機來產生舵機的控制信號舊。應 用模擬電路產生PWM信號，應用的元器件較多， 會增加電路的復雜程度；若用單片機產生PWM信 號，當信號路數較少時單片機能滿足要求，但當 PWM信號多于4路時，由于單片機指令是順序執 行的，會產生較大的延遲，從而使PWM信號波形 不穩，導致舵機發生顫振。
上傳時間： 2013-11-20
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色環電阻識別小程序V1.0--功能說明： 1、能直接根據色環電阻的顏色計算出電阻值和偏差； 2、能根據電阻值，反標電阻顏色； 3、支持四環、五環電阻計算； 4、帶萬用表直讀數； 色環電阻識別小程序--使用說明： 1、選擇電阻環數；（四環電阻或五環電阻） 2、如果是“色環轉阻值”則：鼠標點擊對應環的顏色，然后點按鈕“色環→阻值” 3、如果是“阻值轉色環”則：輸入相應阻值、單位、精度，點按鈕“阻值→色環” 國家標稱電阻值說明： ★E6±20%系列：1.0、1.5、2.2、3.3、4.7、6.8 E12±10%系列：1.0、1.2、1.5、1.8、2.2、2.7、3.3、3.9、4.7、5.6、6.8、8.2、9.1 E24 I級±5%：1.0、1.1、1.2、1.3、1.5、1.6、1.8、2.0、2.2、2.4、2.7、3.0、3.3、3.6、3.9、4.3、4.7、5.1、5.6、6.2、6.8、7.5、8.2、9.1 使用注意事項： 1、請不要帶電和在路測試電阻，這樣操作既不安全也不能測出正確阻值； 2、請不要用手接觸到電阻引腳，因為人體也有電阻，會使測試值產生誤差； 3、請正確選擇萬用表的檔位（電阻檔）和量程（200、20K、2M量程)
上傳時間： 2013-11-24
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摘 要：研究一種基于FPGA的多路視頻合成系統。系統接收16路ITU656格式的視頻數據，按照畫面分割的要求對視頻數據流進行有效抽取和幀合成處理，經過視頻編碼芯片轉換成模擬信號輸出到顯示器，以全屏或多窗口模式顯示多路視頻畫面。系統利用FPGA的高速并行處理能力的優勢，應用靈活的的多路視頻信號的合成技術和數字圖像處理算法，實現實時處理多路視頻數據。
上傳時間： 2013-11-21
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七天玩轉Altera：學習FPGA必經之路包括基礎篇、時序篇和驗證篇三個部分。
上傳時間： 2013-11-13
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XAPP520將符合2.5V和3.3V I/O標準的7系列FPGA高性能I/O Bank進行連接 The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems
上傳時間： 2013-11-06
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抑制△I 噪聲一般需要從多方面著手, 但通過PCB 設計抑制△I 噪聲是有效的措施之一。如何通過PCB 設計抑制△I 噪聲是一個亟待深入研究的問題。在對△I 噪聲的產生、特點、主要危害等研究的基礎上, 討論了輻射干擾機理, 重點結合PCB 和EMC 研究的新進展, 研究了抑制△I 噪聲的PCB 設計方法。對通過PCB 設計抑制△I 噪聲的研究與應用具有指導作用。
上傳時間： 2013-11-18
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