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是一個用verilog寫成的加法器電路,可把七個元件加起來
標(biāo)簽： verilog 加法器 元件
上傳時間： 2014-01-07
上傳用戶：zhangzhenyu
工作流JBPM中文教程,是直譯過來的.感興趣的就
標(biāo)簽： JBPM 教程
上傳時間： 2016-04-25
上傳用戶：003030
Cisco 電話概論文章,語音技術(shù)概略
標(biāo)簽： Cisco
上傳時間： 2016-04-26
上傳用戶：weixiao99
實現(xiàn)對CIH免疫的匯編源代碼供感興趣的人研究，另外附帶CIH1.2的匯編代碼
標(biāo)簽： CIH 免疫 匯編源代碼
上傳時間： 2016-04-28
上傳用戶：cooran
散列的應(yīng)用 能夠清楚的展示簡單的散列 理解散列的意義
標(biāo)簽：
上傳時間： 2016-05-01
上傳用戶：zhaiyanzhong
這是一個Verilog的電梯控制程序碼,控制樓層為1~4樓,關(guān)開門...等
標(biāo)簽： Verilog 控制 程序
上傳時間： 2016-05-04
上傳用戶：wyc199288
這是一個二維的上提式9/7離散小波的Verilog的源碼,此為Encoder
標(biāo)簽： Verilog Encoder
上傳用戶：zhaiye
使用硬體描述語言HDL 設(shè)計硬體電路，臺灣人寫的PPT講義，非常不錯。VHDL硬件設(shè)計入門學(xué)習(xí)。VHDL基本語法架構(gòu)，VHDL的零件庫(Library)及包裝(Package)等內(nèi)容。
標(biāo)簽： HDL
上傳時間： 2014-01-22
上傳用戶：cxl274287265
電子書Absolute.C.plus.plu
標(biāo)簽： Absolute plus plu
上傳時間： 2013-12-23
上傳用戶：yph853211
北大青鳥的內(nèi)部測試題（感興趣的一定要看看哦 ）
標(biāo)簽： 北大青鳥 測試題
上傳時間： 2016-05-11
上傳用戶：gaome
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