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電子產(chǎn)(chǎn)品設(shè)(shè)計(jì)

程式描述：使用Cypress的Cy7C68013A晶片進(jìn)行設(shè)計(jì)

程式描述：使用Cypress的Cy7C68013A晶片進(jìn)行設(shè)計(jì)，通過(guò)外接EEPROM來(lái)進(jìn)行供電時(shí)的重列舉。程式包括USB韌體端的程式以及電腦端的程式。安裝：把來(lái)源程式碼複製到硬碟特定目錄下，使用Keil C編譯器和Visual C++ 6.0運(yùn)行即可。注意：可以首先使用Cypress的測(cè)試工具進(jìn)行韌體程式的測(cè)試，以確保韌體程式的正確性。

標(biāo)簽： Cypress 68013A C68013 68013

上傳時(shí)間： 2017-02-10

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樹(shù)是由n(n≥0)個(gè)結(jié)點(diǎn)組成的有限集合T。n=0的樹(shù)稱為空樹(shù)；對(duì)n>0的樹(shù)

樹(shù)是由n(n≥0)個(gè)結(jié)點(diǎn)組成的有限集合T。n=0的樹(shù)稱為空樹(shù)；對(duì)n>0的樹(shù)，有:(1)僅有一個(gè)特殊的結(jié)點(diǎn)稱為根結(jié)點(diǎn)，根結(jié)點(diǎn)沒(méi)有前驅(qū)結(jié)點(diǎn)；(2)當(dāng)n>1時(shí)，除根結(jié)點(diǎn)外其余的結(jié)點(diǎn)分為m(m>0)個(gè)互不相交的有限集合T1,T2，…，Tm，其中每個(gè)集合Ti本身又是一棵結(jié)構(gòu)和樹(shù)類似的子樹(shù)。

標(biāo)簽： 樹(shù) gt

上傳時(shí)間： 2014-01-01

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演算法是指利用電腦解決問(wèn)題所需要的具體方法和步驟。也就是說(shuō)給定初始狀態(tài)或輸入數(shù)據(jù)

演算法是指利用電腦解決問(wèn)題所需要的具體方法和步驟。也就是說(shuō)給定初始狀態(tài)或輸入數(shù)據(jù)，經(jīng)過(guò)電腦程序的有限次運(yùn)算，能夠得出所要求或期望的終止?fàn)顟B(tài)或輸出數(shù)據(jù)。本書介紹電腦科學(xué)中重要的演算法及其分析與設(shè)計(jì)技術(shù)

標(biāo)簽： 算法

上傳時(shí)間： 2017-06-09

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最長(zhǎng)上升子序列非常經(jīng)典的問(wèn)題。給定的整數(shù)序列

最長(zhǎng)上升子序列非常經(jīng)典的問(wèn)題。給定的整數(shù)序列，請(qǐng)求出其最長(zhǎng)上升子序列的長(zhǎng)度。有多個(gè)測(cè)試用例。每個(gè)測(cè)試用例由一個(gè)行整數(shù)組成，其中第一個(gè)是一個(gè)整數(shù) n (1 ≤ n ≤ 10000)，表示給定序列的長(zhǎng)度。然后是 n 個(gè) 32-bits 帶符號(hào)整數(shù)表示序列中的元素。輸入直至沒(méi)有數(shù)據(jù)或者遇到長(zhǎng)度 n 是非正數(shù)為止。

標(biāo)簽： 序列整數(shù)

上傳時(shí)間： 2014-01-04

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一份射頻PCB設(shè)計(jì)的經(jīng)驗(yàn)總結(jié)。涉及到手機(jī)

一份射頻PCB設(shè)計(jì)的經(jīng)驗(yàn)總結(jié)。涉及到手機(jī)，GPS，等高頻電路的PCB設(shè)計(jì)方法。

標(biāo)簽： PCB

上傳時(shí)間： 2017-07-21

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離散卷積計(jì)算實(shí)驗(yàn)步驟：主界面下進(jìn)入實(shí)驗(yàn)五的“離散卷積計(jì)算”子實(shí)驗(yàn)

離散卷積計(jì)算實(shí)驗(yàn)步驟：主界面下進(jìn)入實(shí)驗(yàn)五的“離散卷積計(jì)算”子實(shí)驗(yàn)，輸入有限長(zhǎng)序列 x(n) 輸入有限長(zhǎng)序列 h(n) 鼠標(biāo)單擊確定按鈕，以數(shù)值和圖形兩種方式顯示卷積結(jié)果

標(biāo)簽： 實(shí)驗(yàn) 離散卷積計(jì)算

上傳時(shí)間： 2013-12-17

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DFT 計(jì)算實(shí)驗(yàn)步驟：主界面下進(jìn)入實(shí)驗(yàn)九的“DFT計(jì)算”的子實(shí)驗(yàn)。輸入取樣點(diǎn)數(shù)

DFT 計(jì)算實(shí)驗(yàn)步驟：主界面下進(jìn)入實(shí)驗(yàn)九的“DFT計(jì)算”的子實(shí)驗(yàn)。輸入取樣點(diǎn)數(shù)，即有限長(zhǎng)序列 x(n) 的長(zhǎng)度。輸入信號(hào)表達(dá)式，或直接輸入離散序列。鼠標(biāo)單擊確定按鈕，顯示原序列及 DFT 系數(shù)的幅度、相位。

標(biāo)簽： DFT 實(shí)驗(yàn) 計(jì)算輸入

上傳時(shí)間： 2017-07-24

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Fortran - Tóm tắ t nộ i dung mô n họ c Các khái niệ m và yế u tố

Fortran - Tóm tắ t nộ i dung mô n họ c Các khái niệ m và yế u tố trong ngô n ngữ lậ p trình FORTRAN. Các câ u lệ nh củ a ngô n ngữ FORTRAN. Cơ bả n về chư ơ ng chư ơ ng dị ch và mô i trư ờ ng lậ p trình DIGITAL Visual Fortran. Viế t và chạ y các chư ơ ng trình cho các bài toán đ ơ n giả n bằ ng ngô n ngữ FORTRAN.

標(biāo)簽： Fortran 7855 7897 7885

上傳時(shí)間： 2013-12-25

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ESD Protection in CMOS ICs

在互補(bǔ)式金氧半(CMOS)積體電路中，隨著量產(chǎn)製程的演進(jìn)，元件的尺寸已縮減到深次微米(deep-submicron)階段，以增進(jìn)積體電路(IC)的性能及運(yùn)算速度，以及降低每顆晶片的製造成本。但隨著元件尺寸的縮減，卻出現(xiàn)一些可靠度的問(wèn)題。在次微米技術(shù)中，為了克服所謂熱載子(Hot-Carrier)問(wèn)題而發(fā)展出 LDD(Lightly-Doped Drain) 製程與結(jié)構(gòu); 為了降低 CMOS 元件汲極(drain)與源極(source)的寄生電阻(sheet resistance) Rs 與 Rd，而發(fā)展出 Silicide 製程; 為了降低 CMOS 元件閘級(jí)的寄生電阻 Rg，而發(fā)展出 Polycide 製程 ; 在更進(jìn)步的製程中把 Silicide 與 Polycide 一起製造，而發(fā)展出所謂 Salicide 製程

標(biāo)簽： Protection CMOS ESD ICs in

上傳時(shí)間： 2020-06-05

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高速電路設(shè)計(jì) 詳細(xì)基礎(chǔ)理論知識(shí)

設(shè)計(jì)高速電路必須考慮高速訊號(hào)所引發(fā)的電磁干擾、阻抗匹配及串音等效應(yīng)，所以訊號(hào)完整性 (signal integrity)將是考量設(shè)計(jì)電路優(yōu)劣的一項(xiàng)重要指標(biāo)，電路日異複雜必須仰賴可靠的軟體來(lái)幫忙分析這些複雜的效應(yīng)，才比較可能獲得高品質(zhì)且可靠的設(shè)計(jì)，因此熟悉軟體的使用也將是重要的研究項(xiàng)目之一。另外了解高速訊號(hào)所引發(fā)之各種效應(yīng)(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路設(shè)計(jì)的重點(diǎn)之一。目前高速示波器的功能越來(lái)越多，使用上很複雜，必須事先進(jìn)修學(xué)習(xí)，否則無(wú)法全盤了解儀器之功能，因而無(wú)法有效發(fā)揮儀器的量測(cè)功能。其次就是高速訊號(hào)量測(cè)與介面的一些測(cè)試規(guī)範(fàn)也必須熟悉，像眼圖分析，探針效應(yīng)，抖動(dòng)(jitter)測(cè)量規(guī)範(fàn)及高速串列介面量測(cè)規(guī)範(fàn)等實(shí)務(wù)技術(shù)，必須充分了解研究學(xué)習(xí)，進(jìn)而才可設(shè)計(jì)出優(yōu)良之教學(xué)教材及教具。

標(biāo)簽： 高速電路

上傳時(shí)間： 2021-11-02

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