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電子節(jié)(jié)能燈

  • 能饋式交流電子模擬負載的研究.rar

    隨著電力電子技術的發(fā)展,各類電力電子裝置應運而生,這些產品在出廠前需要根據(jù)不同的需要進行相應的測試和校驗。傳統(tǒng)的負載測試存在著能耗大、靈活性差等諸多缺點,已經越來越不能滿足各種測試場合的要求,特別是一些要求用動態(tài)變化的負載、非線性負載、具有負阻特性的負載以及有源負載等測試場合。因此針對這一問題,本文利用電力電子技術結合計算機技術、控制技術等設計了一種通用的交流電子負載模擬裝置,以滿足各種測試場合的要求。 @@ 交流電子負載是一種可以模擬真實負載的電力電子裝置,它不但可以模擬傳統(tǒng)的線性負載,也可以模擬各種非線性負載、有源負載等其他形式的負載。目前國內外對電子負載的研究還不成熟,有些是使交流電源按照一定的功率放電,但是輸出電流卻與真實負載測試下的電流有較大的差別;而有些雖然能夠準確控制電源的放電電流取得和真實負載一樣的效果,但試驗電能完全被消耗掉,造成很大的浪費。本文研究的新型交流電子負載克服了以上電子負載方案的缺點,可以滿足各種試驗場合的測試需求,能夠在很大程度上減少能量浪費,豐富試驗樣式且節(jié)約試驗成本。 @@ 本文分析了能饋式交流電子負載的模擬原理,確定了采用中間直流環(huán)節(jié)的交-直-交主電路結構,其一端接待測交流電源,另一端接低壓交流電網。前級負載模擬環(huán)節(jié)和后級能量回饋環(huán)節(jié)均采用可四象限運行的電壓型PWM(Pulse Width Modulation)變換器。負載模擬環(huán)節(jié)直接與待測電源連接,采用電流滯環(huán)瞬時值比較方式,使電源輸出的實際電流信號準確、快速的跟蹤其指令電流信號值,使得電子負載對待測電源呈現(xiàn)設定的負載形式,完成電子負載的模擬功能;能量回饋環(huán)節(jié)與電網連接,通過控制輸出電流與電網電壓同頻、同相位,實現(xiàn)試驗電能的單位功率因數(shù)回饋電網的目的,變換器的控制采用常規(guī)的雙閉環(huán)控制方式,電流內環(huán)控制實際電流跟蹤指令值的變化,電壓外環(huán)通過控制輸出電流的大小使直流側母線電壓穩(wěn)定為設定指令值。 @@ 電子負載系統(tǒng)在負載模擬部分通過人機接口設定具體負載形式和負載屬性,為了更加準確快速的得到電流指令信號值,文中采用更加直接的數(shù)值計算方 法,由數(shù)字信號處理器實時計算出該給定負載模式下的指令電流值。使用交流小信號分析法得到了系統(tǒng)的頻域方塊圖,并對主電路元件參數(shù)以及調節(jié)器進行了優(yōu)化設計。針對大功率開關管開關頻率存在的限制,本文提出了幾種提高電流跟蹤精度的改進方法,取得了良好的效果。整個系統(tǒng)在PSIM平臺上進行了不同工作模式下的仿真,仿真結果表明方案切實可行。最后依據(jù)仿真方案設計基于TMS320F2812的控制系統(tǒng)和功率電路,使用PROTEL軟件進行了原理圖的繪制。@@關鍵詞:電子負載;能量回饋;電壓型變換器;滯環(huán)PWM電流控制;雙閉環(huán);PWM整流器

    標簽: 能饋式 交流電子 模擬負載

    上傳時間: 2013-05-26

    上傳用戶:saharawalker

  • 分級變頻調壓軟起動器的設計與仿真研究.rar

    異步電動機的軟起動研究,是一項重要的研究課題。本文以分級變頻理論為基礎,利用數(shù)學分析的方法對分級變頻的子頻率系統(tǒng)進行了深入的研究,總結了各級子頻率系統(tǒng)的電壓相序情況以及最優(yōu)的觸發(fā)角度。并且對傳統(tǒng)異步電動機軟起動器的主電路結構進行了改進,提出了從較低頻率開始分五級起動的分級變頻調壓軟起動形式,而且各級子頻率的起動都能實現(xiàn)最優(yōu)的正序電壓組合,保證了起動轉矩的最大化。通過對分級變頻調壓軟起動形式的建模和仿真試驗,證明了此方法可以在降低起動電流的同時實現(xiàn)異步電機的高轉矩起動,驗證了此方法的有效性和可行性。基于以上研究的成果,本文介紹了以TMS320LF2407ADSP芯片為核心的軟起動軟硬件設計方法。最后對本課題的進一步研究提出了展望。

    標簽: 分級 仿真研究 頻調

    上傳時間: 2013-04-24

    上傳用戶:assss

  • 動態(tài)匹配換能器的超聲波電源控制策略.rar

    超聲波電源廣泛應用于超聲波加工、診斷、清洗等領域,其負載超聲波換能器是一種將超音頻的電能轉變?yōu)闄C械振動的器件。由于超聲換能器是一種容性負載,因此換能器與發(fā)生器之間需要進行阻抗匹配才能工作在最佳狀態(tài)。串聯(lián)匹配能夠有效濾除開關型電源輸出方波存在的高次諧波成分,因此應用較為廣泛。但是環(huán)境溫度或元件老化等原因會導致?lián)Q能器的諧振頻率發(fā)生漂移,使諧振系統(tǒng)失諧。傳統(tǒng)的解決辦法就是頻率跟蹤,但是頻率跟蹤只能保證系統(tǒng)整體電壓電流同頻同相,由于工作頻率改變了而匹配電感不變,此時換能器內部動態(tài)支路工作在非諧振狀態(tài),導致?lián)Q能器功率損耗和發(fā)熱,致使輸出能量大幅度下降甚至停振,在實際應用中受到限制。所以,在跟蹤諧振點調節(jié)逆變器開關頻率的同時應改變匹配電感才能使諧振系統(tǒng)工作在最高效能狀態(tài)。針對按固定諧振點匹配超聲波換能器電感參數(shù)存在的缺點,本文應用耦合振蕩法對換能器的匹配電感和耦合頻率之間的關系建立數(shù)學模型,證實了匹配電感隨諧振頻率變化的規(guī)律。給出利用這一模型與耦合工作頻率之間的關系動態(tài)選擇換能器匹配電感的方法。經過分析比較,選擇了基于磁通控制原理的可控電抗器作為匹配電感,通過改變電抗控制度調節(jié)電抗值。并給出了實現(xiàn)這一方案的電路原理和控制方法。最后本文以DSP TMS320F2812為核心設計出實現(xiàn)這一原理的超聲波逆變電源。實驗結果表明基于磁通控制的可控電抗器可以實現(xiàn)電抗值隨電抗控制度線性無級可調,由于該電抗器輸出正弦波,理論上沒有諧波污染。具體采用復合控制策略,穩(wěn)態(tài)時,換能器工作在DPLL鎖定頻率上;動態(tài)時,逐步修改匹配電抗大小,搜索輸出電流的最大值,再結合DPLL鎖定該頻率。配合PS-PWM可實現(xiàn)功率連續(xù)可調。該超聲波換能系統(tǒng)能夠有效的跟隨最大電流輸出頻率,即使頻率發(fā)生漂移系統(tǒng)仍能保持工作在最佳狀態(tài),具有實際應用價值。

    標簽: 動態(tài) 換能器 超聲波電源

    上傳時間: 2013-04-24

    上傳用戶:lacsx

  • 電梯系統(tǒng)中超級電容儲能的研究.rar

    電梯在垂直升降的過程中,由于功率變化范圍很大,節(jié)能潛力巨大。本文主要工作在于結合電梯系統(tǒng)的特點,對超級電容儲能系統(tǒng)中超級電容容量需求及其他相關參數(shù)的設置進行詳細討論。也對與之配套的雙向DC/DC變換器進行研究。 本文在研究了電梯系統(tǒng)的結構和運行特點的基礎上,對其運行過程中能量狀態(tài)的變化進行了詳細分析,得到了儲能裝置中超級電容器容量的計算方法,并在此基礎上,根據(jù)超級電容器容量需求與系統(tǒng)前級雙向整流器功率的關系,提出了一套簡單有效的能量管理方案,減少了儲能裝置中超級電容器的容量需求。并且對于超級電容容量設置給出了一般的原則。 儲能裝置與系統(tǒng)直流母線之間需要雙向變換器進行能量傳遞,本文對于各種雙向直流變換器拓撲的優(yōu)缺點進行了比較,結合在超級電容儲能裝置中的具體應用需要,得出BUCK/BOOST型變換器更適合本文中的應用。 本文為儲能裝置設計了基于DSP(數(shù)字信號處理器)全數(shù)字控制的具有多種工作方式的雙向DC/DC變換器的小功率樣機,在電容器放電時,以恒流模式向直流母線輸送能量;在電容器充電時,以分段恒流模式或恒壓模式進行充電。文中給出了詳細的硬件電路以及數(shù)字控制部分的設計過程,并通過實驗進行了驗證。

    標簽: 電梯系統(tǒng) 儲能 超級電容

    上傳時間: 2013-04-24

    上傳用戶:冇尾飛鉈

  • TDSCDMA頻點拉遠系統(tǒng)的FPGA設計與實現(xiàn).rar

    隨著TD—SCDMA技術的不斷發(fā)展,TD—SCDMA系統(tǒng)產品也逐步成熟并隨之完善。產品家族日益豐富,室內型宏基站、室外型宏基站、分布式基站(BBU+RRU)、微基站等系列化基站產品逐步問世,可以滿足不同場景的建網需求。而分布式基站(BBU+RRU)越來越多地受到業(yè)界的關注和重視。 本文主要從TD—SCDMA頻點拉遠系統(tǒng)(RRU)和軟件無線電技術的發(fā)展入手,重點研究TD—SCDMA頻點拉遠系統(tǒng)的FPGA設計與實現(xiàn)。TD—SCDMA通信系統(tǒng)通過靈活分配不同的上下行時隙,實現(xiàn)業(yè)務的不對稱性,但是多路數(shù)字中頻所構成的系統(tǒng)成本高和控制的復雜性,以及TDD雙工模式下,系統(tǒng)的峰均比隨時隙數(shù)增加而增加,對整個頻點拉遠系統(tǒng)的前端放大器線性輸入提出了很高的要求。TD—SCDMA系統(tǒng)使用軟件無線電平臺,一方面軟件算法可以有效保證時隙分配的準確性,保證對前端控制器的開關控制,以及對上下行功率讀取計算和子幀的靈活提取,另一方面靈活的DUC/CFR算法可以有效的提高頻帶利用率和抗干擾能力,有效的控制TDD系統(tǒng)的峰均比,有效降低系統(tǒng)對前端放大器線性輸出能力的要求。 本文主要研究軟件無線電中DUC和CFR的關鍵技術以及FPGA實現(xiàn),DUC主要由3倍FIR內插成型濾波器、2倍插值補償濾波器以及5級CIC濾波器級聯(lián)組成;而CFR主要采用類似基帶削峰的加窗濾波的中頻削峰算法,可以降低相鄰信道的溢出,更有效的降低CF值。將DUC/CFR以單片F(xiàn)PGA實現(xiàn),能很好提高RRU性能,減少其硬件結構,降低成本,降低功耗,增加外部環(huán)境的穩(wěn)定性。

    標簽: TDSCDMA FPGA 頻點

    上傳時間: 2013-07-20

    上傳用戶:rishian

  • 基于H.264編解碼的算法優(yōu)化研究及FPGA的硬件實現(xiàn).rar

    H.264/AVC是由ITU和ISO兩大組織聯(lián)合組成的JVT共同制定的一項新的視頻壓縮技術標準,在較低帶寬上提供高質量的圖像傳輸是H.264/AVC的應用亮點。在同樣的視覺質量前提下,H.264/AVC比H.263和MPEG-4節(jié)約了50%的碼率。但H.264獲得優(yōu)越性能的代價是計算復雜度的增加,據(jù)估計其編碼的計算復雜度大約為H.263的3倍,因此很難應用于實時視頻處理領域。針對這一現(xiàn)狀,業(yè)內做了大量的研究工作,力圖降低其計算復雜度和提高運行效率。比如在運動估計方面,國內外在這方面的研究已經很成熟。而針對幀內/幀間預測編碼的研究卻較少。因此研究預測模式的快速算法具有理論意義和應用價值。 本文在詳細研究H.264標準視頻壓縮編碼特點基礎上,分析了H.264幀內編碼, 幀間編碼及變換,量化技術的原理及特點,提出了一種基于局部邊緣方向信息的快速幀內模式判決算法,通過結合SAD的模式選擇方法來減少模式選擇數(shù)目。它采用了Sobel梯度算子計算當前塊的邊緣信息,累加當前塊中屬于同一方向像素點的邊緣矢量構造不同模式下的邊緣方向直方圖,以便確定最可能的預測模式。該算法有效降低了編碼器的運算復雜度,在并未顯著降低編碼性能的情況下提升了編碼器效率。仿真表明:Foreman 圖像序列編碼性能有了提高,其中PSNR平均降低了0.06dB,Bitrate平均降低了19.4%,這大大提高了視頻傳輸?shù)馁|量。 另外在幀間預測模式選擇算法方面進行了改進研究:按順序對不同類型進行判決,有選擇地去比較可能模式,使得在有效減少需判決的模式數(shù)量的同時,結合小塊模式搜索中途停止準則來確定最優(yōu)模式。仿真表明:改進算法相對與原來算法能夠節(jié)省很多的編碼時間(平均下降了49.3%),但帶來的圖像質星的下降(平均下降0.08dB,可以忽略)和碼率較少的增加。 同時在整數(shù)DCT變換模塊中,提出了一種快速蝶形算法,使得對4×4點數(shù)據(jù)做一次變換,只需通過8×8次加法和2×8次移位運算便可完成,與原來12×8次加法和4×8次移位相比,新算法大大降低了運算復雜度。 最后介紹FPGA的特點及設計流程,并實現(xiàn)了H.264編解碼器中變換編碼及量化和熵解碼模塊的硬件。這種基于FPGA所實現(xiàn)的H.264編碼視頻處理模塊設計具備了成本低,周期短,設計方法靈活等優(yōu)點,具有廣闊的市場應用前景。 仿真表明,通過使用本文提出的幀內/幀間速算法方法可使得H.264編碼速度獲得顯著的提高,使H.264 Baseline編碼器能在PC平臺上實現(xiàn)實時編碼。

    標簽: FPGA 264 編解碼

    上傳時間: 2013-07-18

    上傳用戶:zukfu

  • 一種基于SIFT描述子的特征匹配新算法

    為了克服傳統(tǒng)的局部特征匹配算法對噪聲和圖像灰度非線性變換敏感的不足,提出了基于SIFT(Scale Invariant Feature Transform)描述算子的特征匹配算法。該算法首先

    標簽: SIFT 特征匹配 新算法

    上傳時間: 2013-04-24

    上傳用戶:hphh

  • FPGA的測試

    隨著FPGA(FieldProgrammableGateArray)器件的應用越來越廣泛且重要,F(xiàn)PGA的測試技術也得到了廣泛重視和研究。基于FPGA可編程的特性,應用獨立的測試(工廠測試)需要設計數(shù)個測試編程和測試向量來完成FPGA的測試,確保芯片在任何用戶可能的編程下都可靠工作。 本論文正是針對上述問題,以XilinxXC4000E系列FPGA為主要的研究對象,在詳細研究FPGA內部結構的基礎上,基于“分治法”的基本思路對FPGA的測試理論和方法做了探索性研究。 研究完成了對可編程邏輯模塊(ConfigrableLogicBlock)及其子模塊的測試。主要基于“分治法”對CLB及其子模塊進位邏輯(CLM)、查找表(LUT)的RAM工作模式等進行了測試劃分,分別實現(xiàn)了以“一維陣列”為基礎的測試配置和測試向量,以較少了測試編程次數(shù)完成了所有CLB資源的測試。 研究完成了對互連資源(ConfigrableInterconnectResource)的測試。基于普通數(shù)據(jù)總線的測試方法,針對互連資源主要由線段和NMOS開關管組成的特點及其自身的故障模型,通過手工連線實現(xiàn)測試配置,僅通過4次編程就實現(xiàn)了對其完全測試。 在測試理論研究的基礎上,我們開發(fā)了能對FPGA器件進行實際測試的測試平臺。基于硬件仿真器的測試平臺通過高速光纖連接工作站上的EDA仿真軟件,把軟件語言描述的測試波形通過硬件仿真器轉化為真實測試激勵,測試響應再讀回到仿真軟件進行觀察,能夠靈活、快速的完成FPGA器件的配置和測試。該平臺在國內首次實現(xiàn)了軟硬件協(xié)同在線測試FPGA。在該平臺支持下,我們成功完成了對各軍、民用型號FPGA的測試任務。 本研究成果為國內自主研發(fā)FPGA器件提供了有力保障,具有重大科研與實踐價值,成功解決了國外公司在FPGA測試技術上的壟斷問題,幫助國產FPGA器件實現(xiàn)完全國產化。

    標簽: FPGA 測試

    上傳時間: 2013-05-17

    上傳用戶:wangyi39

  • 基于FPGA組的ASIC邏輯驗證技術研究

    隨著ASIC設計規(guī)模的增長,功能驗證已成為整個開發(fā)周期的瓶頸。傳統(tǒng)的基于軟件模擬和硬件仿真的邏輯驗證方法已難以滿足應用的要求,基于FPGA組的原型驗證方法能有效縮短系統(tǒng)的開發(fā)周期,可提供更快更全面的驗證。由于FPGA芯片容量的增加跟不上ASIC設計規(guī)模的增長,單芯片已無法容納整個設計,所以常常需要對設計進行邏輯分割,將子邏輯塊映射到FPGA陣列中。 本文對邏輯驗證系統(tǒng)的可配置互連結構和ASIC邏輯分割算法進行了深入的研究,提出了FPGA陣列的非對稱可配置互連結構。與現(xiàn)有的對稱互連結構相比,該結構能提供更多的互連通道,可實現(xiàn)對I/O數(shù)量、電平類型和互連路徑的靈活配置。 本文對邏輯分割算法進行了較深入的研究。針對現(xiàn)有的兩類分割算法存在的不足,提出并實現(xiàn)了基于設計模塊的邏輯分割算法,該算法有三個重要特征:1)基于設計代碼;2)以模塊作為邏輯分割的最小單位;3)使用模塊資源信息指導邏輯分割過程,避免了設計分割過程的盲目性,簡化了邏輯分割過程。 本文還對并行邏輯分割方法進行了研究,提出了兩種基于不同任務分配策略的并行分割算法,并對其進行了模擬和性能分析;驗證了采用并行方案對ASIC邏輯進行分割和映射的可行性。 最后基于改進的芯片互連結構,使用原型系統(tǒng)驗證方法對某一大規(guī)模ASIC設計進行了邏輯分割和功能驗證。實驗結果表明,使用改進后的FPGA陣列互連結構可以更方便和快捷地實現(xiàn)ASIC設計的分割和驗證,不但能顯著提高芯片間互連路徑的利用率,而且能給邏輯分割乃至整個驗證過程提供更好的支持,滿足現(xiàn)在和將來大規(guī)模ASIC邏輯驗證的需求。

    標簽: FPGA ASIC 邏輯 驗證技術

    上傳時間: 2013-06-12

    上傳用戶:極客

  • 圖象壓縮系統(tǒng)中熵編解碼器的FPGA設計及實現(xiàn)

    隨著移動終端、多媒體、Internet網絡、通信,圖像掃描技術的發(fā)展,以及人們對圖象分辨率,質量要求的不斷提高,用軟件壓縮難以達到實時性要求,而且會帶來因傳輸大量原始圖象數(shù)據(jù)帶來的帶寬要求,因此采用硬件實現(xiàn)圖象壓縮已成為一種必然趨勢。而熵編碼單元作為圖像變換,量化后的處理環(huán)節(jié),是圖像壓縮中必不可少的部分。研究熵編解碼器的硬件實現(xiàn),具有廣闊的應用背景。本文以星載視頻圖像壓縮的硬件實現(xiàn)項目為背景,對熵編碼器和解碼器的硬件實現(xiàn)進行探討,給出了并行熵編碼和解碼器的實現(xiàn)方案。熵編解碼器中的難點是huffman編解碼器的實現(xiàn)。在設計并行huffman編碼方案時通過改善Huffman編碼器中變長碼流向定長碼流轉換時的控制邏輯,避免了因數(shù)據(jù)處理不及時造成數(shù)據(jù)丟失的可能性,從而保證了編碼的正確性。而在實現(xiàn)并行的huffman解碼器時,解碼算法充分利用了規(guī)則化碼書帶來的碼字的單調性,及在特定長度碼字集內碼字變化的連續(xù)性,將并行解碼由模式匹配轉換為算術運算,提高了存儲器的利用率、系統(tǒng)的解碼效率和速度。在實現(xiàn)并行huffman編碼的基礎上,結合針對DC子帶的預測編碼,針對直流子帶的游程編碼,能夠對圖像壓縮系統(tǒng)中經過DWT變換,量化,掃描后的數(shù)據(jù)進行正確的編碼。同時,在并行huffman解碼基礎上的熵解碼器也可以解碼出正確的數(shù)據(jù)提供給解碼系統(tǒng)的后續(xù)反量化模塊,進一步處理。在本文介紹的設計方案中,按照自頂向下的設計方法,對星載圖像壓縮系統(tǒng)中的熵編解碼器進行分析,進而進行邏輯功能分割及模塊劃分,然后分別實現(xiàn)各子模塊,并最終完成整個系統(tǒng)。在設計過程中,用高級硬件描述語言verilogHDL進行RTL級描述。利用了Altera公司的QuartusII開發(fā)平臺進行設計輸入、編譯、仿真,同時還采用modelsim仿真工具和symplicity的綜合工具,驗證了設計的正確性。通過系統(tǒng)波形仿真和下板驗證熵編碼器最高頻率可以達到127M,在62.5M的情況下工作正常。而熵解碼器也可正常工作在62.5M,吞吐量可達到2500Mbps,也能滿足性能要求。仿真驗證的結果表明:設計能夠滿足性能要求,并具有一定的使用價值。

    標簽: FPGA 圖象壓縮

    上傳時間: 2013-05-19

    上傳用戶:吳之波123

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