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電氣架構(gòu)(gòu)

  • 4x4鍵盤的設(shè)計(jì)與制作

    三種方法讀取鍵值􀂄 使用者設(shè)計(jì)行列鍵盤介面,一般常採用三種方法讀取鍵值。􀂉 中斷式􀂄 在鍵盤按下時(shí)產(chǎn)生一個(gè)外部中斷通知CPU,並由中斷處理程式通過不同位址讀資料線上的狀態(tài)判斷哪個(gè)按鍵被按下。􀂄 本實(shí)驗(yàn)採用中斷式實(shí)現(xiàn)使用者鍵盤介面。􀂉 掃描法􀂄 對(duì)鍵盤上的某一行送低電位,其他為高電位,然後讀取列值,若列值中有一位是低,表明該行與低電位對(duì)應(yīng)列的鍵被按下。否則掃描下一行。􀂉 反轉(zhuǎn)法􀂄 先將所有行掃描線輸出低電位,讀列值,若列值有一位是低表明有鍵按下;接著所有列掃描線輸出低電位,再讀行值。􀂄 根據(jù)讀到的值組合就可以查表得到鍵碼。4x4鍵盤按4行4列組成如圖電路結(jié)構(gòu)。按鍵按下將會(huì)使行列連成通路,這也是見的使用者鍵盤設(shè)計(jì)電路。 //-----------4X4鍵盤程序--------------// uchar keboard(void) { uchar xxa,yyb,i,key; if((PINC&0x0f)!=0x0f) //是否有按鍵按下 {delayms(1); //延時(shí)去抖動(dòng) if((PINC&0x0f)!=0x0f) //有按下則判斷 { xxa=~(PINC|0xf0); //0000xxxx DDRC=0x0f; PORTC=0xf0; delay_1ms(); yyb=~(PINC|0x0f); //xxxx0000 DDRC=0xf0; //復(fù)位 PORTC=0x0f; while((PINC&0x0f)!=0x0f) //按鍵是否放開 { display(data); } i=4; //計(jì)算返回碼 while(xxa!=0) { xxa=xxa>>1; i--; } if(yyb==0x80) key=i; else if(yyb==0x40) key=4+i; else if(yyb==0x20) key=8+i; else if(yyb==0x10) key=12+i; return key; //返回按下的鍵盤碼 } } else return 17; //沒有按鍵按下 }

    標(biāo)簽: 4x4 鍵盤

    上傳時(shí)間: 2013-11-12

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  • 這是用verilog寫的一個(gè)簡單的處理器

    這是用verilog寫的一個(gè)簡單的處理器,雖然只具有5個(gè)指令,但是可以透過這個(gè)範(fàn)例,來了解到cpu的架構(gòu),與如何開發(fā)處理器,相信會(huì)有很大的啟發(fā)。

    標(biāo)簽: verilog

    上傳時(shí)間: 2014-12-08

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  • Debussy是NOVAS Software, Inc(思源科技)發(fā)展的HDL Debug & Analysis tool

    Debussy是NOVAS Software, Inc(思源科技)發(fā)展的HDL Debug & Analysis tool,這套軟體主要不是用來跑模擬或看波形,它最強(qiáng)大的功能是:能夠在HDL source code、schematic diagram、waveform、state bubble diagram之間,即時(shí)做trace,協(xié)助工程師debug。 可能您會(huì)覺的:只要有simulator如ModelSim就可以做debug了,我何必再學(xué)這套軟體呢? 其實(shí)Debussy v5.0以後的新版本,還提供了nLint -- check coding style & synthesizable,這蠻有用的,可以協(xié)助工程師了解如何寫好coding style,並養(yǎng)成習(xí)慣。 下圖所示為整個(gè)Debussy的原理架構(gòu),可歸納幾個(gè)結(jié)論:

    標(biāo)簽: Analysis Software Debussy Debug

    上傳時(shí)間: 2014-01-14

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  • Struts結(jié)合了數(shù)個(gè)技術(shù)

    Struts結(jié)合了數(shù)個(gè)技術(shù),為了要瞭解Struts,您必須先瞭解JSP/Servlet相關(guān)技術(shù),必須先瞭解MVC、Model 1、Model 2等架構(gòu)模式。

    標(biāo)簽: Struts

    上傳時(shí)間: 2013-12-21

    上傳用戶:lhc9102

  • 類神經(jīng)網(wǎng)路

    類神經(jīng)網(wǎng)路,MLP程式碼,可以計(jì)算多層架構(gòu)之類神經(jīng)網(wǎng)路運(yùn)算~C

    標(biāo)簽:

    上傳時(shí)間: 2013-12-28

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  • JVT所釋出的H.264/MPEG-4 AVC REFERENCE SOFTWARE MANUAL,

    JVT所釋出的H.264/MPEG-4 AVC REFERENCE SOFTWARE MANUAL,,裡面詳細(xì)介紹了jm的架構(gòu),以及其中 各種演算法所存在的類別,所以接觸jm的朋友,是一個(gè)非常好的嚮導(dǎo),幫助你了解大概的jm雛形.

    標(biāo)簽: REFERENCE SOFTWARE MANUAL MPEG

    上傳時(shí)間: 2013-12-20

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  • GPRS_CHT技術(shù)文檔

    GPRS_CHT技術(shù)文檔,包括主要詳細(xì)介紹GPRS的通訊協(xié)定,內(nèi)容包括GPRS 所要提供的功能、系統(tǒng)架構(gòu)、 各個(gè)網(wǎng)路元件、各元件間定義的介面、計(jì)費(fèi)系統(tǒng)與GSM 演進(jìn)為GPRS 所採 行的方式。其中GPRS 介面部份,抽出來獨(dú)立成為GPRS_Interface 檔案

    標(biāo)簽: GPRS_CHT 文檔

    上傳時(shí)間: 2014-01-20

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  • 使用Flash提供的Web Service的能力

    使用Flash提供的Web Service的能力,利用這個(gè)能力與SOAP Server連接並做資料的存取。而這篇文章將以一個(gè)極簡單的範(fàn)例來說明如何透過Flash取得想要的資料。關(guān)於SOAP Server的製作請(qǐng)參考之前撰寫的"Pyhon的SOAP Library"這篇文章,這篇文章有教大家如何使用python這個(gè)程式語言實(shí)作一個(gè)RPC Server,提供其他程式作遠(yuǎn)端呼叫。我提供RPC Server的製作,而我會(huì)使用python來架構(gòu)RPC Server,使用python內(nèi)建的函式庫來實(shí)作該Server。 需要工具; 1. Flash 8.0 2. Python 2.3 以上

    標(biāo)簽: Service Flash Web

    上傳時(shí)間: 2014-01-25

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  • 在GIS領(lǐng)域中

    在GIS領(lǐng)域中,目前正有一新興的架構(gòu)模式產(chǎn)生,此架構(gòu)改變了GIS處理圖資的方式,此架構(gòu)模式稱為DGIS(Distributed GIS-分散式地理資訊系統(tǒng))。DGIS將傳統(tǒng)桌上型單機(jī)作業(yè)之GIS概念延伸至網(wǎng)際網(wǎng)路(Web)之解決方案上,以能符合現(xiàn)行系統(tǒng)圖資處理之需求。而此種以分散式概念延伸至網(wǎng)際網(wǎng)路的架構(gòu)稱之為網(wǎng)際網(wǎng)路地理資訊系統(tǒng)(WebGIS或Internet GIS)。

    標(biāo)簽: GIS

    上傳時(shí)間: 2014-01-17

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  • OPEN-JTAG ARM JTAG 測(cè)試原理 1 前言 本篇報(bào)告主要介紹ARM JTAG測(cè)試的基本原理。基本的內(nèi)容包括了TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN

    OPEN-JTAG ARM JTAG 測(cè)試原理 1 前言 本篇報(bào)告主要介紹ARM JTAG測(cè)試的基本原理。基本的內(nèi)容包括了TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN ARCHITECTURE的介紹,在此基礎(chǔ)上,結(jié)合ARM7TDMI詳細(xì)介紹了的JTAG測(cè)試原理。 2 IEEE Standard 1149.1 - Test Access Port and Boundary-Scan Architecture 從IEEE的JTAG測(cè)試標(biāo)準(zhǔn)開始,JTAG是JOINT TEST ACTION GROUP的簡稱。IEEE 1149.1標(biāo)準(zhǔn)最初是由JTAG這個(gè)組織提出,最終由IEEE批準(zhǔn)並且標(biāo)準(zhǔn)化,所以,IEEE 1149.1這個(gè)標(biāo)準(zhǔn)一般也俗稱JTAG測(cè)試標(biāo)準(zhǔn)。 接下來介紹TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN ARCHITECTURE的基本架構(gòu)。

    標(biāo)簽: JTAG BOUNDARY-SCAN OPEN-JTAG ARM

    上傳時(shí)間: 2016-08-16

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