是一個(gè)用verilog寫成的加法器電路,可把七個(gè)元件加起來
標(biāo)簽： verilog 加法器 元件
上傳時(shí)間： 2014-01-07
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Cisco 電話概論文章,語音技術(shù)概略
標(biāo)簽： Cisco
上傳時(shí)間： 2016-04-26
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這是一個(gè)Verilog的電梯控制程序碼,控制樓層為1~4樓,關(guān)開門...等
標(biāo)簽： Verilog 控制 程序
上傳時(shí)間： 2016-05-04
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使用硬體描述語言HDL 設(shè)計(jì)硬體電路，臺灣人寫的PPT講義，非常不錯(cuò)。VHDL硬件設(shè)計(jì)入門學(xué)習(xí)。VHDL基本語法架構(gòu)，VHDL的零件庫(Library)及包裝(Package)等內(nèi)容。
標(biāo)簽： HDL
上傳時(shí)間： 2014-01-22
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電子書Absolute.C.plus.plu
標(biāo)簽： Absolute plus plu
上傳時(shí)間： 2013-12-23
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5 bits 的加法器與減法器合併電路之原始程式製作
標(biāo)簽： bits 加法器 法器 程式
上傳時(shí)間： 2016-05-18
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Accelerated c++ 電子書 對 c++ container 多有描述
標(biāo)簽： Accelerated container
上傳時(shí)間： 2014-01-15
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解power flow CODE(學(xué)電力系統(tǒng)必備的東西)(內(nèi)含詳細(xì)註解)
標(biāo)簽： power flow CODE 系統(tǒng)
上傳時(shí)間： 2013-11-29
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接收機(jī)的經(jīng)典電子書想學(xué)習(xí)的人多多下載對你有幫助的
標(biāo)簽： 接收
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基于89s52的最小系統(tǒng)按鍵音樂計(jì)時(shí)系統(tǒng)
標(biāo)簽： 89s52 系統(tǒng)
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