文中設計了一個性能良好、結構簡單、成本低廉、維護方便的電子鋸齒波產生器。介紹了這種電子鋸齒波產生器的結構,說明了它的工作原理,定量地用自動控制理論分析和推導了它的性能,并介紹了它的檢修思路。
標簽： 電子 產生器 方案 鋸齒波
上傳時間： 2015-01-03
上傳用戶：yan2267246
工頻正玄波的逆變器電路，成熟使用的方案，請用作設計參考，thx
標簽： 工頻 正 逆變器電路
上傳時間： 2014-01-01
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PWM輸出實驗 1) 熟悉LF2407的事件管理模塊 2) 學會用通用定時器產生PWM波 一個簡單的pwm波產生程序！
標簽： PWM 2407 pwm LF
上傳時間： 2015-06-07
上傳用戶：wweqas
基于DSP的fangbo.asm 利用定時器Timer0在XF腳產生周期1s的的方波 此程序采用100Mhz的時鐘頻率，產生的方波
標簽： fangbo Timer0 DSP 100
上傳時間： 2014-01-13
上傳用戶：shus521
正弦波數據產生器， 升級版本，用ＶＣ＋＋編寫
標簽： 正弦波 數據 產生器
上傳時間： 2015-08-11
上傳用戶：gmh1314
使用定時器產生PWM波，可配合L298N用來驅動普通直流電機。適用于51單片機
標簽： PWM 定時器
上傳時間： 2015-08-31
上傳用戶：wangzhen1990
yx-em-sy485讀寫器模塊 y x-em-sy485讀寫器模塊
標簽： 485 yx-em-sy x-em-sy 讀寫器
上傳時間： 2014-06-09
上傳用戶：chens000
用verilog設計密勒解碼器 一、題目： 設計一個密勒解碼器電路 二、輸入信號： 1． DIN：輸入數據 2． CLK：頻率為2MHz的方波，占空比為50％ 3． RESET：復位信號，低有效 三、輸入信號說明： 輸入數據為串行改進密勒碼，每個碼元持續時間為8μs，即16個CLK時鐘；數據流是由A、B、C三種信號組成； A：前8個時鐘保持“1”，接著5個時鐘變為“0”，最后3個時鐘為“1”。 B：在整個碼元持續時間內都沒有出現“0”，即連續16個時鐘保持“1”。 C：前5個時鐘保持“0”，后面11個時鐘保持“1”。 改進密勒碼編碼規則如下： 如果碼元為邏輯“1”，用A信號表示。 如果碼元為邏輯“0”，用B信號表示，但以下兩種特例除外：如果出現兩個以上連“0”，則從第二個“0”起用C信號表示；如果在“通信起始位”之后第一位就是“0”，則用C信號表示，以下類推； “通信起始位”，用C信號表示； “通信結束位”，用“0”及緊隨其后的B信號表示。 “無數據”，用連續的B信號表示。
標簽： verilog 2MHz DIN CLK
上傳時間： 2013-12-02
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dsp實驗測試程序,包括指令實驗、存儲器、串口、同步串口、步進電機、硬件中斷、定時器、交通燈、直流電機、濾波器、正弦波發生器、語音錄放、EXAM_C、顯示屏
標簽： EXAM_C dsp 實驗 串口
上傳時間： 2015-09-26
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蜂鳴器實驗 向蜂鳴器發送一定頻率的方波可以使蜂鳴器發出相應的音調，該實驗通過設計一個狀 態機和分頻器使蜂鳴器發出“多來咪發梭拉西多”的音調。
標簽： 蜂鳴器 實驗 發送 定頻
上傳時間： 2013-12-25
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