將Verilog設計轉成VHDL設計的程式
標簽： Verilog VHDL 程式
上傳時間： 2016-01-18
上傳用戶：lifangyuan12
將VHDL設計轉換成Verilog設計的程式
上傳用戶：wkchong
JPEG的硬體設計採用的是VHDL設計,有源碼
標簽： JPEG VHDL 有源
上傳用戶：agent
工作流表單模版 包含9個類別73個表單，基本含蓋了所有的辦公需要的表單。
標簽： 表單 模版
上傳時間： 2016-01-19
上傳用戶：6546544
10小時學會C語言..這個是電子書..有需要的人可以下載
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上傳時間： 2014-11-17
上傳用戶：yy541071797
使用FPGA設計WiMax接收機之OFDM同步硬體電路(內附VHDL code)
標簽： WiMax FPGA OFDM VHDL
上傳時間： 2016-01-22
上傳用戶：zhuyibin
鏈表的例程 一種模版 用指針c++實現的一種源程序
標簽： 模版 指針 源程序
上傳用戶：hasan2015
一個簡單的游戲設計...好好玩的
上傳時間： 2013-12-31
上傳用戶：edisonfather
公司內部的一個測試用例的模版，iso9000用的。
標簽： 測試 模版
上傳時間： 2016-01-26
上傳用戶：daoxiang126
Proakis 的通訊課本解答~ 學通訊的重點書籍~歡迎使用
標簽： Proakis
上傳時間： 2016-01-27
上傳用戶：hjshhyy
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