用verilog設計密勒解碼器 一、題目： 設計一個密勒解碼器電路 二、輸入信號： 1． DIN：輸入數(shù)據(jù) 2． CLK：頻率為2MHz的方波，占空比為50％ 3． RESET：復位信號，低有效 三、輸入信號說明： 輸入數(shù)據(jù)為串行改進密勒碼，每個碼元持續(xù)時間為8μs，即16個CLK時鐘；數(shù)據(jù)流是由A、B、C三種信號組成； A：前8個時鐘保持“1”，接著5個時鐘變?yōu)椤?”，最后3個時鐘為“1”。 B：在整個碼元持續(xù)時間內(nèi)都沒有出現(xiàn)“0”，即連續(xù)16個時鐘保持“1”。 C：前5個時鐘保持“0”，后面11個時鐘保持“1”。 改進密勒碼編碼規(guī)則如下： 如果碼元為邏輯“1”，用A信號表示。 如果碼元為邏輯“0”，用B信號表示，但以下兩種特例除外：如果出現(xiàn)兩個以上連“0”，則從第二個“0”起用C信號表示；如果在“通信起始位”之后第一位就是“0”，則用C信號表示，以下類推； “通信起始位”，用C信號表示； “通信結束位”，用“0”及緊隨其后的B信號表示。 “無數(shù)據(jù)”，用連續(xù)的B信號表示。
標簽： verilog 2MHz DIN CLK
上傳時間： 2013-12-02
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dsp實驗測試程序,包括指令實驗、存儲器、串口、同步串口、步進電機、硬件中斷、定時器、交通燈、直流電機、濾波器、正弦波發(fā)生器、語音錄放、EXAM_C、顯示屏
標簽： EXAM_C dsp 實驗 串口
上傳時間： 2015-09-26
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SPBA01B是由凌陽公司開發(fā)的可級連的單片I0、總線擴展芯片。它具有使用簡單、擴展能力強、性價比高的特點。本程序實現(xiàn)了如何利用SPBA01B來對SPCE061A進行IO擴展。
標簽： SPBA 01B 01 061A
上傳時間： 2014-01-21
上傳用戶：lindor
本文詳細介紹了制作電路板的方法及步驟. 實驗板的功能 這個實驗板可以做如下實驗： 1．可以進行運算器（加、減、乘和除法）、比較器、譯碼器、編碼器、選擇器、分配器和一般組合電路的實驗 2．可以進行觸發(fā)器、寄存器、計數(shù)器和一般時序電路的實驗 3．可以進行頻率計電路、時鐘電路、計時電路、交通燈等復雜數(shù)字系統(tǒng)的實驗 4．加擴展板可以進行A/D、D/A、串行E2ROM和8031單片機等方面的實驗
標簽： 實驗板 實驗 詳細介紹 電路板
上傳時間： 2015-10-02
上傳用戶：colinal
matlab繪圖教程（1、 學習MATLAB的各種二維繪圖； 2、 學習MATLAB的三維繪圖； 3、 MATLAB的繪圖修飾； 4、 基本句柄繪圖操作。 ）
標簽： MATLAB 繪圖 matlab 教程
上傳時間： 2014-01-19
上傳用戶：wangdean1101
本程序包括三個功能：按前序遍歷的方式創(chuàng)建二叉樹、前序遍歷顯示二叉樹、完全二叉樹的判斷。其中，#表示空樹
標簽： 二叉樹 程序 方式
上傳時間： 2014-07-16
上傳用戶：TRIFCT
詞法分析程序。可實現(xiàn)對C語言的詞法分析,關鍵字32個,包含了C的絕大部分運算、限界符,主要是對文件進行讀、寫操作,節(jié)省內(nèi)存消耗,是一個不錯的詞法分析程序。
標簽： 分 程序 C語言 內(nèi)存
上傳時間： 2013-12-29
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delphi動態(tài)構造系統(tǒng) 程序可以幫助你動態(tài)建立數(shù)據(jù)庫表、建立業(yè)務邏輯、 動態(tài)建立操作界面、生成的操作界面還可以任意調(diào)整、 動態(tài)的生成萬能查詢、動態(tài)建立你所需要的各種報表
標簽： 動態(tài) delphi 操作界面
上傳時間： 2015-10-16
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用原理圖輸入法設計門電路 一、 實驗目的 ◆通過一個簡單的反向器的現(xiàn)實，初步了解CPLD開發(fā)的全過程。 ◆學會利用軟件仿真和硬件實現(xiàn)對數(shù)字電路的邏輯功能進行驗證和分析。 ◆能夠通過CPLD開發(fā)實現(xiàn)具有反向器功能的數(shù)字電路。 二、實驗軟件主要功能的介紹...........
標簽： 原理圖 輸入法 實驗 反向器
上傳時間： 2014-11-29
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BBS論壇的詳細設計 1、MVC中的視圖層的設計 2、MVC中的控制層的設計 3、MVC中的模型層設計----業(yè)務處理組件等
標簽： MVC BBS 論壇 圖層
上傳時間： 2014-12-08
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