VHDL 基礎(chǔ)程序百例 FPGA 邏輯設(shè)計源碼VHDL語言100例第1例 帶控制端口的加法器第2例 無控制端口的加法器第3例 乘法器第4例 比較器第5例 二路選擇器第6例 寄存器第7例 移位寄存器第8例 綜合單元庫第9例 七值邏輯與基本數(shù)據(jù)類型第10例 函數(shù)第11例 七值邏輯線或分辨函數(shù)第12例 轉(zhuǎn)換函數(shù)第13例 左移函數(shù)第14例 七值邏輯程序包第15例 四輸入多路器第16例 目標選擇器第17例 奇偶校驗器第18例 映射單元庫及其使用舉第19例 循環(huán)邊界常數(shù)化測試第20例 保護保留字第21例 進程死鎖 第22例 振蕩與死鎖第23例 振蕩電路第24例 分辨信號與分辨函數(shù)第25例 信號驅(qū)動源第26例 屬性TRANSACTION和分辨信號第27例 塊保護及屬性EVENT,第28例 形式參數(shù)屬性的測試第29例 進程和并發(fā)語句第30例 信號發(fā)送與接收第31例 中斷處理優(yōu)先機制建模第32例 過程限定第33例 整數(shù)比較器及其測試第34例 數(shù)據(jù)總線的讀寫第35例 基于總線的數(shù)據(jù)通道第36例 基于多路器的數(shù)據(jù)通道第37例 四值邏輯函數(shù)第38例 四值邏輯向量按位或運算第39例 生成語句描述規(guī)則結(jié)構(gòu)第40例 帶類屬的譯碼器描述第41例 帶類屬的測試平臺第42例 行為與結(jié)構(gòu)的混合描述第43例 四位移位寄存器第44例 寄存／計數(shù)器第45例 順序過程調(diào)用第46例 VHDL中g(shù)eneric缺省值的使用第47例 無輸入元件的模擬第48例 測試激勵向量的編寫第49例 delta延遲例釋第50例 慣性延遲分析第51例 傳輸延遲驅(qū)動優(yōu)先第52例 多倍（次）分頻器第53例 三位計數(shù)器與測試平臺第54例 分秒計數(shù)顯示器的行為描述6第55例 地址計數(shù)器第56例 指令預讀計數(shù)器第57例 加.c減.c乘指令的譯碼和操作第58例 2－4譯碼器結(jié)構(gòu)描述第59例 2－4譯碼器行為描述第60例 轉(zhuǎn)換函數(shù)在元件例示中的應用第61例 基于同一基類型的兩分辨類型的賦值相容問題第62例 最大公約數(shù)的計算第63例 最大公約數(shù)七段顯示器編碼第64例 交通燈控制器第65例 空調(diào)系統(tǒng)有限狀態(tài)自動機第66例 FIR濾波器第67例 五階橢圓濾波器第68例 鬧鐘系統(tǒng)的控制第69例 鬧鐘系統(tǒng)的譯碼第70例 鬧鐘系統(tǒng)的移位寄存器第71例 鬧鐘系統(tǒng)的鬧鐘寄存器和時間計數(shù)器第72例 鬧鐘系統(tǒng)的顯示驅(qū)動器第73例 鬧鐘系統(tǒng)的分頻器第74例 鬧鐘系統(tǒng)的整體組裝第75例 存儲器第76例 電機轉(zhuǎn)速控制器第77例 神經(jīng)元計算機第78例ccAm2901四位微處理器的ALU輸入第79例ccAm2901四位微處理器的ALU第80例ccAm2901四位微處理器的RAM第81例ccAm2901四位微處理器的寄存器第82例ccAm2901四位微處理器的輸出與移位第83例ccAm2910四位微程序控制器中的多路選擇器第84例ccAm2910四位微程序控制器中的計數(shù)器／寄存器第85例ccAm2910四位微程序控制器的指令計數(shù)器第86例ccAm2910四位微程序控制器的堆棧第87例 Am2910四位微程序控制器的指令譯碼器第88例 可控制計數(shù)器第89例 四位超前進位加法器第90例 實現(xiàn)窗口搜索算法的并行系統(tǒng)（1）——協(xié)同處理器第91例 實現(xiàn)窗口搜索算法的并行系統(tǒng)（2）——序列存儲器第92例 實現(xiàn)窗口搜索算法的并行系統(tǒng)（3）——字符串存儲器第93例 實現(xiàn)窗口搜索算法的并行系統(tǒng)（4）——頂層控制器第94例 MB86901流水線行為描述組成框架第95例 MB86901寄存器文件管理的描述第96例 MB86901內(nèi)ALU的行為描述第97例 移位指令的行為描述第98例 單周期指令的描述第99例 多周期指令的描述第100例 MB86901流水線行為模型
標簽：
vhdl
fpga
上傳時間：
2022-05-14
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