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高性能計算

單相有源ACDC變換器及高性能功率模塊的研究與應用

高功率因數、高效率、低噪音是電源裝置和用電設備普遍追求的品質。本文以單相有源功率因數校正控制器和高性能功率模塊的研制、開發為依托，對其從理論和應用開發兩個方面進行了較為全面的研究和討論。

標簽： ACDC 單相功率模塊有源

上傳時間： 2014-01-22

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高性能電源自動化測試系統

UTS-625是AUTOTEST公司一套高性能電源測試系統，它集合了所有電源的測試功能，成為了電源測試的最終解決方案。UTS系列開放的終端體系結構讓客戶自行配置系統結構，來匹配電源測試一般和特殊功能，以達到一方和多方面應用的效果。彈性化設計的自動化測試系統不但可以滿足資訊產業，能訊產業，以致滿足航天，國防等電源器種類繁多，規格多的特性，同時能夠滿足生產線產量大，效率高的需求。

標簽： 性能電源自動化測試系統

上傳時間： 2013-11-23

上傳用戶：15070202241
一種低功耗，高性能微處理器復位芯片的設計

針對廣泛使用電池供電的系統，由于電源電壓監控的要求，系統復位電路的可靠性對整個系統的穩定性起著非常重要的作用，本文研究并設計一種低功耗，高性能的復位芯片，可以在系統上電，掉電的情況下向微處理器提供復位信號。當電源電壓低于預設的門檻電壓時，輸出復位信號并在電源電壓恢復到門檻電壓以上繼續持續復位一段時間，實現整個系統的平穩恢復，復位信號低電平有效。該芯片采用CMSC035標準CMOS工藝實現，采用Cadence Spectre仿真，工作電流僅為10 μA。該芯片已成功應用于工業類控制系統中。

標簽： 低功耗性能微處理器復位芯

上傳時間： 2014-12-24

上傳用戶：Late_Li
計算器（可以算好多東西）

可以算RC常數，色環電阻，電阻串并聯，變壓器，有源濾波，無源濾波，二分頻，三分頻等

標簽： 計算器

上傳時間： 2013-10-12

上傳用戶：黃蛋的蛋黃
MICROTUNE推出高性能、低成本、超小型接收器芯片

來自日本東京，韓國首爾，美國德克薩斯普萊諾，2009年12月10日—MICROTUNE,INC.今日發布一款基于最新高集成硅技術的標準射頻-基帶芯片，此款芯片以極具吸引力的價格提供出色的電視接收性能。MT3141單芯片為全球電視制造商在下一代數字電視設計中引入高性能、低成本、超小型的接收器，從而使他們能夠提供所有品牌、型號、價格和屏幕尺寸的超薄超輕的高性能數字電視產品。

標簽： MICROTUNE 性能接收器芯片

上傳時間： 2013-10-23

上傳用戶：xitai
at89c2051 高性能CMOS 8位單片機

AT89C2051是一個低電壓，高性能CMOS 8位單片機，片內含2k bytes的可反復擦寫的只讀Flash程序存儲器和128 bytes的隨機存取數據存儲器（RAM），器件采用ATMEL公司的高密度、非易失性存儲技術生產，兼容標準MCS-51指令系統，片內置通用8位中央處理器和Flash存儲單元，功能強大AT89C2051單片機可為您提供許多高性價比的應用場合。AT89C2051是一個功能強大的單片機，但它只有20個引腳，15個雙向輸入/輸出（I/O）端口，其中P1是一個完整的8位雙向I/O口，兩個外中斷口，兩個16位可編程定時計數器,兩個全雙向串行通信口，一個模擬比較放大器。

標簽： c2051 2051 CMOS 89c

上傳時間： 2014-04-16

上傳用戶：ippler8
高性能可編程DMA控制接口82C37A-5

高性能可編程DMA控制接口82C37A-54.1 概述對象實體：直接存儲器訪問（DMA）控制接口芯片82C37A-5芯片的特點：1、管腳引線與NMOS 8237A-5兼容。2、允許/禁止單獨DMA請求控制。3、頻率從0~5MHz區間全靜態設計。4、低電平操作。 5、4個各自獨立的DMA通道并獨立的進行初始化。6、存儲器到存儲器之間傳送。7、存儲器模塊初始化處理。8、地址的增量和減量。9、傳送速率可達1.6MB/s.10、可直接擴展成任意數量的通道。11 、終止傳送的過程即輸入結束。12、軟件請求。13、獨立信號DREQ和信號DACK的極性控制。4.2 82C37A-5的體系結構4.2.1 基本結構描述1. 82C37A-5內部配備了規模為344位的內部存儲器，它是以寄存器的形式出現的。2. 配有3個基本的控制模塊：（1）定時及控制模塊；（2）優先級編碼及循環優先級控制模塊；（3）命令控制模塊； 3. 12個不同類型的寄存器。圖 4-1 82C37A-5結構圖EOP# A0~A3RESETCS#. IOW# DREQ0~DREQ3HLDAHRQ DB0~DB7DACK0~DACK3

標簽： DMA 82 37 性能

上傳時間： 2013-10-21

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基于Arria V和Cyclone V精度可調DSP模塊的高性能DSP應用與實現

本文是基于Arria V和Cyclone V精度可調DSP模塊的高性能DSP應用與實現（英文資料）

標簽： DSP Cyclone Arria 精度可調

上傳時間： 2014-12-28

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XAPP520將符合2.5V和3.3V I/O標準的7系列FPGA高性能I/O Bank進行連接

XAPP520將符合2.5V和3.3V I/O標準的7系列FPGA高性能I/O Bank進行連接 The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems

標簽： XAPP FPGA Bank 520

上傳時間： 2013-11-19

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基于FPGA的新型高性能永磁同步電機驅動系統設計

為了研制高性能的全數字永磁同步電機驅動系統，本文提出了一種基于FPGA的單芯片驅動控制方案。它采用硬件模塊化的現代EDA設計方法，使用VHDL硬件描述語言，實現了永磁同步電機矢量控制系統的設計。方案包括矢量變換、空間矢量脈寬調制(SVPWM)、電流環、速度環以及串行通訊等五部分。經過仿真和實驗表明，系統具有良好的穩定性和動態性能，調節轉速的范圍可以達到0.5r/min~4200r/min，對干擾誤差信號具有較強的容錯性，能夠滿足高性能的運動控制領域對永磁同步電機驅動系統的要求。

標簽： FPGA 性能永磁同步電機驅動

上傳時間： 2013-10-13

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