DSP與LabWindows_CVI的電力故障監測錄波器設計
標簽: LabWindows_CVI DSP 電力故障 波器設計
上傳時間: 2013-10-17
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陷波器是無限沖擊響應(IIR)數字濾波器,該濾波器可以用以下常系數線性差分方程表示:ΣΣ==−−−=MiNiiiinybinxany01)()()( (1)式中: x(n)和y(n)分別為輸人和輸出信號序列;和為濾波器系數。 iaib對式(1)兩邊進行z變換,得到數字濾波器的傳遞函數為: ΠΠΣΣ===−=−−−==NiiMiiNiiiMiiipzzzzbzazH1100)()()( (2)式中:和分別為傳遞函數的零點和極點。 izip由傳遞函數的零點和極點可以大致繪出頻率響應圖。在零點處,頻率響應出現極小值;在極點處,頻率響應出現極大值。因此可以根據所需頻率響應配置零點和極點,然后反向設計帶陷數字濾波器。考慮一種特殊情況,若零點在第1象限單位圓上,極點在單位圓內靠近零點的徑向上。為了防止濾波器系數出現復數,必須在z平面第4象限對稱位置配置相應的共軛零點、共軛極點。 izip∗iz∗ip這樣零點、極點配置的濾波器稱為單一頻率陷波器,在頻率ωo處出現凹陷。而把極點設置在零的的徑向上距圓點的距離為l-μ處,陷波器的傳遞函數為: ))1()()1(())(()(2121zzzzzzzzzHμμ−−−−−−= (3)式(3)中μ越小,極點越靠近單位圓,則頻率響應曲線凹陷越深,凹陷的寬度也越窄。當需要消除窄帶干擾而不能對其他頻率有衰減時,陷波器是一種去除窄帶干擾的理想數字濾波器。當要對幾個頻率同時進行帶陷濾波時,可以按(2)式把幾個單獨頻率的帶陷濾波器(3)式串接在一起。一個例子:設有一個輸入,它
標簽: 數字 陷波器
上傳時間: 2013-10-18
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文中提出了一種基于FPGA的八通道超聲探傷系統設計方案。該系統利用低功耗可變增益運放和八通道ADC構成高集成度的前端放大和數據采集模塊;采用FPGA和ARM作為數字信號處理的核心和人機交互的通道。為了滿足探傷系統實時、高速的要求,我們采用了硬件報警,缺陷回波峰值包絡存儲等關鍵技術。此外,該系統在小型化和數字化方面有顯著提高,為便攜式多通道超聲檢測系統設計奠定基礎
標簽: FPGA 八通道 超聲探傷 系統設計
上傳時間: 2013-11-07
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為滿足對彈載雷達回波信號、圖像及遙測數據的高速、高容量、遠距離、低功耗、高可靠性等特點的要求。地面測試臺采用LVDS接口,運用FPGA對雷達獲取信號數據進行處理與存儲,通過USB接口將數據上傳到計算機實現數據分析與實驗。實驗結果表明,該方案的傳輸速率600 MBps,很好的滿足了對雷達獲取信號的數據發送和接收的速度要求。
標簽: FPGA 實時傳輸 接口設計
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設計采用Altera公司CycloneII系列EP2C5Q208作為核心器件,采用直接數字頻率合成技術實現了一個頻率、相位可控的基本信號發生器。該信號發生器可以產生正弦波、方波、三角波和鋸齒波四種波形。仿真及硬件驗證的結果表明,該信號發生器精度高,抗干擾性好,此設計方案具有一定的實用性。
標簽: FPGA DDS 波形 信號發生器
上傳時間: 2013-11-10
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如何在STM32上得到高精度的ADC
標簽: STM ADC 32 高精度
上傳時間: 2013-11-09
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該信號源可輸出正弦波、方波和三角波,輸出信號的頻率以數控方式調節,幅度連續可調。與傳統信號源相比,該信號源具有波形質量好、精度高、設計方案簡潔、易于實現、便于擴展與維護的特點。
標簽: FPGA DDS 數控 信號源
上傳時間: 2013-10-11
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Virtex™-5 器件包括基于第二代高級硅片組合模塊 (ASMBL™) 列架構的多平臺 FPGA 系列。集成了為獲得最佳性能、更高集成度和更低功耗設計的若干新型架構元件,Virtex-5 器件達到了比以往更高的系統性能水平。
標簽: Virtex FPGA 245 WP
上傳時間: 2013-10-29
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提出了一種基于FPGA的多級小波逆變換的高速、實時的硬件解決方案。仿真驗證表明本方案能夠滿足連續輸入的數據進行實時處理的要求,并且所設計的系統具有功耗低、成本低等優點。
標簽: 多級 小波逆變換 實時系統 方案
上傳時間: 2014-12-28
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本白皮書分析了業界對更高速率接口(尤其是100 GbE)的迫切需求、向平臺添加 100 GbE 時系統架構師所面臨的重大風險和問題,并評介幾種實現方案,這些方案顯示出 FPGA 在解決這些難題方面具有何等獨特的地位。
標簽: FPGA 280 WP 高端
上傳時間: 2013-10-25
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