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上傳時(shí)間： 2022-07-27
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此代碼是我們?cè)趩纹瑱C(jī)來(lái)控制CPLD記數(shù),然后讀出并轉(zhuǎn)換數(shù)據(jù),精度很高,在我們學(xué)校的電子設(shè)計(jì)大賽上還獲的了二等獎(jiǎng)
標(biāo)簽： CPLD 電子設(shè)計(jì)大賽 用單片機(jī) 控制
上傳時(shí)間： 2013-08-29
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摘要: 介紹了時(shí)鐘分相技術(shù)并討論了時(shí)鐘分相技術(shù)在高速數(shù)字電路設(shè)計(jì)中的作用。 關(guān)鍵詞: 時(shí)鐘分相技術(shù); 應(yīng)用 中圖分類號(hào): TN 79 文獻(xiàn)標(biāo)識(shí)碼:A 文章編號(hào): 025820934 (2000) 0620437203 時(shí)鐘是高速數(shù)字電路設(shè)計(jì)的關(guān)鍵技術(shù)之一, 系統(tǒng)時(shí)鐘的性能好壞, 直接影響了整個(gè)電路的 性能。尤其現(xiàn)代電子系統(tǒng)對(duì)性能的越來(lái)越高的要求, 迫使我們集中更多的注意力在更高頻率、 更高精度的時(shí)鐘設(shè)計(jì)上面。但隨著系統(tǒng)時(shí)鐘頻率的升高。我們的系統(tǒng)設(shè)計(jì)將面臨一系列的問(wèn) 題。 1) 時(shí)鐘的快速電平切換將給電路帶來(lái)的串?dāng)_(Crosstalk) 和其他的噪聲。 2) 高速的時(shí)鐘對(duì)電路板的設(shè)計(jì)提出了更高的要求: 我們應(yīng)引入傳輸線(T ransm ission L ine) 模型, 并在信號(hào)的匹配上有更多的考慮。 3) 在系統(tǒng)時(shí)鐘高于100MHz 的情況下, 應(yīng)使用高速芯片來(lái)達(dá)到所需的速度, 如ECL 芯 片, 但這種芯片一般功耗很大, 再加上匹配電阻增加的功耗, 使整個(gè)系統(tǒng)所需要的電流增大, 發(fā) 熱量增多, 對(duì)系統(tǒng)的穩(wěn)定性和集成度有不利的影響。 4) 高頻時(shí)鐘相應(yīng)的電磁輻射(EM I) 比較嚴(yán)重。 所以在高速數(shù)字系統(tǒng)設(shè)計(jì)中對(duì)高頻時(shí)鐘信號(hào)的處理應(yīng)格外慎重, 盡量減少電路中高頻信 號(hào)的成分, 這里介紹一種很好的解決方法, 即利用時(shí)鐘分相技術(shù), 以低頻的時(shí)鐘實(shí)現(xiàn)高頻的處 理。 1 時(shí)鐘分相技術(shù) 我們知道, 時(shí)鐘信號(hào)的一個(gè)周期按相位來(lái)分, 可以分為360°。所謂時(shí)鐘分相技術(shù), 就是把 時(shí)鐘周期的多個(gè)相位都加以利用, 以達(dá)到更高的時(shí)間分辨。在通常的設(shè)計(jì)中, 我們只用到時(shí)鐘 的上升沿(0 相位) , 如果把時(shí)鐘的下降沿(180°相位) 也加以利用, 系統(tǒng)的時(shí)間分辨能力就可以 提高一倍(如圖1a 所示)。同理, 將時(shí)鐘分為4 個(gè)相位(0°、90°、180°和270°) , 系統(tǒng)的時(shí)間分辨就 可以提高為原來(lái)的4 倍(如圖1b 所示)。 以前也有人嘗試過(guò)用專門的延遲線或邏輯門延時(shí)來(lái)達(dá)到時(shí)鐘分相的目的。用這種方法產(chǎn)生的相位差不夠準(zhǔn)確, 而且引起的時(shí)間偏移(Skew ) 和抖動(dòng) (J itters) 比較大, 無(wú)法實(shí)現(xiàn)高精度的時(shí)間分辨。 近年來(lái)半導(dǎo)體技術(shù)的發(fā)展, 使高質(zhì)量的分相功能在一 片芯片內(nèi)實(shí)現(xiàn)成為可能, 如AMCC 公司的S4405, CY2 PRESS 公司的CY9901 和CY9911, 都是性能優(yōu)異的時(shí)鐘 芯片。這些芯片的出現(xiàn), 大大促進(jìn)了時(shí)鐘分相技術(shù)在實(shí)際電 路中的應(yīng)用。我們?cè)谶@方面作了一些嘗試性的工作: 要獲得 良好的時(shí)間性能, 必須確保分相時(shí)鐘的Skew 和J itters 都 比較小。因此在我們的設(shè)計(jì)中, 通常用一個(gè)低頻、高精度的 晶體作為時(shí)鐘源, 將這個(gè)低頻時(shí)鐘通過(guò)一個(gè)鎖相環(huán)(PLL ) , 獲得一個(gè)較高頻率的、比較純凈的時(shí)鐘, 對(duì)這個(gè)時(shí)鐘進(jìn)行分相, 就可獲得高穩(wěn)定、低抖動(dòng)的分 相時(shí)鐘。 這部分電路在實(shí)際運(yùn)用中獲得了很好的效果。下面以應(yīng)用的實(shí)例加以說(shuō)明。2 應(yīng)用實(shí)例 2. 1 應(yīng)用在接入網(wǎng)中 在通訊系統(tǒng)中, 由于要減少傳輸 上的硬件開銷, 一般以串行模式傳輸 圖3 時(shí)鐘分為4 個(gè)相位 數(shù)據(jù), 與其同步的時(shí)鐘信號(hào)并不傳輸。 但本地接收到數(shù)據(jù)時(shí), 為了準(zhǔn)確地獲取 數(shù)據(jù), 必須得到數(shù)據(jù)時(shí)鐘, 即要獲取與數(shù) 據(jù)同步的時(shí)鐘信號(hào)。在接入網(wǎng)中, 數(shù)據(jù)傳 輸?shù)慕Y(jié)構(gòu)如圖2 所示。 數(shù)據(jù)以68MBös 的速率傳輸, 即每 個(gè)bit 占有14. 7ns 的寬度, 在每個(gè)數(shù)據(jù) 幀的開頭有一個(gè)用于同步檢測(cè)的頭部信息。我們要找到與它同步性好的時(shí)鐘信號(hào), 一般時(shí)間 分辨應(yīng)該達(dá)到1ö4 的時(shí)鐘周期。即14. 7ö 4≈ 3. 7ns, 這就是說(shuō), 系統(tǒng)時(shí)鐘頻率應(yīng)在300MHz 以 上, 在這種頻率下, 我們必須使用ECL inp s 芯片(ECL inp s 是ECL 芯片系列中速度最快的, 其 典型門延遲為340p s) , 如前所述, 這樣對(duì)整個(gè)系統(tǒng)設(shè)計(jì)帶來(lái)很多的困擾。 我們?cè)谶@里使用鎖相環(huán)和時(shí)鐘分相技術(shù), 將一個(gè)16MHz 晶振作為時(shí)鐘源, 經(jīng)過(guò)鎖相環(huán) 89429 升頻得到68MHz 的時(shí)鐘, 再經(jīng)過(guò)分相芯片AMCCS4405 分成4 個(gè)相位, 如圖3 所示。 我們只要從4 個(gè)相位的68MHz 時(shí)鐘中選擇出與數(shù)據(jù)同步性最好的一個(gè)。選擇的依據(jù)是: 在每個(gè)數(shù)據(jù)幀的頭部(HEAD) 都有一個(gè)8bit 的KWD (KeyWord) (如圖1 所示) , 我們分別用 這4 個(gè)相位的時(shí)鐘去鎖存數(shù)據(jù), 如果經(jīng)某個(gè)時(shí)鐘鎖存后的數(shù)據(jù)在這個(gè)指定位置最先檢測(cè)出這 個(gè)KWD, 就認(rèn)為下一相位的時(shí)鐘與數(shù)據(jù)的同步性最好(相關(guān))。 根據(jù)這個(gè)判別原理, 我們?cè)O(shè)計(jì)了圖4 所示的時(shí)鐘分相選擇電路。 在板上通過(guò)鎖相環(huán)89429 和分相芯片S4405 獲得我們所要的68MHz 4 相時(shí)鐘: 用這4 個(gè) 時(shí)鐘分別將輸入數(shù)據(jù)進(jìn)行移位, 將移位的數(shù)據(jù)與KWD 作比較, 若至少有7bit 符合, 則認(rèn)為檢 出了KWD。將4 路相關(guān)器的結(jié)果經(jīng)過(guò)優(yōu)先判選控制邏輯, 即可輸出同步性最好的時(shí)鐘。這里, 我們運(yùn)用AMCC 公司生產(chǎn)的 S4405 芯片, 對(duì)68MHz 的時(shí)鐘進(jìn)行了4 分 相, 成功地實(shí)現(xiàn)了同步時(shí)鐘的獲取, 這部分 電路目前已實(shí)際地應(yīng)用在某通訊系統(tǒng)的接 入網(wǎng)中。 2. 2 高速數(shù)據(jù)采集系統(tǒng)中的應(yīng)用 高速、高精度的模擬- 數(shù)字變換 (ADC) 一直是高速數(shù)據(jù)采集系統(tǒng)的關(guān)鍵部 分。高速的ADC 價(jià)格昂貴, 而且系統(tǒng)設(shè)計(jì) 難度很高。以前就有人考慮使用多個(gè)低速 圖5 分相技術(shù)應(yīng)用于采集系統(tǒng) ADC 和時(shí)鐘分相, 用以替代高速的ADC, 但由 于時(shí)鐘分相電路產(chǎn)生的相位不準(zhǔn)確, 時(shí)鐘的 J itters 和Skew 比較大(如前述) , 容易產(chǎn)生較 大的孔徑晃動(dòng)(Aperture J itters) , 無(wú)法達(dá)到很 好的時(shí)間分辨。 現(xiàn)在使用時(shí)鐘分相芯片, 我們可以把分相 技術(shù)應(yīng)用在高速數(shù)據(jù)采集系統(tǒng)中: 以4 分相后 圖6 分相技術(shù)提高系統(tǒng)的數(shù)據(jù)采集率 的80MHz 采樣時(shí)鐘分別作為ADC 的 轉(zhuǎn)換時(shí)鐘, 對(duì)模擬信號(hào)進(jìn)行采樣, 如圖5 所示。 在每一采集通道中, 輸入信號(hào)經(jīng)過(guò) 緩沖、調(diào)理, 送入ADC 進(jìn)行模數(shù)轉(zhuǎn)換, 采集到的數(shù)據(jù)寫入存儲(chǔ)器(M EM )。各個(gè) 采集通道采集的是同一信號(hào), 不過(guò)采樣 點(diǎn)依次相差90°相位。通過(guò)存儲(chǔ)器中的數(shù) 據(jù)重組, 可以使系統(tǒng)時(shí)鐘為80MHz 的采 集系統(tǒng)達(dá)到320MHz 數(shù)據(jù)采集率(如圖6 所示)。 3 總結(jié) 靈活地運(yùn)用時(shí)鐘分相技術(shù), 可以有效地用低頻時(shí)鐘實(shí)現(xiàn)相當(dāng)于高頻時(shí)鐘的時(shí)間性能, 并 避免了高速數(shù)字電路設(shè)計(jì)中一些問(wèn)題, 降低了系統(tǒng)設(shè)計(jì)的難度。
標(biāo)簽： 時(shí)鐘 分相 技術(shù)應(yīng)用
上傳時(shí)間： 2013-12-17
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在傳統(tǒng)正溫度系數(shù)電流基礎(chǔ)上,增加兩種不同材料的電阻以實(shí)現(xiàn)帶隙基準(zhǔn)的二階溫度補(bǔ)償,采用具有反饋偏置的折疊共源共柵運(yùn)算放大器,使得所設(shè)計(jì)的帶隙基準(zhǔn)電路,具有較高的精度和溫度穩(wěn)定性。
標(biāo)簽： 高精度 帶隙基準(zhǔn)源
上傳時(shí)間： 2013-10-18
上傳用戶：604759954
摘要：本文詳細(xì)介紹了電源電壓檢測(cè)電路從電路要求到電路設(shè)計(jì)，從電路仿真驗(yàn)證到版圖設(shè)計(jì)的整個(gè)模擬電路設(shè)計(jì)流程。著重討論了如何降低電源電壓、溫度及工藝等變化對(duì)電路精度的影響，使設(shè)計(jì)的電源電壓檢測(cè)電路具有精度高，電壓、工藝、溫度容限寬的特點(diǎn)。
上傳時(shí)間： 2014-01-10
上傳用戶：moshushi0009
干涉儀測(cè)向具有精度高、速度快的特點(diǎn)，在無(wú)源探測(cè)定位系統(tǒng)中具有廣泛的應(yīng)用。傳統(tǒng)干涉儀依靠短基線保證無(wú)模糊測(cè)向范圍，依靠長(zhǎng)基線保證測(cè)向精度，采用整數(shù)階基線比。該方法在寬帶應(yīng)用條件下難以實(shí)現(xiàn)，且對(duì)天線陣的安裝位置非常敏感。本課題研究分?jǐn)?shù)階干涉儀測(cè)向的算法，同時(shí)實(shí)現(xiàn)寬帶、高精度、無(wú)模糊的要求，并研究不同分?jǐn)?shù)比、相位測(cè)量誤差對(duì)測(cè)向精度的影響，進(jìn)行仿真驗(yàn)證。
上傳時(shí)間： 2013-12-02
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長(zhǎng)高44b0xi BIOS源碼 FS44B0II BIOS具有啟動(dòng)、引導(dǎo)，下載、燒寫，設(shè)置日期、時(shí)間，設(shè)置工作頻率等多種功能，並且支持各種參數(shù)的存儲(chǔ)和自動(dòng)調(diào)用。 可以用flashpgm等軟件將BIOS燒寫到Flash中去，BIOS的自身駐留地址位于NOR FLASH的0x1f0000處，系統(tǒng)參數(shù)保存在0x1ff000以上區(qū)域中。所以在燒寫完BIOS，上電復(fù)位后先要執(zhí)一定要執(zhí)行backup命令把BIOS本身拷貝到NOR FLASH的高端1f0000去。
上傳時(shí)間： 2013-12-25
上傳用戶：ainimao
L3_1.m: 純量量化器的設(shè)計(jì)(程式) L3_2.m: 量化造成的假輪廓(程式) L3_3.m: 向量量化器之碼簿的產(chǎn)生(程式) L3_4.m: 利用LBG訓(xùn)練三個(gè)不同大小與維度的碼簿並分別進(jìn)行VQ(程式) gau.m: ML量化器設(shè)計(jì)中分母的計(jì)算式(函式) gau1.m: ML量化器設(shè)計(jì)中分子的計(jì)算式(函式) LBG.m: LBG訓(xùn)練法(函式) quantize.m:高斯機(jī)率密度函數(shù)的非均勻量化(函式) VQ.m: 向量量化(函式) L3_2.bmp: 影像檔 lena.mat: Matlab的矩陣變數(shù)檔
上傳時(shí)間： 2013-12-26
上傳用戶：jiahao131
本文提出基于AD2S1210的旋變信號(hào)轉(zhuǎn)換電路,給出了具體的電路實(shí)現(xiàn)方法和配置方法.相比以往的RDC方案,本系統(tǒng)具有精度高,設(shè)計(jì)靈活,可靠性高等特點(diǎn),可廣泛應(yīng)用于各種伺服系統(tǒng)中.In this paper, the switching signal conversion circuit based on ADS1210 is proposed, and the specific circuit implementation and configuration method are given. Compared with the previous RDC scheme, this system has the characteristics of high precision, flexible design and high reliability, and can be widely used in various servo systems.
標(biāo)簽： ad2s1210
上傳時(shí)間： 2022-05-04
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在電力系統(tǒng)容量日益擴(kuò)大和電網(wǎng)電壓運(yùn)行等級(jí)不斷提高的潮流下，傳統(tǒng)電磁式互感器在運(yùn)行中暴露出越來(lái)越多的弊端，難以滿足電力系統(tǒng)向自動(dòng)化、標(biāo)準(zhǔn)化和數(shù)字化的發(fā)展需求，電子式互感器取代傳統(tǒng)電磁式互感器已經(jīng)成為一種必然的趨勢(shì)，并成為人們研究的熱點(diǎn)。本文圍繞電子式電流互感器高壓側(cè)數(shù)據(jù)采集系統(tǒng)進(jìn)行了研究與設(shè)計(jì)。 Rogowski線圈是電流傳感元件，本文總紿了Rogowski線圈的基本原理，其中包括線圈的等效電路和相量圖，線圈的電磁參數(shù)計(jì)算。在理論研究的基礎(chǔ)上，結(jié)合實(shí)際設(shè)計(jì)一款高精度PCBRogowski線圈。電容分壓器是電壓傳感元件，文章中介紹了傳感器的原理、傳感器的模型結(jié)構(gòu)，針對(duì)其自身結(jié)構(gòu)缺陷和工作環(huán)境的電磁干擾，提出具有針對(duì)性的電磁兼容設(shè)計(jì)方法。 積分器的性能一直是影響Rogowski線圈電流傳感器的精度和穩(wěn)定性的重要因素之一。模擬積分器具有結(jié)構(gòu)簡(jiǎn)單、響應(yīng)速度快、輸入動(dòng)態(tài)范圍大等優(yōu)點(diǎn)；數(shù)字積分器具有性能穩(wěn)定，精度高等優(yōu)點(diǎn)。后者的優(yōu)勢(shì)使其成為近年來(lái)Rogowski線圈電流互感器實(shí)用化研究的一個(gè)熱點(diǎn)問(wèn)題。本文設(shè)計(jì)了一套數(shù)字積分器設(shè)計(jì)的方法，其中包括了積分算法的選擇，積分輸入采樣率和分辨率的確定，數(shù)字積分器的通用結(jié)構(gòu)，積分初值的選擇方法等。 為了保證系統(tǒng)的運(yùn)行穩(wěn)定，文章中的系統(tǒng)只采用激光供電模式，降低數(shù)據(jù)采集系統(tǒng)的功耗就成了系統(tǒng)設(shè)計(jì)的一個(gè)重要環(huán)節(jié)。文章中介紹了一些實(shí)用的低功耗處理方法，分析了激光器的特性，光電池的特性和光電轉(zhuǎn)換器件的特性，并根據(jù)這些器件的特性，改進(jìn)了數(shù)據(jù)發(fā)送激光器的驅(qū)動(dòng)電路，大幅度降低了系統(tǒng)的功耗，保證了系統(tǒng)在較低供電功率條件下的正常運(yùn)行。 論文最后對(duì)全文工作進(jìn)行總結(jié)，提出進(jìn)一步需要解決的問(wèn)題。
標(biāo)簽： 電子式互感器 數(shù)據(jù)采集系統(tǒng)
上傳時(shí)間： 2013-07-10
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