這篇應(yīng)用指南的目標(biāo)讀者是數(shù)字 系統(tǒng)設(shè)計(jì)師，他們?cè)谘邪l(fā)過(guò)程中會(huì)用 到模擬和數(shù)字元器件，包括采用串行 總線的微控制器和DSP系統(tǒng)。本文討 論調(diào)試串行總線設(shè)計(jì)所面臨的挑戰(zhàn)和 新的解決方案，這些串行總線包括控 制器局域網(wǎng) (CAN)、集成電路間總線 (I2C)、串行外設(shè)接口 (SPI) 或通用串行 總線 (USB)。
標(biāo)簽： 混合信號(hào)示波器 串行 總線系統(tǒng) 應(yīng)用指南
上傳時(shí)間： 2013-06-15
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本文應(yīng)用EDA技術(shù)，基于FPGA器件設(shè)計(jì)與實(shí)現(xiàn)UART，并采用CRC校驗(yàn)。主要工作如下： 1、在異步串行通信電路部分完全用FPGA來(lái)實(shí)現(xiàn)。選用Xilinx公司的SpartanⅢ系列的XC3S1000來(lái)實(shí)現(xiàn)異步串行通信的接收、發(fā)送和接口控制功能，利用FPGA集成度比較高，具有在線可編程能力，在其完成各種功能的同時(shí)，完全可以將串行通信接口構(gòu)建其中，可根據(jù)實(shí)際需求分配資源。 2、利用VerilogHDL語(yǔ)言非常容易掌握，功能比VHDL更強(qiáng)大的特點(diǎn)，可以在設(shè)計(jì)時(shí)不斷修改程序，來(lái)適用不同規(guī)模的應(yīng)用，而且采用Verilog輸入法與工藝性無(wú)關(guān)，利用系統(tǒng)設(shè)計(jì)時(shí)對(duì)芯片的要求，施加不同的約束條件，即可設(shè)計(jì)出實(shí)際電路。 3、利用ModelSim仿真工具對(duì)程序進(jìn)行功能仿真和時(shí)序仿真，以驗(yàn)證設(shè)計(jì)是否能獲得所期望的功能，確定設(shè)計(jì)程序配置到邏輯芯片之后是否可以運(yùn)行，以及程序在目標(biāo)器件中的時(shí)序關(guān)系。 4、為保證數(shù)據(jù)傳輸?shù)恼_性，采用循環(huán)冗余校驗(yàn)CRC(CyclicRedundancyCheck)，該編碼簡(jiǎn)單，誤判概率低，為了減少硬件成本，降低硬件設(shè)計(jì)的復(fù)雜度，本設(shè)計(jì)通過(guò)CRC算法軟件實(shí)現(xiàn)。 實(shí)驗(yàn)結(jié)果表明，基于EDA技術(shù)的現(xiàn)場(chǎng)可編程門(mén)陣列FPGA集成度高，結(jié)構(gòu)靈活，設(shè)計(jì)方法多樣，開(kāi)發(fā)周期短，調(diào)試方便，修改容易，采用FPGA較好地實(shí)現(xiàn)了串行數(shù)據(jù)的通信功能，并對(duì)數(shù)據(jù)作了一定的處理，本設(shè)計(jì)中為CRC校驗(yàn)。另外，可以利用FPGA的在線可編程特性，對(duì)本設(shè)計(jì)電路進(jìn)行功能擴(kuò)展，以滿足更高的要求。
標(biāo)簽： FPGA CRC 串行 通信實(shí)現(xiàn)
上傳時(shí)間： 2013-04-24
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128Mb以上的串行閃存被認(rèn)為是電子產(chǎn)品滿足市場(chǎng)需求、增加更多功能的一個(gè)主要障礙，針對(duì)需要128Mb以上串行閃存的應(yīng)用要求，美光科技 (Micron Technology)推出一個(gè)簡(jiǎn)單的獨(dú)一無(wú)二的擴(kuò)容解決方案。這個(gè)解決方案可以把存儲(chǔ)容量輕松地?cái)U(kuò)大到4G或更大，完全兼容現(xiàn)有的串行外設(shè)接口(SPI)協(xié)議，無(wú)需重新設(shè)計(jì)主芯片的硬件。該解決方案優(yōu)于市場(chǎng)上現(xiàn)有的要求創(chuàng)建一個(gè)新的32位尋址模式的解決方案，因?yàn)閯?chuàng)建新的尋址模式可能強(qiáng)迫設(shè)計(jì)人員修改軟硬件。
上傳時(shí)間： 2013-12-20
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嵌入式應(yīng)用技術(shù)基礎(chǔ)教程1 第1章 嵌入式應(yīng)用技術(shù)概述 第2章 嵌入式應(yīng)用技術(shù)的硬件基礎(chǔ) 第3章 高級(jí)語(yǔ)言的串行通信編程 第4章 Freescale 08系列單片機(jī)概述 第5章 HC08 CPU與匯編基礎(chǔ) 第6章 通用I/O與第一個(gè)匯編程序 第7章 08C語(yǔ)言 第8章 串行通信接口SCI與串行外設(shè)接口SPI 第9章 鍵盤(pán)中斷模塊與A/D轉(zhuǎn)換模塊 第10章 定時(shí)接口模塊
標(biāo)簽： Freescale 嵌入式 應(yīng)用技術(shù) 08
上傳時(shí)間： 2015-05-03
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常用串行EEPROM的編程應(yīng)用，Microwire總線是美國(guó)國(guó)家半導(dǎo)體公司研發(fā)的一種簡(jiǎn)單的串行通訊接口協(xié)議，該總線是采用三線進(jìn)行數(shù)據(jù)傳輸。Microwire總線和SPI總線一樣數(shù)據(jù)輸入輸出分別使用一根引線，同樣可以提供同步數(shù)據(jù)傳輸方式，可以適用在多種微控制器、EEPROM或ADC等場(chǎng)合。
標(biāo)簽： EEPROM 串行 編程應(yīng)用
上傳時(shí)間： 2013-12-22
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說(shuō)明：Microchip Technology Inc.采用存儲(chǔ)容量為1 Kb至1Mb的低電壓串行電可擦除PROM（Electrically Erasable PROM，EEPROM），支持兼容串行外設(shè)接口（Serial Peripheral Interface，SPI）的串行總線架構(gòu)，該系列器件支持字節(jié)級(jí)和頁(yè)級(jí)功能，存儲(chǔ)容量為512 Kb和1Mb的器件還通常與基于閃存的產(chǎn)品結(jié)合使用，具有扇區(qū)和芯片擦除功能。所需的總線信號(hào)為時(shí)鐘輸入（SCK）線、獨(dú)立的數(shù)據(jù)輸入（S1）線和數(shù)據(jù)輸出（SO）線。通過(guò)片選（CS）輸入信號(hào)控制對(duì)器件的訪問(wèn)。可通過(guò)保持引腳（HOLD）暫停與器件的通信。器件被暫停后，除片選信號(hào)外的所有輸入信號(hào)的變化都將被忽略，允許主機(jī)響應(yīng)優(yōu)先級(jí)更高的中斷。整個(gè)SPI兼容系列器件都具有標(biāo)準(zhǔn)的8引腳PDIP和SOIC封裝，以及更高級(jí)的封裝，如8引腳TSSOP，MSOP.2x3DFN，5x6 DFN和6引腳SOT-23封裝形式。所有封裝均為符合RoHS標(biāo)準(zhǔn)的無(wú)鉛（霧錫）封裝。引腳圖（未按比例繪制）
上傳時(shí)間： 2022-06-20
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現(xiàn)代社會(huì)信息量爆炸式增長(zhǎng)，由于網(wǎng)絡(luò)、多媒體等新技術(shù)的發(fā)展，用戶對(duì)帶寬和速度的需求快速增加。并行傳輸技術(shù)由于時(shí)鐘抖動(dòng)和偏移，以及PCB布線的困難，使得傳輸速率的進(jìn)一步提升面臨設(shè)計(jì)的極限；而高速串行通信技術(shù)憑借其帶寬大、抗干擾性強(qiáng)和接口簡(jiǎn)單等優(yōu)勢(shì)，正迅速取代傳統(tǒng)的并行技術(shù)，成為業(yè)界的主流。 本論文針對(duì)目前比較流行并且有很大發(fā)展?jié)摿Φ膬煞N高速串行接口電路——高速鏈路口和Rocket I/O進(jìn)行研究，并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺(tái)進(jìn)行仿真設(shè)計(jì)。本論文的主要工作是以某低成本相控陣?yán)走_(dá)信號(hào)處理機(jī)為設(shè)計(jì)平臺(tái)，在其中的一塊信號(hào)處理板上，進(jìn)行了基于LVDS(Low VoltageDifferential Signal)技術(shù)的高速LinkPort(鏈路口)設(shè)計(jì)和基于CML(Current ModeLogic)技術(shù)的Rocket I/O高速串行接口設(shè)計(jì)。首先在FPGA的軟件中進(jìn)行程序設(shè)計(jì)和功能、時(shí)序的仿真，當(dāng)仿真驗(yàn)證通過(guò)之后，重點(diǎn)是在硬件平臺(tái)上進(jìn)行調(diào)試。硬件調(diào)試驗(yàn)證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接，進(jìn)行數(shù)據(jù)的互相傳送，接收和發(fā)送的數(shù)據(jù)相同，證明了高速鏈路口設(shè)計(jì)的正確性。并且在硬件調(diào)試時(shí)對(duì)Rocket IO GTP收發(fā)器進(jìn)行回環(huán)設(shè)計(jì)，經(jīng)過(guò)回環(huán)之后接收到的數(shù)據(jù)與發(fā)送的數(shù)據(jù)相同，證明了Rocket I/O高速串行接口設(shè)計(jì)的正確性。
上傳時(shí)間： 2013-04-24
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網(wǎng)絡(luò)通信中2M專(zhuān)用HW線的高速串行接口的DSP C程序?qū)崿F(xiàn)
標(biāo)簽： DSP 網(wǎng)絡(luò)通信 C程序 高速串行接口
上傳時(shí)間： 2013-12-13
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《ALTERA FPGACPLD高級(jí)篇》高速串行差分接口（HSDI）設(shè)計(jì)實(shí)例
標(biāo)簽： FPGACPLD ALTERA HSDI 高速串行
上傳時(shí)間： 2014-12-08
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MAX121芯片在高速串行接口電路中的應(yīng)用 MAX121應(yīng)用于高速串行接口電路
上傳時(shí)間： 2013-12-26
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