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高速實現(xiàn)

華為《高速數字電路設計教材》

這本書是專門為電路設計工程師寫的。它主要描述了模擬電路原理在高速數字電路設計中的分析應用。通過列舉很多的實例，作者詳細分析了一直困擾高速電路路設計工程師的鈴流、串擾和輻射噪音等問題。

標簽： 華為高速數字電路設計教材

上傳時間： 2013-04-24

上傳用戶：hsj3927
基于ARM多核平臺的打印機JPEG高速解碼引擎設計與實現

大多數現在的PCL打印機驅動程序都是將需要打印的文件(包括圖形或者文本)處理成JPEG文件發送到打印機進行打印，因為這樣一方面可以減少發送給打印機的數據量，一方面可以極大的簡化驅動程序的開發。而在打印機內部，這些JPEG文件又被解碼成BMP文件進行進一步的處理。采用這種方式工作的打印機JPEG解碼的工作占據了其CPU時間的一半以上，所以JPEG文件解碼引擎是打印機的核心之一，提高JPEG的解碼速度對于提高打印機的處理能力至關重要。同時，JPEG文件解碼工作是一個計算密集型的作業，主要有兩個辦法提高它的速度：一個是設計更高效的算法，一個是采用性能更加強勁的CPU設備。在單核CPU的嵌入式環境中，JPEG編解碼速度已經幾乎到了極限，難有提升的空間，然而近兩年多核嵌入式芯片的出現，為大幅度提升它的性能提供了可能。本文基于嵌入式的Linux平臺，采用ARM11 MPCore4核處理器，針對PCL，XL打印機控制語言的JPEG文件解碼設計和實現了一個高速引擎，主要內容為：分析和解碼PCL，XL文件，提取出其中的JPEG文件。對JPEG文件實現并行化解碼，在多個處理器核上并行處理，并針對多核處理器構架進行內存讀取等方面的優化。針對多核處理器的特點和優勢，設計和實現多線程調度算法。總結和提取數據，分析多核處理器相對于單核處理器的性能提升。另外，為便于讀者理解，文中簡要介紹了ARM(SIMD)指令集，嵌入式匯編以及與硬件相關的一些概念。

標簽： JPEG ARM 多核打印機

上傳時間： 2013-06-16

上傳用戶：scorpion
高速PCB的過孔設計

在高速PCB設計中，過孔設計是一個重要因素，它由孔、孔周圍的焊盤區和POWER層隔離區組成，通常分為盲孔、埋孔和通孔三類。在PCB設計過程中通過對過孔的寄生電容和寄生電感分析，總結出高速PCB

標簽： PCB 過孔

上傳時間： 2013-06-17

上傳用戶：xfbs821
印刷線路板制作技術大全-高速PCB設計指南

印刷線路板制作技術大全-高速PCB設計指南:改進電路設計規程提高可測試性隨著微型化程度不斷提高，元件和布線技術也取得巨大發展，例如BGA外殼封裝的高集成度的微型IC，以及導體之間的絕緣

標簽： PCB 印刷線路板制技術大全設計指南

上傳時間： 2013-06-26

上傳用戶：waitingfy
基于ARMCPLD的高速運動控制器的開發和應用

目前運動控制主要有兩種實現方式,一是使用PLC加運動控制模塊來實現：二是使用PC加運動控制卡來實現。兩者各有優缺點,但兩者有以下共同的缺點：一是由于它們兒乎都是采用通用微控制器(MCU和DSP)來實現電機控制,由于受CPU速度的限制,以及CPU的多個進程同時處理,故無法在控制精度和控制速度比較高的場合中應用。二是它們的設計只是把運動控制部件當作系統的一個部分,如果要完成一個機械設備的完整控制,還需要輔助有其他的數字量/模擬量控制設備。這樣在提高了系統成本的同時,也降低了系統的可靠性。論文設計了一種基于ARM+CPLD的高速運動控制器,該控制器采用高速的CPLD處理器來完成電機的閉環控制,輔助以NXP的32位ARM7TDMI處理器LPC231X來實現復雜的運動規劃,使得運動控制精度更高、速度更快、運動更加平穩；同時為系統擴展了常規運動控制卡不具備的通用I/O接口,除開4軸運動控制所需要的8點高速脈沖輸入和8點高速脈沖輸出外,系統具有24點數字量輸入(可選共陰或共陽),25點繼電器輸出,僅一臺這樣的專用設備就可以完成4軸運動控制和設備上其它開關量控制。系統采用可移植的軟、硬件設計。硬件上以運動控制部件為核心,可以方便的在ARM處理器預留的資源上擴展出數字輸入,數字輸出,AD輸入,DA輸出等常用功能模塊。系統軟件構架如下：在最上層,系統采用μC/OS-Ⅱ操作系統來完成系統任務調度；在底層,將底層設備的操作打包編寫成底層驅動的形式,可直接供用戶程序調用；在中間層,可根據不同的用戶要求編寫用戶程序,再將其傳遞給μC/OS-Ⅱ來調度該用戶程序。將該運動控制器應用于工業應用中的套標機,在對套標機進行運動分解之后,結合套標機的電氣特性,很好的實現了運動控制器在套標機上的二次開發,滿足了套標機在現場中的應用。

標簽： ARMCPLD 運動控制器

上傳時間： 2013-04-24

上傳用戶：牛津鞋
基于ARM的高速繡花機控制器的研究與開發

隨著我國加入WTO，我國逐漸成為世界縫制設備生產和銷售中心。在縫制設備行業占據極其重要地位的繡花機行業也因此而得到迅速發展，我國繡花機產量已占據全球繡花機產量的70％。但是，我國的繡花機行業在發展的過程中仍存在和面臨著很多問題。一方面是產品結構和產品質量，我國的繡花機主要以中低檔為主，在噪聲、刺繡質量、效率、產品壽命以及維護性等方面與國外先進機型存在較大差距；另一方面是技術實力和創新能力，作為繡花機全部技術核心的控制器，國內能開發的公司屈指可數，缺乏有效的競爭，且技術實力和創新能力無法與國際企業相抗衡。針對上述情況，本文分析了繡花機的工作原理和當前主流繡花機的控制方式及特點，在研究室已完成的中低速平繡型工業繡花機課題的基礎上，設計了一種基于硬實時嵌入式操作系統WinCE5.0，以32位RISC架構ARM9處理器S3C2440A為主控芯片，以MAXII系列CPLDEPM1270為接口芯片的高速繡花機控制器。整個繡花機以高速，高質量為目標，以伺服電機作為主軸驅動，步進電機作為X/Y軸驅動，帶USB接口和Ethernet接口，預留特種繡接口，帶高分辨率彩色觸摸屏，功能豐富，操作方便。本文分7章，第一章闡述了課題背景，繡花機發展現狀和關鍵技術；第二章從原理出發完成了需求分析，硬件和操作系統選型和項目規劃；第三章完成了總體硬件系統設計并重點介紹了驅動系統，CPLD單元，主控制板的設計和各種資源的分配；第四章在分析WinCE及其項目開發流程和環境構建的基礎上，完成了軟件的總體框架設計并介紹了相關設計要點。第五章主要是驅動程序和運動控制模塊并以步進電機驅動的開發為例介紹了流驅動的開發過程和相關的技術要點。第六章設計了一種自主的內部花樣格式并完成了相應的測試。最后一章是對本課題的總結和展望。本文不僅從項目研究與開發和軟件工程的高度詳細探討了基丁ARM和WinCE5.0的繡花機控制器的整個開發過程，也具體的從硬件設計，資源配置，軟件編寫，驅動開發，運動控制和花樣處理等多個方面進行了深入的分析和研究。本課題的工作對于高速高檔繡花機的開發具有很好的參考價值和實踐意義，對于提升國內繡花機行業在高端市場與國外企業的競爭力，提升民族品牌價值，改變國內繡花機控制器被少數公司所壟斷，增加良性有效競爭有積極影響。

標簽： ARM 繡花機控制器

上傳時間： 2013-06-29

上傳用戶：qazwsxedc
高速電路板設計(世界級水準)

想成為PCB高速設計高手，請看世界級的PCB設計水準。

標簽： 高速電路板

上傳時間： 2013-04-24

上傳用戶：英雄
ADI---高速運放PCB布線實踐指南

雖然印制電路板（PCB）布線在高速電路中具有關鍵的作用，但它往往是電路設計過程的最后幾個步驟之一。高速 PCB 布線有很多方面的問題，關于這個題目已有人撰寫了大量的文獻。本文主要從實踐的角度來探討高速電路的布線問題。主要目的在于幫助新用戶當設計高速電路 PCB 布線時對需要考慮的多種不同問題引起注意。另一個目的是為已經有一段時間沒接觸PCB 布線的客戶提供一種復習資料。由于版面有限，本文不可能詳細地論述所有的問題，但是我們將討論對提高電路性能、縮短設計時間、節省修改時間具有最大成效的關鍵部分。

標簽： ADI PCB 高速運放布線

上傳時間： 2013-04-24

上傳用戶：DanXu
高速數字電路設計教材華為黑魔手冊翻譯

高速數字電路設計教材華為黑魔手冊翻譯

標簽： 高速數字電路設計教材華為

上傳時間： 2013-07-20

上傳用戶：ZHWKLIU
FPGA用于160Gbs高速光纖通信系統中PMD補償的研究

偏振模色散(PMD)是限制光通信系統向高速率和大容量擴展的主要障礙，尤其是160Gb/s光傳輸系統中，由PMD引起的脈沖畸變現象更加嚴重。為了克服PMD帶來的危害，國內外已經開始了對PMD補償的研究。但是目前的補償系統復雜、成本高且補償效果不理想，因此采用前向糾錯(FEC)和偏振擾偏器配合抑制PMD的方法，可以實現低成本的PMD補償。在實驗中將擾偏器連入光時分復用系統，通過觀察其工作前后的脈沖波形，發現擾偏器的應用改善了系統的性能。隨著系統速率的提高，對擾偏器速率的要求也隨之提高，目前市場上擾偏器的速率無法滿足160Gb/s光傳輸系統要求。通過對偏振擾偏器原理的分析，決定采用高速控制電路驅動偏振控制器的方法來實現高速擾偏器的設計。擾偏器采用鈮酸鋰偏振控制器，其響應時間小于100ns，是目前偏振控制器能夠達到的最高速率，但是將其用于160Gb/s高速光通信系統擾偏時，這個速率仍然偏低，因此，提出采用多段鈮酸鋰晶體并行擾偏的方法，彌補鈮酸鋰偏振控制器速率低的問題。通過對幾種處理器的分析和比較，選擇DSP+FPGA作為控制端，DSP芯片用于產生隨機數據，FPGA芯片具有豐富的I/O引腳，工作頻率高，可以實現大量數據的快速并行輸出。這樣的方案可以充分發揮DSP和FPGA各自的優勢。另外對數模轉換芯片也要求響應速度快，本論文以FPGA為核心，完成了FPGA與其它芯片的接口電路設計。在QuartusⅡ集成環境中進行FPGA的開發，使用VHDL語言和原理圖輸入法進行電路設計。本文設計的偏振擾偏器在高速控制電路的驅動下，可以實現大量的數據處理，采用多段鈮酸鋰晶體并行工作的方法，可以提高偏振擾偏器的速率。利用本方案制作的擾偏器具有高擾偏速率，適合應用于160Gb/s光通信系統中進行PMD補償。

標簽： FPGA 160 Gbs PMD

上傳時間： 2013-04-24

上傳用戶：suxuan110425