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高速緩存

高速緩沖存儲器（Cache）其原始意義是指存取速度比一般隨機存取記憶體（RAM）來得快的一種RAM，一般而言它不像系統主記憶體那樣使用DRAM技術，而使用昂貴但較快速的SRAM技術，也有快取記憶體的名稱。

基于FPGA的高速高階FIR濾波器設計

　　隨著雷達、圖像、通信等領域對信號高速處理的要求，研究人員正尋求高速的數字信號處理算法，以滿足這種高速地處理數據的需要。常用的高速實時數字信號處理的器件有ASIC、可編程的數字信號處理芯片、FPGA，等等。　　本文研究了時域FPGA上實現高速高階FIR數字濾波器結構，并實現了高壓縮比的LFM脈沖信號的匹配濾波。文章根據FIR數字濾波器理論，分析比較實現了FIR濾波器的方法；使用并行分布式算法，在Xilinx的VirtexⅡFPGA系列芯片上設計了高速高階FIR濾波器。并詳細進行了分析；設計出了一個256階的線性調頻脈沖壓縮信號的匹配濾波器設計實例，并用ModelSim軟件進行了仿真。

標簽： FPGA FIR 濾波器設計

上傳時間： 2013-07-18

上傳用戶：yt1993410
基于FPGA的高速IPSec協議實現技術研究

隨著國際互聯網絡的迅猛發展，網絡應用的不斷豐富，Intenret已經從最初以學術交流為目的而演變為商業行為，網絡安全性需求日益增加，高速網絡安全保密成為關注的焦點，在安全得到保障的情況下，為了滿足網速無限制的追求，高速網絡硬件加密設備也必將成為需求熱點。另一方面，IPSec協議被廣泛的應用于防火墻和安全網關中，但對IPSec協議的處理會大大增加網關的負載，成為千兆網實現的瓶頸。本文便是針對上述現狀，研究基于高性能FPGA實現千兆IPSec協議的設計技術。目前，國外IPSec協議實現已經芯片化，達到幾千兆的速率，但是國內產品多以軟件實現，速度難以提高。本文采用的基于FPGA的IPSec技術方案，采用硬件實現隧道模式下的IPSec協議，為IP分組及其上層協議數據提供機密性、數據完整性驗證以及數據源驗證等安全服務。在以VPN為實施方案的基礎上，構建了以KDIPSec為設備原型以IPSec協議為出發點的千兆網絡系統環境模型，從硬件體系結構到各個模塊的劃分以及各個模塊實現的功能這幾個方面描述了KDIPSec實現技術，最后描述了一些關鍵模塊的FPGA設計和和仿真。所有處理模塊均在Xilinx公司的FPGA芯片中實現，處理速率超過1Gb/s。

標簽： IPSec FPGA 協議實現技術

上傳時間： 2013-07-03

上傳用戶：wfl_yy
華為《高速數字電路設計教材》

這本書是專門為電路設計工程師寫的。它主要描述了模擬電路原理在高速數字電路設計中的分析應用。通過列舉很多的實例，作者詳細分析了一直困擾高速電路路設計工程師的鈴流、串擾和輻射噪音等問題。

標簽： 華為高速數字電路設計教材

上傳時間： 2013-04-24

上傳用戶：hsj3927
基于ARM_Linux的無線數據采集系統

微處理器技術、傳感器技術和無線通信技術的進步，推動了無線數據采集系統的產生和發展。數據采集技術廣泛應用于雷達、通信、遙感遙測等領域。在各種信息的獲取中，對高速數據采集的需求非常廣泛。隨著測控技術的發展，對數據采集系統的智能化和網絡化水平也提出了更高的要求。并且由于通訊網絡的飛速發展，移動通信與實際應用的結合使得各種基于GPRS網絡的無線數據傳輸系統成為當前遠距離無線通訊領域最為廣泛的應用。本課題將廣泛應用的嵌入式控制器引入到數據采集系統設計中，并結合GPRS優秀的網絡特性，實現了一個低功耗、智能化、網絡化、軟硬件可根據具體測量任務適當裁減的無線高速數據采集平臺。本設計采用32位ARM處理器S3C2410為核心器件，配以FPGA+DDRSDRAM高速數據采集模塊，GPRS數據通信模塊，在Linux嵌入式操作系統和應用軟件的支持下，實現了數字化高速采集，數字化無線數據網絡傳輸的現場數據采集系統。該平臺采集的現場數據主要為各種傳感器輸出的電壓模擬量。前端數據采集模塊的FPGA控制高速AD轉換器將輸入的模擬量信號采集后，存儲在由DDRSDRAM構成的大容量緩存中，再經過嵌入式系統中的微控制器進行各種處理，然后將處理結果保存在ARM系統的SDRAM內存，最后通過在ARM系統模塊擴展的GPRS模塊，將采集到的數據通過GPRS網絡發送出去。 IAnux由于其代碼開放性以及強大的網絡功能等特點，在許多的嵌入式網絡設備中有著廣泛應用，與其他的嵌入式操作系統相比，具有著更多的優勢。因此本課題將其作為硬件平臺的操作系統。基于ARM的嵌入式數據采集與處理系統結構清晰、通用性好、可擴展性強，可為各種嵌入式應用提供一套完整的硬、軟件解決方案，在工業測量與控制領域具有較為廣闊的應用前景。

標簽： ARM_Linux 無線數據采集系統

上傳時間： 2013-04-24

上傳用戶：xlcky
基于ARM多核平臺的打印機JPEG高速解碼引擎設計與實現

大多數現在的PCL打印機驅動程序都是將需要打印的文件(包括圖形或者文本)處理成JPEG文件發送到打印機進行打印，因為這樣一方面可以減少發送給打印機的數據量，一方面可以極大的簡化驅動程序的開發。而在打印機內部，這些JPEG文件又被解碼成BMP文件進行進一步的處理。采用這種方式工作的打印機JPEG解碼的工作占據了其CPU時間的一半以上，所以JPEG文件解碼引擎是打印機的核心之一，提高JPEG的解碼速度對于提高打印機的處理能力至關重要。同時，JPEG文件解碼工作是一個計算密集型的作業，主要有兩個辦法提高它的速度：一個是設計更高效的算法，一個是采用性能更加強勁的CPU設備。在單核CPU的嵌入式環境中，JPEG編解碼速度已經幾乎到了極限，難有提升的空間，然而近兩年多核嵌入式芯片的出現，為大幅度提升它的性能提供了可能。本文基于嵌入式的Linux平臺，采用ARM11 MPCore4核處理器，針對PCL，XL打印機控制語言的JPEG文件解碼設計和實現了一個高速引擎，主要內容為：分析和解碼PCL，XL文件，提取出其中的JPEG文件。對JPEG文件實現并行化解碼，在多個處理器核上并行處理，并針對多核處理器構架進行內存讀取等方面的優化。針對多核處理器的特點和優勢，設計和實現多線程調度算法。總結和提取數據，分析多核處理器相對于單核處理器的性能提升。另外，為便于讀者理解，文中簡要介紹了ARM(SIMD)指令集，嵌入式匯編以及與硬件相關的一些概念。

標簽： JPEG ARM 多核打印機

上傳時間： 2013-06-16

上傳用戶：scorpion
高速PCB的過孔設計

在高速PCB設計中，過孔設計是一個重要因素，它由孔、孔周圍的焊盤區和POWER層隔離區組成，通常分為盲孔、埋孔和通孔三類。在PCB設計過程中通過對過孔的寄生電容和寄生電感分析，總結出高速PCB

標簽： PCB 過孔

上傳時間： 2013-06-17

上傳用戶：xfbs821
印刷線路板制作技術大全-高速PCB設計指南

印刷線路板制作技術大全-高速PCB設計指南:改進電路設計規程提高可測試性隨著微型化程度不斷提高，元件和布線技術也取得巨大發展，例如BGA外殼封裝的高集成度的微型IC，以及導體之間的絕緣

標簽： PCB 印刷線路板制技術大全設計指南

上傳時間： 2013-06-26

上傳用戶：waitingfy
基于ARMCPLD的高速運動控制器的開發和應用

目前運動控制主要有兩種實現方式,一是使用PLC加運動控制模塊來實現：二是使用PC加運動控制卡來實現。兩者各有優缺點,但兩者有以下共同的缺點：一是由于它們兒乎都是采用通用微控制器(MCU和DSP)來實現電機控制,由于受CPU速度的限制,以及CPU的多個進程同時處理,故無法在控制精度和控制速度比較高的場合中應用。二是它們的設計只是把運動控制部件當作系統的一個部分,如果要完成一個機械設備的完整控制,還需要輔助有其他的數字量/模擬量控制設備。這樣在提高了系統成本的同時,也降低了系統的可靠性。論文設計了一種基于ARM+CPLD的高速運動控制器,該控制器采用高速的CPLD處理器來完成電機的閉環控制,輔助以NXP的32位ARM7TDMI處理器LPC231X來實現復雜的運動規劃,使得運動控制精度更高、速度更快、運動更加平穩；同時為系統擴展了常規運動控制卡不具備的通用I/O接口,除開4軸運動控制所需要的8點高速脈沖輸入和8點高速脈沖輸出外,系統具有24點數字量輸入(可選共陰或共陽),25點繼電器輸出,僅一臺這樣的專用設備就可以完成4軸運動控制和設備上其它開關量控制。系統采用可移植的軟、硬件設計。硬件上以運動控制部件為核心,可以方便的在ARM處理器預留的資源上擴展出數字輸入,數字輸出,AD輸入,DA輸出等常用功能模塊。系統軟件構架如下：在最上層,系統采用μC/OS-Ⅱ操作系統來完成系統任務調度；在底層,將底層設備的操作打包編寫成底層驅動的形式,可直接供用戶程序調用；在中間層,可根據不同的用戶要求編寫用戶程序,再將其傳遞給μC/OS-Ⅱ來調度該用戶程序。將該運動控制器應用于工業應用中的套標機,在對套標機進行運動分解之后,結合套標機的電氣特性,很好的實現了運動控制器在套標機上的二次開發,滿足了套標機在現場中的應用。

標簽： ARMCPLD 運動控制器

上傳時間： 2013-04-24

上傳用戶：牛津鞋
基于ARM的變壓器繞組變形檢測系統的研制

電力變壓器是電力系統的重要設備之一，其安全運行對于保障電力系統的安全可靠運行意義重大。對變壓器繞組進行狀態檢測和故障診斷，及時發現變壓器的事故隱患，避免事故的發生，對提高變壓器運行的安全可靠性，具有十分重要的意義。本文分變壓器繞組變形檢測基礎、嵌入式系統設計基礎、硬件設計和軟件設計四個部分。前兩個部分主要介紹基礎的背景知識:首先簡要介紹了變壓器繞組變形的幾種測試方法與比較，重點介紹了頻響法的診斷原理與模型；然后介紹了嵌入式系統的概念與組成，特別是Linux在ARM上的相關移植。后面的兩個部分則在前面的理論基礎上分別從硬件和軟件介紹了如何實現基于嵌入式系統的變壓器繞組變形測試儀:在硬件部分中，利用S3C2410A自帶的USB控制器、LCD控制器、SD卡控制器，簡化了系統設計，并針對系統需要設計了掃頻信號發生器、數據高速采集與緩存等模塊；在軟件部分中，介紹了ARM基于Linux操作系統的I/O口、USB、LCD驅動的編寫，以及相關應用程序的編寫包括數據采集部分程序、LCD、串口通訊程序等，同時本文充分考慮了通訊環節可能引起的延遲問題以及提高系統資源利用效率等因素，提出了將系統設計成多進程的思路，并實現之。

標簽： ARM 變壓器繞組變形檢測系統

上傳時間： 2013-04-24

上傳用戶：fsypc
基于ARM的高速繡花機控制器的研究與開發

隨著我國加入WTO，我國逐漸成為世界縫制設備生產和銷售中心。在縫制設備行業占據極其重要地位的繡花機行業也因此而得到迅速發展，我國繡花機產量已占據全球繡花機產量的70％。但是，我國的繡花機行業在發展的過程中仍存在和面臨著很多問題。一方面是產品結構和產品質量，我國的繡花機主要以中低檔為主，在噪聲、刺繡質量、效率、產品壽命以及維護性等方面與國外先進機型存在較大差距；另一方面是技術實力和創新能力，作為繡花機全部技術核心的控制器，國內能開發的公司屈指可數，缺乏有效的競爭，且技術實力和創新能力無法與國際企業相抗衡。針對上述情況，本文分析了繡花機的工作原理和當前主流繡花機的控制方式及特點，在研究室已完成的中低速平繡型工業繡花機課題的基礎上，設計了一種基于硬實時嵌入式操作系統WinCE5.0，以32位RISC架構ARM9處理器S3C2440A為主控芯片，以MAXII系列CPLDEPM1270為接口芯片的高速繡花機控制器。整個繡花機以高速，高質量為目標，以伺服電機作為主軸驅動，步進電機作為X/Y軸驅動，帶USB接口和Ethernet接口，預留特種繡接口，帶高分辨率彩色觸摸屏，功能豐富，操作方便。本文分7章，第一章闡述了課題背景，繡花機發展現狀和關鍵技術；第二章從原理出發完成了需求分析，硬件和操作系統選型和項目規劃；第三章完成了總體硬件系統設計并重點介紹了驅動系統，CPLD單元，主控制板的設計和各種資源的分配；第四章在分析WinCE及其項目開發流程和環境構建的基礎上，完成了軟件的總體框架設計并介紹了相關設計要點。第五章主要是驅動程序和運動控制模塊并以步進電機驅動的開發為例介紹了流驅動的開發過程和相關的技術要點。第六章設計了一種自主的內部花樣格式并完成了相應的測試。最后一章是對本課題的總結和展望。本文不僅從項目研究與開發和軟件工程的高度詳細探討了基丁ARM和WinCE5.0的繡花機控制器的整個開發過程，也具體的從硬件設計，資源配置，軟件編寫，驅動開發，運動控制和花樣處理等多個方面進行了深入的分析和研究。本課題的工作對于高速高檔繡花機的開發具有很好的參考價值和實踐意義，對于提升國內繡花機行業在高端市場與國外企業的競爭力，提升民族品牌價值，改變國內繡花機控制器被少數公司所壟斷，增加良性有效競爭有積極影響。

標簽： ARM 繡花機控制器

上傳時間： 2013-06-29

上傳用戶：qazwsxedc