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上傳時間： 2022-06-06
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1、本課題任務如下：設計一個具有特定功能的電子鐘。該電子鐘上電或按鍵復位后能自動顯示系統提示符"P."，進入時鐘準備狀態；第一次按電子鐘啟動/調整鍵，電子鐘從0時0分0秒開始運行，進入時鐘運行狀態；再次按電子鐘啟動/調整鍵，則電子鐘進入時鐘調整狀態，此時可利用各調整鍵調整時間，調整結束后可按啟動/調整鍵再次進入時鐘運行狀態。2、本課題要求如下：（1）在AT89S51的PO口和P2口外接由六個LED數碼管（LED5~LEDO）構成的顯示器，用PO口作LED的段碼輸出口（PO.0~P0.7對應于LED的a-dp），P2.5-P2.0作LED的位控輸出線（P2.5~P2.0對應于LED5~LEDO），P1口外接四個按鍵A、B，C.D（對應于P1.0~P1.3）.（2）、利用六個LED顯示當前時間。（3）、四個按鍵的功能：A鍵用于電子鐘啟動/調整；B鍵用于調時，范圍0-23，0為24點，每按一次時加1；C鍵用于調分，范圍0-59，0為60分，每按一次分加1：D鍵用于調秒，范圍0-59，0為60秒，每按一次秒加1.（4）、單片機采用AT89S51，fasc-12MHz（5）、電子鐘供電電源電路的設計。
上傳時間： 2022-06-19
上傳用戶：aben
AR0231AT7C00XUEA0-DRBR（RGB濾光）安森美半導體推出采用突破性減少LED閃爍 (LFM)技術的新的230萬像素CMOS圖像傳感器樣品AR0231AT，為汽車先進駕駛輔助系統(ADAS)應用確立了一個新基準。新器件能捕獲1080p高動態范圍(HDR)視頻，還具備支持汽車安全完整性等級B(ASIL B)的特性。LFM技術(專利申請中)消除交通信號燈和汽車LED照明的高頻LED閃爍，令交通信號閱讀算法能于所有光照條件下工作。AR0231AT具有1/2.7英寸(6.82 mm)光學格式和1928(水平) x 1208(垂直)有源像素陣列。它采用最新的3.0微米背照式(BSI)像素及安森美半導體的DR-Pix?技術，提供雙轉換增益以在所有光照條件下提升性能。它以線性、HDR或LFM模式捕獲圖像，并提供模式間的幀到幀情境切換。 AR0231AT提供達4重曝光的HDR，以出色的噪聲性能捕獲超過120dB的動態范圍。AR0231AT能同步支持多個攝相機，以易于在汽車應用中實現多個傳感器節點，和通過一個簡單的雙線串行接口實現用戶可編程性。它還有多個數據接口，包括MIPI(移動產業處理器接口)、并行和HiSPi(高速串行像素接口)。其它關鍵特性還包括可選自動化或用戶控制的黑電平控制，支持擴頻時鐘輸入和提供多色濾波陣列選擇。封裝和現狀：AR0231AT采用11 mm x 10 mm iBGA-121封裝，現提供工程樣品。工作溫度范圍為-40℃至105℃(環境溫度)，將完全通過AEC-Q100認證。
標簽： 圖像傳感器
上傳時間： 2022-06-27
上傳用戶：XuVshu
NCS8803 3.2.1 功能：是一顆將HDMI信號轉EDP信號的轉接芯片。其應用如下： 3.2.2產品特征 輸入：HDMI 輸出：Embedded-DisplayPort (eDP) EDP接口 1/2/4-lane eDP @ 1.62/2.7Gbps per lane HD to WQXGA (2560*1600) supported 內置EDP協議 HDMI Input HDMI 1.4a supported 支持RGB444/YCbCr444/YCbCr422 像素時鐘： 340MHz 支持雙通道音頻輸入； 參考時鐘 任何頻率，在19MHz到100MHz之間，單端時鐘輸入 內置5000 ppm SSC與否 通信方式 IIC 電源 1.2V core supply 2.5V or 3.3V IO supply 功耗：150Mw 封裝：QFN-56 (7mm x 7mm) 3.2.4 應用產品：廣告機，平板、醫療器械、車機、顯示器、小電視、車載電視等 3.2.5 應用平臺：RK、全志、M-star、炬力等 3.3.6 推廣注意事項A:確認客戶使用屏的分辨率，最常用的是1366x768@60Hz和1920x1080@60Hz BNCS8803支持4-lane DP / eDP輸出通常支持WQXGA所需 (2560 * 1600)及以上60 hz的幀速率 C.確認客戶的信號源，要是標準的HDMI信號,其他的都不行； D.此芯片支持縮放功能，分數縮放比例2:1至1:2； E、此芯片不是純硬件轉換芯片，需要通過IIC或者SPI進行初始化，初始化一般使用客戶CPU進行，這樣方便控制時序也節省成本，如果不使用客戶CPU進行初始化就要另外加MCU進行配置。 設計注意事項： A、NCS8801S設計的時候要特別注意輸入輸出的走線問題，要做好屏蔽以免信號受到干擾。 B、注意電源濾波 C、設計的時候預留LVDS信號要預留阻抗匹配電阻 D、設計的時候復位腳最好由客戶CPU的GPIO口進行控制，以便控制整個方案的時序，避免后面出現問題。
上傳時間： 2022-07-08
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1.2 源代碼表示不考慮主題，列舉 15 000行源代碼本身就是一件難事。下面是所有源代碼都使用的文本格式：1.2.1 將擁塞窗口設置為13 8 7 - 3 8 8 這是文件t c p _ s u b r . c中的函數t c p _ q u e n c h。這些源文件名引用4 . 4 B S D - L i t e發布的文件。4 . 4 B S D在1 . 1 3節中討論。每個非空白行都有編號。正文所描述的代碼的起始和結束位置的行號記于行開始處，如本段所示。有時在段前有一個簡短的描述性題頭，對所描述的代碼提供一個概述。這些源代碼同4 . 4 B S D - L i t e發行版一樣，偶爾也包含一些錯誤，在遇到時我們會提出來并加以討論，偶爾還包括一些原作者的編者評論。這些代碼已通過了 G N U縮進程序的運行，使它們從版面上看起來具有一致性。制表符的位置被設置成 4個欄的界線使得這些行在一個頁面中顯示得很合適。在定義常量時，有些 # i f d e f語句和它們的對應語句 # e n d i f被刪去(如：G A T E W A Y和M R O U T I N G，因為我們假設系統被作為一個路由器或多播路由器 )。所有r e g i s t e r說明符被刪去。有些地方加了一些注釋，并且一些注釋中的印刷錯誤被修改了，但代碼的其他部分被保留下來。這些函數大小不一，從幾行 (如前面的t c p _ q u e n c h)到最大11 0 0行(t c p _ i n p u t)。超過大約4 0行的函數一般被分成段，一段一段地顯示。雖然盡量使代碼和相應的描述文字放在同一頁或對開的兩頁上，但為了節約版面，不可能完全做到。本書中有很多對其他函數的交叉引用。為了避免給每個引用都添加一個圖號和頁碼，書封底內頁中有一個本書中描述的所有函數和宏的字母交叉引用表和描述的起始頁碼。因為本書的源代碼來自公開的 4 . 4 B S D _ L i t e版，因此很容易獲得它的一個拷貝：附錄 B詳細說明了各種方法。當你閱讀文章時，有時它會幫助你搜索一個在線拷貝 [例如U n i x程序grep ( 1 )]。描述一個源代碼模塊的各章通常以所討論的源文件的列表開始，接著是全局變量、代碼維護的相關統計以及一個實際系統的一些例子統計，最后是與所描述協議相關的 S N M P變量。全局變量的定義通常跨越各種源文件和頭文件，因此我們將它們集中到的一個表中以便于參考。這樣顯示所有的統計，簡化了后面當統計更新時對代碼的討論。卷 1的第2 5章提供了S N M P的所有細節。我們在本文中關心的是由內核中的 T C P / I P例程維護的、支持在系統上運行的S N M P代理的信息。TCP IP詳解 卷1協議 ：http://dl.21ic.com/download/tcpip-288223.html TCP IP詳解 卷2實現 ：http://dl.21ic.com/download/tcpip-288224.html TCPIP詳解卷三：TCP事務協議,HTTP,NNTP和UNIX域協議 ：http://dl.21ic.com/download/tcpip-288225.html
上傳時間： 2022-07-27
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特點： 精確度0.1%滿刻度 可作各式數學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A|/ 16 BIT類比輸出功能 輸入與輸出絕緣耐壓2仟伏特/1分鐘(input/output/power) 寬范圍交直流兩用電源設計 尺寸小,穩定性高
上傳時間： 2014-12-23
上傳用戶：ydd3625
§4.1 概述 §4.2 集成運放中的電流源電路 §4.3 集成運放電路簡介 §4.4 集成運放的性能指標及低頻等效電路 §4.5 集成運放的種類及選擇 §4.6 集成運放的使用
上傳時間： 2013-11-24
上傳用戶：xuanchangri
這里僅討論電容及電感值的選取。種類的選取,則需要更多的工程實踐,更多的RF電路的經驗,這里不再討論。從理論上講,隔直電容、旁路電容的容量應滿足。顯然,在任何角頻率下,這在工程上是作不到的。電容量究竟取多大是合理的呢？圖1-5(a),(b)給出了隔直電容(多數情況下,這個電容又稱為耦合電容)和旁路電容的使用簡化
上傳時間： 2013-11-12
上傳用戶：13188549192
特點(FEATURES) 精確度0.1%滿刻度 (Accuracy 0.1%F.S.) 可作各式數學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A| (Math functioA+B/A-B/AxB/A/B/A&B(Hi&Lo)/|A|/etc.....) 16 BIT 類比輸出功能(16 bit DAC isolating analog output function) 輸入/輸出1/輸出2絕緣耐壓2仟伏特/1分鐘(Dielectric strength 2KVac/1min. (input/output1/output2/power)) 寬范圍交直流兩用電源設計(Wide input range for auxiliary power) 尺寸小,穩定性高(Dimension small and High stability)
上傳時間： 2013-11-24
上傳用戶：541657925
摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協議數據幀格式定義的弊端, 并采用高速串行收發器Rocket I/O, 實現數據率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協議 為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內嵌高速串行收發器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協議———Aurora 協議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數據傳輸。Aurora 協議是為專有上層協議或行業標準的上層協議提供透明接口的第一款串行互連協議, 可用于高速線性通路之間的點到點串行數據傳輸, 同時其可擴展的帶寬, 為系統設計人員提供了所需要的靈活性[4]。但該協議幀格式的定義存在弊端,會導致系統資源的浪費。本文提出的設計方案可以改進Aurora 協議的固有缺陷,提高系統性能, 實現數據率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。
上傳時間： 2013-11-06
上傳用戶：smallfish
