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1024

  • 用C++語言對1024點的FFT進行編程

    用C++語言對1024點的FFT進行編程

    標簽: 1024 FFT 語言 編程

    上傳時間: 2017-07-31

    上傳用戶:redmoons

  • 定點復數FFT算法 C語言實現 支持點數為128,256,512,1024,2048可配置 同時附帶文檔

    定點復數FFT算法 C語言實現 支持點數為128,256,512,1024,2048可配置 同時附帶文檔

    標簽: 1024 2048 FFT 128

    上傳時間: 2013-12-19

    上傳用戶:AbuGe

  • fifo 的vhdl源程序,容量為1024*8的fifo程序代碼

    fifo 的vhdl源程序,容量為1024*8的fifo程序代碼

    標簽: fifo 1024 vhdl 源程序

    上傳時間: 2013-12-23

    上傳用戶:yt1993410

  • 利用DSP的1024點蝶形運算FFT全套程序

    利用DSP的1024點蝶形運算FFT全套程序,很不錯的

    標簽: 1024 DSP FFT 運算

    上傳時間: 2014-01-26

    上傳用戶:ghostparker

  • CSharp RSA 1024-bit...

    CSharp RSA 1024-bit...

    標簽: CSharp 1024 RSA bit

    上傳時間: 2013-12-23

    上傳用戶:cjf0304

  • 1024點FFT算法C

    1024點快速傅里葉變換C程序。。。。。。。。。。。。

    標簽: 1024 FFT 算法 C

    上傳時間: 2017-02-07

    上傳用戶:Mr.HWang

  • 1024位數字電位器 ADN2850 datasheet

    好用的數字電位器  1024檔位  精度高  SPI接口  

    標簽: 數字電位器 ADN2850

    上傳時間: 2022-07-17

    上傳用戶:wangshoupeng199

  • 電路原理 下冊

    電路原理 下冊

    標簽: 電路原理

    上傳時間: 2013-06-05

    上傳用戶:eeworm

  • 線束導通檢測與管線氣密檢測系統的設計.rar

    線束導通檢測與管線氣密檢測系統是一種保證線束質量和可靠性以及管線密閉性的最基本測試儀器,它可以剔除大量線束連接中出現的短路、斷路、誤配線和接觸不良等故障,也可以用于檢測管線的氣密性是否符合實際生產要求,從而提高相關工業產品的質量及穩定性。 本文詳細介紹了線束導通檢測與管線氣密檢測系統的硬件制作及軟件設計。論文首先闡述了課題背景和線束導通檢測與管線氣密檢測裝置發展的國內外現狀,同時對線束測試的基本原理和幾種常見的失效模式進行了分析。隨后詳細介紹本系統的總體設計方案和設計思路以及系統的結構組成。文章主體主要分為三大部分內容,第一部分為線束檢測系統的設計,第二部分為管線氣密檢測系統的設計,第三部分為檢測信息編輯PC機軟件的設計。三大部分涵蓋軟、硬件的設計研究,但在設計及功能上相對獨立,故分開進行介紹。 作為第一部分線束檢測系統設計的開頭篇,第二章詳細介紹了系統的導通檢測、數據讀寫、人機交互等各個模塊的硬件設計。第三章以第二章所介紹的硬件結構為基礎,從線束檢測算法、數據通信、數據存取等方面逐層進行探討,從而完成對線束檢測系統軟件部分的介紹。按照第一部分的模式,第二部分所包含的四、五兩章對本系統中的管線氣密檢測部分分別從硬件和軟件的角度進行詳細介紹和深度剖析。第三部分主要介紹基于MFC的PC機信息編輯軟件的開發,分別從開發工具、軟件架構、算法等方面進行詳盡的闡述。 本論文介紹的汽車線束檢測系統可以支持最多1024個線束點,8路氣密管線的檢測,并且能管理并存儲線束測試的大量數據,方便操作人員查看線束測試情況,同時線束檢測部分具有自學習功能,應用前景十分廣闊。

    標簽: 線束 導通 檢測

    上傳時間: 2013-04-24

    上傳用戶:lmq0059

  • 基于FPGA利用FFT算法實現GPSCA碼捕獲的研究.rar

    隨著中國二代導航系統的建設,衛星導航的應用將普及到各個行業,具有自主知識產權的衛星導航接收機的研究與設計是該領域的一個研究熱點。在接收機的設計中,對于成熟技術將利用ASIC芯片進行批量生產,該芯片是專用芯片,一旦制造成型不能改變。但是對于正在研究的接收機技術,特別是在需要利用接收機平臺進行提高接收機性能研究時,利用FPGA通用可編程門陣列芯片是非常方便的。在FPGA上的研究成果,一旦成熟可以很方便的移植到ASIC芯片,進行批量生產。本課題就是基于FPGA研究GPS并行捕獲技術的硬件電路,著重進行了其中一個捕獲通道的設計和實現。 GPS信號捕獲時間是影響GPS接收機性能的一個關鍵因素,尤其是在高動態和實時性要求高的應用中或者對弱GPS信號的捕獲方面。因此,本文在滑動相關法基礎上引出了基于FFT的并行快速捕獲方法,采用自頂向下的方法對系統進行總體功能劃分和結構設計,并采用自底向上的方法對系統進行功能實現和驗證。 本課題以Xilinx公司的Spartan3E開發板為硬件開發平臺,以ISE9.2i為軟件開發平臺,采用Verilog HDL編程實現該系統。并利用Nemerix公司的GPS射頻芯片NJ1006A設計制作了GPS中頻信號產生平臺。該平臺可實時地輸出采樣頻率為16.367MHz的GPS數字中頻信號。 本課題主要是基于采樣率變換和FFT實現對GPS C/A碼的捕獲。該算法利用平均采樣的方法,將信號的采樣率降低到1.024 MHz,在低采樣率下利用成熟的1024點FFT IP核對C/A碼進行粗捕,給出GPS信號的碼相位(精度大約為1/4碼片)和載波的多普勒頻率,符合GPS后續跟蹤的要求。 同時,由于FFT算法是以資源換取時間的方法來提高GPS捕獲速度的,所以在設計時,合理地采用FPGA設計思想與技巧優化系統。基于實用性的要求,詳細的給出了基于FFT的GPS并行捕獲各個模塊的實現原理、實現結構以及仿真結果。并達到降低系統硬件資源,能夠快速、高效地實現對GPS C/A碼捕獲的要求。 本研究是導航研究所承擔的國家863課題“利用多徑信號提高GNSS接收機性能的新技術研究”中關于接收機信號捕獲算法的一部分,對接收機的設計具有一定的參考價值。

    標簽: GPSCA FPGA FFT

    上傳時間: 2013-07-22

    上傳用戶:user08x

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