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ALTERA-USB-BLASTER

USB in 模型作為輸入包括基于Altera的工程源碼固件使用Verilog

USB in 模型，作為輸入，包括基于Altera的工程、源碼、固件，使用Verilog

標簽： usb

上傳時間： 2022-05-16

上傳用戶：20125101110
ALTERA　NIOS處理器實驗

ALTERA　NIOS處理器實驗，編程環(huán)境是QUARTUS，在NIOS SHELL下編譯實現(xiàn)功能。實驗USB接口

標簽： ALTERA NIOS 處理器實驗

上傳時間： 2015-04-13

上傳用戶：1079836864
USB-Blaster_驅動安裝方法

USB-Blaster_驅動安裝方法 1、WIN XP 系統(tǒng)使用 QUARTUS自帶的驅動程序，驅動路徑選擇 C:\altera\11.0\quartus\drivers，可以參考USB-Blaster_驅動安裝方法&USBBALSTER.exe。 2、WIN 7 32位系統(tǒng)使用本目錄USB_Blaster_WIN7 32下面的驅動，驅動路徑選擇 USB_Blaster_WIN7 32\CDM 2.04.16 WHQL Certified 3、WIN 7 64系統(tǒng)使用 QUARTUS自帶的驅動程序驅動路徑選擇 C:\altera\11.0\quartus\drivers

標簽： USB-Blaster_驅動安裝方法

上傳時間： 2015-06-06

上傳用戶：qweasdex
Altera DE教學開發(fā)板中文用戶手冊

感謝您使用 Altera DE教學開發(fā)板。這塊板子的著眼于為在數(shù)字邏輯，計算機組織和FPGA方面的學習提供一個理想的工具。它在硬件和CAD工具上應用先進的技術為學生和專業(yè)人員展示了一個寬廣的主題。該板具有多種特點，非常適合各大學課程在實驗室環(huán)境下的一系列設計項目和非常復雜尖端的數(shù)字系統(tǒng)的開發(fā)和應用。Altera公司為DE2板提供了套支持文件，例如學習指導，現(xiàn)成的教學實驗練習和豐富的插圖說明DE2的特點DE2板是以 Cyclonell2C35FPGA為特點的672針引腳的包裝。板上所有重要的部件都與板上的芯片相連，使用戶能夠控制板上各種的操作DE2板包括了很多開關（兼有撥動開關和按鍵），發(fā)光二極管和七段數(shù)碼管。在更多進一步的實驗中還用到了SRAM，SDRAM Fash以及16×駙字符液晶。需要進行處理器和O接口試驗時，可以簡單的用 Altera Niosll處理器和象RS-232和PS/2標準接口。進行涉及音頻和視頻的實驗時，也有標準MC、line-in video-in（TV Decoder）和VGA（10-bit dac），這些特點都能夠被用來制作CD質量的音頻應用程序和專業(yè)的視頻圖象。為了能夠設計更強大的項目，DE2還提供了USB20接口（包括主、從USB），10/100M自適應以太網(wǎng)，紅外（lRDA）接口，以及SD卡接口。最后，可以通過兩排擴展O口與其它用戶自定義的板子相連。

標簽： altera

上傳時間： 2022-04-01

上傳用戶：bluedrops
Altera(Intel)_MAX10_10M02SCU169開發(fā)板資料硬件參考設計+邏輯例程

Altera(Intel)_MAX10_10M02SCU169開發(fā)板資料硬件參考設計+邏輯例程.QM_MAX10_10M02SCU169開發(fā)板主要特征參數(shù)如下所示：? 主控CPLD：10M02SCU169C8G；? 主控CPLD外部時鐘源頻率：50MHz；? 10M02SCU169C8G芯片內部自帶豐富的Block RAM資源；? 10M02SCU169C8G芯片邏輯單元數(shù)為2K LE；? QM_MAX10_10M02SCU169開發(fā)板板載Silicon Labs的CP2102芯片來實現(xiàn)USB轉串口功能；? QM_MAX10_10M02SCU169開發(fā)板板載MP2359高效率DC/DC提供CPLD芯片工作的3.3V電源；? QM_MAX10_10M02SCU169開發(fā)板引出了兩排50p、2.54mm間距的排座，可以用于外接24Bit的TFT液晶屏、CY7C68013 USB模塊、高速ADC采集模塊或者CMOS攝像頭模塊等；? QM_MAX10_10M02SCU169開發(fā)板引出了芯片的3路按鍵用于測試；? QM_MAX10_10M02SCU169開發(fā)板引出了芯片的3路LED用于測試；? QM_MAX10_10M02SCU169開發(fā)板引出了芯片的JTAG調試端口，采用雙排10p、2.54mm的排針；

標簽： altera intel max10

上傳時間： 2022-05-11

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Altera(Intel)_Cyclone10_10CL006開發(fā)板資料硬件參考設計+邏輯例程

Altera(Intel)_Cyclone10_10CL006開發(fā)板資料硬件參考設計+邏輯例程。QM_Cyclone10_10CL006開發(fā)板主要特征參數(shù)如下所示：? 主控FPGA：10CL006YU256C8G；? 主控FPGA外部時鐘源頻率：50MHz；? 10CL006YU256C8G芯片內部自帶豐富的Block RAM資源；? 10CL006YU256C8G芯片邏輯單元數(shù)為6K LE；? QM_Cyclone10_10CL006開發(fā)板板載MP2359高效率DC/DC提供FPGA芯片工作的3.3V電源；? QM_Cyclone10_10CL006開發(fā)板引出了兩排64p、2.54mm間距的排座，可以用于外接24Bit的TFT液晶屏、CY7C68013 USB模塊、高速ADC采集模塊或者CMOS攝像頭模塊等；? QM_Cyclone10_10CL006開發(fā)板引出了芯片的3路按鍵用于測試；? QM_Cyclone10_10CL006開發(fā)板引出了芯片的2路LED用于測試；? QM_Cyclone10_10CL006開發(fā)板引出了芯片的JTAG調試端口，采用雙排10p、2.54mm的排針；

標簽： altera intel cyclone10

上傳時間： 2022-05-11

上傳用戶：qingfengchizhu
Altera(Intel)_Cyclone_IV_EP4CE15_開發(fā)板資料硬件參考設計+邏輯例程

Altera(Intel)_Cyclone_IV_EP4CE15_開發(fā)板資料硬件參考設計+邏輯例程Cyclone IV EP4CE15核心板主要特征參數(shù)如下所示：? 主控FPGA：EP4CE15F23C8N；? 主控FPGA外部時鐘源頻率：50MHz；? EP4CE15F23C8N芯片內部自帶豐富的Block RAM資源；? EP4CE15F23C8N芯片邏輯單元數(shù)為15K LE；? Cyclone IV EP4CE15板載W25Q064 SPI Flash芯片，8MB字節(jié)的存儲容量；? Cyclone IV EP4CE15板載Winbond 32MB的SDRAM，型號為W9825G6KH-6；? Cyclone IV EP4CE15核心板板載MP2315高效率DC/DC芯片提供FPGA芯片工作的3.3V電源；? Cyclone IV EP4CE15核心板引出了兩排64p、2.54mm間距的排座，可以用于外接24Bit的TFT液晶屏、CY7C68013 USB模塊、高速ADC采集模塊或者CMOS攝像頭模塊等；? Cyclone IV EP4CE15核心板引出了芯片的3路按鍵用于測試；? Cyclone IV EP4CE15核心板引出了芯片的2路LED用于測試；? Cyclone IV EP4CE15核心板引出了芯片的JTAG調試端口，采用雙排10p、2.54mm的排針；

標簽： altera intel cyclone

上傳時間： 2022-05-11

上傳用戶：zhanglei193
USB子類協(xié)議.part2

USB子類協(xié)議.part2

標簽： part USB 協(xié)議

上傳時間： 2013-05-22

上傳用戶：eeworm
USB HID Demonstrator Release 1.0.1

USB HID Demonstrator Release 1.0.1

標簽： Demonstrator Release USB HID

上傳時間： 2013-04-15

上傳用戶：eeworm
USB子類協(xié)議.part3

USB子類協(xié)議.part3

標簽： part USB 協(xié)議

上傳時間： 2013-08-03

上傳用戶：eeworm