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Active-HDL

用verilog hdl編寫的一些例程

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Design and Test_Verilog HDL——EDA先鋒工作室《設計與驗證—Verilog HDL》配書源代碼

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active shape model的matlab代碼實現

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TestAD is an example for active directory

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數字時鐘顯示模塊,用VERILOG HDL 實現

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基于Verilog HDL設計的多功能數字鐘

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UART轉I2C的Verilog HDL代碼

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24C01A的Verilog HDL仿真代碼

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一個介紹verilog HDL的ppt文檔

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Vlerilog HDL高級數字設計源碼

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