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Active-HDL

采用Verilog HDL語言編寫的步進電機位置系統(tǒng)

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采用Verilog HDL語言編寫的直流電動機控制系統(tǒng)

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這篇文章是關(guān)于幾何活動邊界的最經(jīng)典文獻之一．?dāng)⑹隽擞蓅nake到geodesic active contour的理論推導(dǎo)．大家可以一起參考

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Verilog HDL語言的PPT教程。包括簡介、邏輯概念、語法和示例。

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設(shè)計CPU方法及流程！VERILOG hdl

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定時鬧鐘.放在active 桌面上的鬧鐘

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eeprom的Verilog HDL源代碼

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VerilogHDL硬件描述語言(簡單的Verilog HDL語法

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關(guān)于雙口RAM的Verilog HDL源碼

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小例子,關(guān)于Verilog HDL語言的一些小練習(xí),可供參考.

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