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Asic

Asic(ApplicationSpecificIntegratedCircuit)即專(zhuān)用集成電路，是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計(jì)、制造的集成電路。用CPLD（復(fù)雜可編程邏輯器件）和FPGA（現(xiàn)場(chǎng)可編程邏輯門(mén)陣列）來(lái)進(jìn)行Asic設(shè)計(jì)是最為流行的方式之一，它們的共性是都具有用戶現(xiàn)場(chǎng)可編程特性，都支持邊界掃描技術(shù)，但兩者在集成度、速度以及編程方式上具有各自的特點(diǎn)。[1]

IBM Asic design

IBM Asic design

標(biāo)簽： design Asic IBM

上傳時(shí)間： 2013-12-26

上傳用戶：zsjinju
v2html - verilog to html converter 主要為FPGA和Asic工作人員

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標(biāo)簽： converter verilog v2html html

上傳時(shí)間： 2014-01-03

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Asic 設(shè)計(jì)中包存儲(chǔ)功能的fifo

Asic 設(shè)計(jì)中包存儲(chǔ)功能的fifo，TCP/IP，以太網(wǎng)2的應(yīng)用

標(biāo)簽： Asic fifo 存儲(chǔ)

上傳時(shí)間： 2016-01-24

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PCI 32 target IP for Fpga/Asic Designer

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標(biāo)簽： Designer target Fpga Asic

上傳時(shí)間： 2016-03-06

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AHB to PCI Structure for FPGA/Asic Designer

AHB to PCI Structure for FPGA/Asic Designer

標(biāo)簽： Structure Designer FPGA Asic

上傳時(shí)間： 2013-12-26

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PCI express CRC rtl core for Fpga/Asic Designer

PCI express CRC rtl core for Fpga/Asic Designer

標(biāo)簽： Designer express Fpga core

上傳時(shí)間： 2016-03-06

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<Asic教程課件>英文版,400頁(yè). 雖然只是個(gè)課件,但絕對(duì)的經(jīng)典. 茶前飯后,隨便瀏覽,必生啟迪.

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標(biāo)簽： Asic 400 lt gt

上傳時(shí)間： 2016-03-18

上傳用戶：cursor
非常詳細(xì)非常有用的Asic驗(yàn)證測(cè)試方案

非常詳細(xì)非常有用的Asic驗(yàn)證測(cè)試方案，據(jù)說(shuō)是美國(guó)軍方用的

標(biāo)簽： Asic 驗(yàn)證測(cè)試方案

上傳時(shí)間： 2014-01-24

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MIT關(guān)于OFDM收發(fā)器、WIFI收發(fā)器的Asic和 FPGA硬件開(kāi)發(fā)源碼及資料

MIT關(guān)于OFDM收發(fā)器、WIFI收發(fā)器的Asic和 FPGA硬件開(kāi)發(fā)源碼及資料，比較不錯(cuò)的資料OFDM: OFDM transceiver (transmitter and receiver), highly parameterized to cover 802.11a (WiFi), 802.16 (WiMax) and others in the future. Support for 802.15 (WUSB) is currently being worked on. 802.11a: 802.11a WiFi transmitter

標(biāo)簽： Asic FPGA OFDM WIFI

上傳時(shí)間： 2014-01-03

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華為FPGA設(shè)計(jì)流程指南:本部門(mén)所承擔(dān)的FPGA設(shè)計(jì)任務(wù)主要是兩方面的作用：系統(tǒng)的原型實(shí)現(xiàn)和Asic的原型驗(yàn)證。編寫(xiě)本流程的目的是：在于規(guī)范整個(gè)設(shè)計(jì)流程

華為FPGA設(shè)計(jì)流程指南:本部門(mén)所承擔(dān)的FPGA設(shè)計(jì)任務(wù)主要是兩方面的作用：系統(tǒng)的原型實(shí)現(xiàn)和Asic的原型驗(yàn)證。編寫(xiě)本流程的目的是：在于規(guī)范整個(gè)設(shè)計(jì)流程，實(shí)現(xiàn)開(kāi)發(fā)的合理性、一致性、高效性。形成風(fēng)格良好和完整的文檔。實(shí)現(xiàn)在FPGA不同廠家之間以及從FPGA到Asic的順利移植。便于新員工快速掌握本部門(mén)FPGA的設(shè)計(jì)流程。

標(biāo)簽： FPGA Asic 設(shè)計(jì)流程華為

上傳時(shí)間： 2016-04-26

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Asic

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Asic 設(shè)計(jì)中包存儲(chǔ)功能的fifo

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<Asic教程課件>英文版,400頁(yè). 雖然只是個(gè)課件,但絕對(duì)的經(jīng)典. 茶前飯后,隨便瀏覽,必生啟迪.

非常詳細(xì)非常有用的Asic驗(yàn)證測(cè)試方案

MIT關(guān)于OFDM收發(fā)器、WIFI收發(fā)器的Asic和 FPGA硬件開(kāi)發(fā)源碼及資料

華為FPGA設(shè)計(jì)流程指南:本部門(mén)所承擔(dān)的FPGA設(shè)計(jì)任務(wù)主要是兩方面的作用：系統(tǒng)的原型實(shí)現(xiàn)和Asic的原型驗(yàn)證。編寫(xiě)本流程的目的是：在于規(guī)范整個(gè)設(shè)計(jì)流程