ＲＳ編碼在ＦＰＧＡ上實(shí)現(xiàn)的理論和方法，對(duì)設(shè)計(jì)ＲＳ編碼很有幫助，且ＦＯＧＡ資源占有少
標(biāo)簽： 編碼
上傳時(shí)間： 2013-08-16
上傳用戶：chens000
一種基于FPGA 實(shí)現(xiàn)的全并行結(jié)構(gòu)FFT 設(shè)計(jì)方法，采用全并行加流水結(jié)構(gòu), 可在一個(gè)時(shí)鐘節(jié)拍內(nèi)完成32 點(diǎn)FFT 運(yùn)算的功能, 設(shè)計(jì)最高運(yùn)算速度可達(dá)11ns
標(biāo)簽： FPGA FFT 并行 設(shè)計(jì)方法
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基于FPGA的USB2.0的實(shí)現(xiàn)方法，適用于急需開(kāi)發(fā)usb2.0的人員
標(biāo)簽： FPGA 2.0 USB 實(shí)現(xiàn)方法
上傳時(shí)間： 2013-08-17
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altera的幾種新型的FPGA的配置方法和使用心得
標(biāo)簽： altera FPGA 配置方法
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fPGA中的競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象的來(lái)源及其解決方法
標(biāo)簽： fPGA 競(jìng)爭(zhēng)冒險(xiǎn)
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針對(duì)嵌入式系統(tǒng)的底層網(wǎng)絡(luò)接口給出了一種由FPGA實(shí)現(xiàn)的以太網(wǎng)控制器的設(shè)計(jì)方法．該控制器能支持10Mbps和100Mbps的傳輸速率以及半雙工和全雙工模式，同時(shí)可提供MII接口，可并通過(guò)外接以太網(wǎng)物理層（PHY）芯片來(lái)實(shí)現(xiàn)網(wǎng)絡(luò)接入\r\n
標(biāo)簽： FPGA 嵌入式系統(tǒng) 以太網(wǎng)控制器 底層
上傳時(shí)間： 2013-08-18
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本文介紹了一種新的使用串行通信進(jìn)行DSP遠(yuǎn)程在線編程方法。對(duì)設(shè)計(jì)中的主要技術(shù)：DSP與PC機(jī)的串口通信、Flash編程以及DSP自引導(dǎo)等進(jìn)行了詳細(xì)介紹。結(jié)合TI公司的TMS320VC33處理器，闡述了具體的實(shí)現(xiàn)方法
標(biāo)簽： DSP 串行通信 遠(yuǎn)程 編程方法
上傳時(shí)間： 2013-08-19
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一種計(jì)算高階矩陣奇異值分解的FPGA實(shí)現(xiàn)方法。
標(biāo)簽： FPGA 計(jì)算 矩陣 奇異值分解
上傳時(shí)間： 2013-08-21
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介紹了propetus和keil混合編程的方法，如何將二者迅速的集成起來(lái)。
標(biāo)簽： propetus keil 混合編程
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一種LUT函數(shù)運(yùn)算單元的FPGA實(shí)現(xiàn)方法，希望能夠幫助大家
標(biāo)簽： FPGA LUT 函數(shù) 運(yùn)算
上傳時(shí)間： 2013-08-22
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