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BSAT-I 雙發(fā)五收聲波圖

  • wnwb_800_50萬(wàn)能五筆（輸入法工具）

    萬(wàn)能五筆是一種輸入法工具，特點(diǎn)是：軟件小，功能齊，特別是能反查字根，對(duì)于字根需要練習(xí)的朋友，用它即可，能拼音、五筆同時(shí)打。 同時(shí)對(duì)字、詞、句能同時(shí)顯示字根、拼音和聯(lián)想。 個(gè)人覺(jué)得不錯(cuò)，給需要的朋友

    標(biāo)簽： wnwb 800 50 萬(wàn)能五筆

    上傳時(shí)間： 2013-10-19

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  • USB Anaslyst-I分析儀軟件

    USB Anaslyst-I分析儀軟件 安裝程序

    標(biāo)簽： Anaslyst-I USB 分析儀 軟件

    上傳時(shí)間： 2013-10-09

    上傳用戶：qijian11056

  • ATmega8-Protues仿真之五_定時(shí)_計(jì)數(shù)器學(xué)習(xí)

    ATmega8-Protues仿真之五_定時(shí)_計(jì)數(shù)器學(xué)習(xí)

    標(biāo)簽： Protues ATmega 仿真 定時(shí)

    上傳時(shí)間： 2013-10-11

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  • 1KHz正弦波信號(hào)

    1KHz正弦波信號(hào)

    標(biāo)簽： 1KHz 正弦波信號(hào)

    上傳時(shí)間： 2013-11-30

    上傳用戶：skfreeman

  • wnwb_800_50萬(wàn)能五筆（輸入法工具）

    萬(wàn)能五筆是一種輸入法工具，特點(diǎn)是：軟件小，功能齊，特別是能反查字根，對(duì)于字根需要練習(xí)的朋友，用它即可，能拼音、五筆同時(shí)打。 同時(shí)對(duì)字、詞、句能同時(shí)顯示字根、拼音和聯(lián)想。 個(gè)人覺(jué)得不錯(cuò)，給需要的朋友

    標(biāo)簽： wnwb 800 50 萬(wàn)能五筆

    上傳時(shí)間： 2013-11-10

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  • USB Anaslyst-I分析儀軟件

    USB Anaslyst-I分析儀軟件 安裝程序

    標(biāo)簽： Anaslyst-I USB 分析儀 軟件

    上傳時(shí)間： 2013-11-17

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  • 基于FPGA的激光測(cè)距回波信號(hào)高速采集研究

    在激光測(cè)距系統(tǒng)中，微弱回波信號(hào)的檢測(cè)處理一直是一個(gè)難題。本文主要討論了激光測(cè)距接收系統(tǒng)的實(shí)現(xiàn)方法，這種測(cè)距方法既適用于短距離的測(cè)量又適用于長(zhǎng)距離的測(cè)量。首先介紹了脈沖式激光測(cè)距的原理，在此原理的基礎(chǔ)上，結(jié)合FPGA的高速信號(hào)處理能力，設(shè)計(jì)了高精度激光測(cè)距接收系統(tǒng)，并設(shè)計(jì)了回波信號(hào)接收與計(jì)數(shù)電路模塊。

    標(biāo)簽： FPGA 激光測(cè)距 回波信號(hào) 高速采集

    上傳時(shí)間： 2015-01-01

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  • XAPP520將符合2.5V和3.3V I/O標(biāo)準(zhǔn)的7系列FPGA高性能I/O Bank進(jìn)行連接

    XAPP520將符合2.5V和3.3V I/O標(biāo)準(zhǔn)的7系列FPGA高性能I/O Bank進(jìn)行連接  The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems

    標(biāo)簽： XAPP FPGA Bank 520

    上傳時(shí)間： 2013-11-06

    上傳用戶：wentianyou

  • 多級(jí)小波逆變換實(shí)時(shí)系統(tǒng)方案

    提出了一種基于FPGA的多級(jí)小波逆變換的高速、實(shí)時(shí)的硬件解決方案。仿真驗(yàn)證表明本方案能夠滿足連續(xù)輸入的數(shù)據(jù)進(jìn)行實(shí)時(shí)處理的要求,并且所設(shè)計(jì)的系統(tǒng)具有功耗低、成本低等優(yōu)點(diǎn)。

    標(biāo)簽： 多級(jí) 小波逆變換 實(shí)時(shí)系統(tǒng) 方案

    上傳時(shí)間： 2013-12-20

    上傳用戶：JasonC

  • 抑制△I噪聲的PCB設(shè)計(jì)方法

    抑制△I 噪聲一般需要從多方面著手, 但通過(guò)PCB 設(shè)計(jì)抑制△I 噪聲是有效的措施之一。如何通過(guò)PCB 設(shè)計(jì)抑制△I 噪聲是一個(gè)亟待深入研究的問(wèn)題。在對(duì)△I 噪聲的產(chǎn)生、特點(diǎn)、主要危害等研究的基礎(chǔ)上, 討論了輻射干擾機(jī)理, 重點(diǎn)結(jié)合PCB 和EMC 研究的新進(jìn)展, 研究了抑制△I 噪聲的PCB 設(shè)計(jì)方法。對(duì)通過(guò)PCB 設(shè)計(jì)抑制△I 噪聲的研究與應(yīng)用具有指導(dǎo)作用。

    標(biāo)簽： PCB 設(shè)計(jì)方法

    上傳時(shí)間： 2013-11-18

    上傳用戶：wweqas

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