This collection of C++ templates wraps the FORTRAN or C interfaces for LAPACK so that they integrate with the Boost uBLAS library. Currently implements Cholesky decomposition, LU decomposition, inversion and determinant for general and positive-definite matrices.
標簽： collection interfaces integrate templates
上傳時間： 2015-08-10
上傳用戶：chfanjiang
The objective of this projectis to design, model and simulate an autocorrelation generator circuit using 4-bit LFSR. the register and LFSR will used D flip-flop and some gates. By the autocorrelation concept, there should be 2 same length vectors, for calculating the autocorrelation , we have to design the register for storing the original vector and the shifter for make time delay.
標簽： autocorrelation objective generator projectis
上傳時間： 2015-08-17
上傳用戶：ikemada
邏輯分析儀 PC發送到單片機的命令共7個字節： 第一字節是觸發信號，每bit對應一路信號，1為高電平觸發，0為低電平觸發； 第二字節是觸發有效信號，每bit對應一路信號，1為忽略，0為有效； 第三、四字節是采樣時間，對應如下： 2us=0x0402，5us=0x0a02，10us=0x1402，10us=0x2802，50us=0x6402，100us=0xc802，200us=0x3203，500us=0x7d03，1ms=0xfa03，2ms=0x7d04，4ms=0xfa04，8ms=0x7d05，16ms=0xfa05； 第五、六字節是一樣的，為預觸發：8=0％，7=12.5％，6=25％，5=37.5％，4=50％，3=62.5％，2=75％，1=87.5％ 第七字節為模式，0=普通模式；1=外部時鐘，上升延；2=外部時鐘，下降延；3=外部觸發，上升延；4=外部觸發，下降延；5=靜態模式；6沒有查到，不知道是什么；7為測試模式的二進制信號；8為測試模式的AA、55；9為測試模式的清零。
上傳時間： 2013-12-12
上傳用戶：luke5347
Hard-decision decoding scheme Codeword length (n) : 31 symbols. Message length (k) : 19 symbols. Error correction capability (t) : 6 symbols One symbol represents 5 bit. Uses GF(2^5) with primitive polynomial p(x) = X^5 X^2 + 1 Generator polynomial, g(x) = a^15 a^21*X + a^6*X^2 + a^15*X^3 + a^25*X^4 + a^17*X^5 + a^18*X^6 + a^30*X^7 + a^20*X^8 + a^23*X^9 + a^27*X^10 + a^24*X^11 + X^12. Note: a = alpha, primitive element in GF(2^5) and a^i is root of g(x) for i = 19, 20, ..., 30. Uses Verilog description with synthesizable RTL modelling. Consists of 5 main blocks: SC (Syndrome Computation), KES (Key Equation Solver), CSEE (Chien Search and Error Evaluator), Controller and FIFO Register.
標簽： symbols length Hard-decision Codeword
上傳時間： 2014-07-08
上傳用戶：曹云鵬
由delphi實現的bt下載器示例程序，帶全部源碼和BT協議 包中文件說明： BTDemo.dpr, BTDemoF.pas, BTDemoF.dfm -- 一個簡單的bt下載器，支持多個.torrent文件同時下載 btutils.pas -- 核心bt組件 DCP*.pas -- SHA算法源碼（復制自DEC組件包） InetUtils.pas -- 提供Internet下載的函數庫 SimpleSocks.pas -- socket組件（TCP） SortLists.pas -- 排序的List組件 ThreadTimer.pas -- 定時器與線程池 DelayLists.pas -- 一個延時5秒再釋放Object的隊列 FastShareMem.pas, MemPools.pas, ShareGlobals.inc -- 由ThreadTimer內部使用 Bit Torrent Specification.htm -- BT協議文檔
上傳時間： 2015-09-10
上傳用戶：lizhen9880
/*** *** *** *** *** *** *** *** *** *** *** *** **/ //**此映射表用來映射LED模塊不譯碼時，顯示的字符和必須輸入的數據的關系 //**每段和對應比特位的關系見示意圖 // g // --- --- // b | a |f | | <---顯示0時點亮的段為gfedcb // --- // c | |e | | 那么寫入數據為0x7e // --- --- // d // bit: 7 6 5 4 3 2 1 0 // 段位： g f e d c b a
上傳時間： 2013-11-25
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the c languge is used for the GPS field.The pogram is the PARITY CHECK ,which is one kind data of the GPS data .and it is used for correcting one bit error
上傳時間： 2013-11-26
上傳用戶：xiaodu1124
sd2003芯片資料及源碼，C51下的，可以直接使用，不是廠方提供的測試程序， 相應子程序： extern void ini_SD2003(void) extern bit mend_scl_SD2003(void) extern bit start_bit_SD2003(void) extern void stop_bit_SD2003(void) extern void ack_SD2003(void) extern void no_ack_SD2003(void) extern void mast_ack_SD2003(void) extern void write_8bit_SD2003(UCHAR ch) extern UCHAR Read_8bit_SD2003(void) extern void write_8bit_SD2003_R(UCHAR ch) extern UCHAR Read_8bit_SD2003_R(void) extern bit Readblock_SD2003(UCHAR ucommand,UCHAR *p) extern bit Writeblock_SD2003(UCHAR ucommand,UCHAR *p)
上傳時間： 2015-09-14
上傳用戶：zl5712176
提高衛星通信信道傳輸效率的新途徑本 文 結 合 V SAT衛星通信系統設計中涉及衛星通信傳輸技術極為重要的 信道編碼與調制解調方式，探討了各種新型的衛星信道編碼與調制解調技術， 它們的原理及在衛星通信中的應用。在數字調制中，信號傳輸質量主要取決于 比特差錯率BER (Bit Error Rate)，因此要盡可能采用相同的每比特信號能量與 噪聲功率譜密度比(Eb/N.)的條件下，BER低的調制方式，以節省衛星功率 另外頻帶利用率要盡可能的高，以節省寶貴的衛星頻帶。本文還對各種不同的 差錯編碼與調制技術進行了實驗和詳細的性能比較。
上傳時間： 2015-09-16
上傳用戶：AbuGe
一個簡單的ＳＰＩ ＩＰ核，SPI Core Specifications 可以從說明文檔中找到！ The simple Serial Peripheral Interface core is an enhanced version of the Serial Peripheral Interface found on Motorola s M68HC11 family of CPUs. The Serial Peripheral Interface is a serial, synchronous communication protocol that requires a minimum of 3 wires. FEATURES: · Compatible with Motorola’s SPI specifications · Enhanced M68HC11 Serial Peripheral Interface · 4 entries deep read FIFO · 4 entries deep write FIFO · Interrupt generation after 1, 2, 3, or 4 transferred bytes · 8 bit WISHBONE RevB.3 Classic interface · Operates from a wide range of input clock frequencies · Static synchronous design · Fully synthesizable
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上傳時間： 2015-09-17
上傳用戶：TRIFCT
