H.264/AVC是由國際電信聯(lián)合會(huì)的視頻專家組和國際標(biāo)準(zhǔn)化組織的運(yùn)動(dòng)圖像專家組組成的聯(lián)合視頻小組制定的下一代視頻壓縮標(biāo)準(zhǔn)。新標(biāo)準(zhǔn)采用了一些先進(jìn)算法，因此具有優(yōu)異的壓縮性能和極好的網(wǎng)絡(luò)親和性，滿足低碼率情況下的高質(zhì)量視頻的傳輸。 H.264/AVC采用的先進(jìn)算法包括多模式幀間預(yù)測、1/4像素精度預(yù)測、整數(shù)變換量化、去方塊濾波和熵編碼。本論文著重對整數(shù)變換與量化、去方塊濾波做了研究。整數(shù)變換是一種只有加法和移位的運(yùn)算，量化可以通過查表和乘法操作就可以完成，避免了反變換的時(shí)候失配問題，沒有精度損失；去方塊濾波是一種用來去除低碼率情況下的每個(gè)宏塊的塊效應(yīng)，提高了解碼圖像的外觀。 本文主要從算法研究和硬件實(shí)現(xiàn)兩方面著手，在算法研究方面設(shè)計(jì)了一個(gè)可視化測試軟件，在硬件實(shí)現(xiàn)方面主要對整數(shù)變換、量化和去方塊濾波做了研究和實(shí)現(xiàn)。視頻壓縮技術(shù)的關(guān)鍵在于視頻壓縮算法及其芯片的實(shí)現(xiàn)，F(xiàn)PGA可重復(fù)使用，設(shè)計(jì)修改靈活，片內(nèi)資源豐富，具備DSP模塊等優(yōu)勢。在本論文的目標(biāo)實(shí)現(xiàn)部分模塊FPGA的硬件設(shè)計(jì)，用Verilog完成了關(guān)鍵部分的設(shè)計(jì)。首先簡要介紹了視頻壓縮基本原理，常用視頻壓縮標(biāo)準(zhǔn)及其特性以及國內(nèi)外的研究動(dòng)態(tài)，并對H.264標(biāo)準(zhǔn)基本檔次所涉及的核心技術(shù)進(jìn)行了詳細(xì)介紹，兩種分層結(jié)構(gòu)分別討論。其次在掌握了H.264.算法及編解碼流程的基礎(chǔ)上，設(shè)計(jì)了基于H.264編解碼的可視化軟件平臺(tái)。然后詳細(xì)介紹了整數(shù)變換、量化、反變換和反量化核心模塊的設(shè)計(jì)和實(shí)現(xiàn)，并在Altera的軟件和開發(fā)板上進(jìn)行了仿真驗(yàn)證；對去方塊濾波算法做了軟件研究測試，并給出了一種改進(jìn)的硬件整體結(jié)構(gòu)設(shè)計(jì)。最后，對全文工作進(jìn)行了總結(jié)和對未來研究工作做了展望。我在課題中所做的主要工作有： 1.查閱相關(guān)文獻(xiàn)，熟悉H.264.標(biāo)準(zhǔn)及整數(shù)變換、量化和去方塊濾波等算法。 2.用VC++完成了基于H.264編解碼的可視化軟件平臺(tái)設(shè)計(jì)。 3.用Verilog完成了整數(shù)變換量化、反變換反量化模塊FPGA設(shè)計(jì)與驗(yàn)證。 4.去方塊濾波器的算法研究、仿真和硬件整體結(jié)構(gòu)設(shè)計(jì)。
上傳時(shí)間： 2013-04-24
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目前電力系統(tǒng)正朝著設(shè)備數(shù)字化和網(wǎng)絡(luò)互聯(lián)化的方向發(fā)展，電力系統(tǒng)的行為也將會(huì)越來越復(fù)雜。作為電網(wǎng)故障分析必不可少的故障錄波器，電網(wǎng)的日趨復(fù)雜化對其性能提出了更高的要求。FPGA技術(shù)和嵌入式系統(tǒng)的發(fā)展為故障錄波器的性能改善提供了必要條件。 本文首先提出了一種基于以上技術(shù)的高性能分布式輸電線路故障錄波器的實(shí)現(xiàn)方案，簡要分析了其軟硬件結(jié)構(gòu)和功能；接著針對故障錄波裝置中數(shù)據(jù)采集的高精度、高速度問題，提出了基于FPGA和AD7656的數(shù)據(jù)采集單元的設(shè)計(jì)方案；針對大容量故障數(shù)據(jù)的存儲(chǔ)問題，設(shè)計(jì)了在內(nèi)嵌PowerPC微處理器的FPGA上實(shí)現(xiàn)SDRAM控制器的方案，并運(yùn)用modelsim6.0仿真工具對設(shè)計(jì)的SDRAM控制器進(jìn)行了仿真；研究了在內(nèi)嵌PowerPC微處理器上構(gòu)建嵌入式系統(tǒng)的問題；最后討論了行波測距算法在輸電線路故障錄波器中應(yīng)用的相關(guān)問題。
上傳時(shí)間： 2013-07-17
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本文以數(shù)字信號(hào)處理系統(tǒng)為應(yīng)用背景，圍繞基于FPGA的ⅡR數(shù)字濾波器的實(shí)現(xiàn)技術(shù)展開了研究。 首先以ⅡR數(shù)字濾波器的優(yōu)化設(shè)計(jì)基本理論為依據(jù)，研究了在頻域上的最小均方誤差設(shè)計(jì)法和在時(shí)域上的最小平方誤差設(shè)計(jì)法。以四階和六階兩個(gè)ⅡR低通數(shù)字濾波器設(shè)計(jì)為例，利用Matlab軟件進(jìn)行輔助設(shè)計(jì)，探討了濾波器的設(shè)計(jì)過程。 然后著重研究了FPGA的設(shè)計(jì)方法和設(shè)計(jì)流程，在設(shè)計(jì)中采用了層次化、模塊化的設(shè)計(jì)思想，將整個(gè)濾波器劃分為多個(gè)功能模塊，利用VHDL語言編程和原理圖兩種設(shè)計(jì)技術(shù)進(jìn)行了ⅡR濾波器的各個(gè)功能模塊的設(shè)計(jì)，采用EPlCl2Q240器件實(shí)現(xiàn)了基于FPGA的二個(gè)二階節(jié)級(jí)聯(lián)型結(jié)構(gòu)的四階ⅡR低通數(shù)字濾波器，并類推了設(shè)計(jì)六階ⅡR低通數(shù)字濾波器。最后用QuartusⅡ4.0軟件進(jìn)行了綜合與仿真，用MATLAB7.0軟件對仿真結(jié)果進(jìn)行了分析，最終在GW48-PK2開發(fā)系統(tǒng)中進(jìn)行了硬件電路驗(yàn)證，得出了實(shí)際濾波效果測試波形，驗(yàn)證了所設(shè)計(jì)濾波器的正確性。 本設(shè)計(jì)對于用二階節(jié)級(jí)聯(lián)型結(jié)構(gòu)構(gòu)成的ⅡR數(shù)字濾波器硬件電路具有通用性，通過改變二階節(jié)級(jí)聯(lián)型結(jié)構(gòu)的數(shù)量，可以構(gòu)成任意偶數(shù)階的濾波器；同時(shí)，通過上模型中系數(shù)的變換，也可以構(gòu)成相應(yīng)階數(shù)的高通、帶通、帶阻等濾波器。
標(biāo)簽： FPGA 數(shù)字濾波器
上傳時(shí)間： 2013-06-20
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逆變控制器的發(fā)展經(jīng)歷從分立元件的模擬電路到以專用微處理芯片（DSP/MCU）為核心的電路系統(tǒng)，并從數(shù)模混合電路過渡到純數(shù)字控制的歷程。但是，通用微處理芯片是為一般目的而設(shè)計(jì)，存在一定局限。為此，近幾年來逆變器專用控制芯片（ASIC）實(shí)現(xiàn)技術(shù)的研究越來越受到關(guān)注，已成為逆變控制器發(fā)展的新方向之一。本文利用一個(gè)成熟的單相電壓型PWM逆變器控制模型，圍繞逆變器專用控制芯片ASIC的實(shí)現(xiàn)技術(shù)，依次對專用芯片的系統(tǒng)功能劃分，硬件算法，全系統(tǒng)的硬件設(shè)計(jì)及優(yōu)化，流水線操作和并行化，芯片運(yùn)行穩(wěn)定性等問題進(jìn)行了初步研究。首先引述了單相電壓型PWM逆變器連續(xù)時(shí)間和離散時(shí)間的數(shù)學(xué)模型，以及基于極點(diǎn)配置的單相電壓型PWM逆變器電流內(nèi)環(huán)電壓外環(huán)雙閉環(huán)控制系統(tǒng)的設(shè)計(jì)過程，同時(shí)給出了仿真結(jié)果，仿真表明此系統(tǒng)具有很好的動(dòng)、靜態(tài)性能，并且具有自動(dòng)限流功能，提高了系統(tǒng)的可靠性。緊接著分析了FPGA器件的特征和結(jié)構(gòu)。在給出本芯片應(yīng)用目標(biāo)的基礎(chǔ)上，制定了FPGA目標(biāo)器件的選擇原則和芯片的技術(shù)規(guī)格，完成了器件選型及相關(guān)的開發(fā)環(huán)境和工具的選取。然后系統(tǒng)闡述了復(fù)雜FPGA設(shè)計(jì)的設(shè)計(jì)方法學(xué)，詳細(xì)介紹了基于FPGA的ASIC設(shè)計(jì)流程，概要介紹了僅使用QuartusII的開發(fā)流程，以及Modelsim、SynplifyPro、QuartusII結(jié)合使用的開發(fā)流程。在此基礎(chǔ)上，進(jìn)行了芯片系統(tǒng)功能劃分，針對：DDS標(biāo)準(zhǔn)正弦波發(fā)生器，電壓電流雙環(huán)控制算法單元，硬件PI算法單元，SPWM產(chǎn)生器，三角波發(fā)生器，死區(qū)控制器，數(shù)據(jù)流/控制流模塊等逆變器控制硬件算法/控制單元，研究了它們的硬件算法，完成了模塊化設(shè)計(jì)。分析了全數(shù)字鎖相環(huán)的結(jié)構(gòu)和模型，以此為基礎(chǔ)，設(shè)計(jì)了一種應(yīng)用于逆變器的，用比例積分方法替代傳統(tǒng)鎖相系統(tǒng)中的環(huán)路濾波，用相位累加器實(shí)現(xiàn)數(shù)控振蕩器（DCO）功能的高精度二階全數(shù)字鎖相環(huán)（DPLL）。分析了“流水線操作”等設(shè)計(jì)優(yōu)化問題，并針對逆變器控制系統(tǒng)中，控制系統(tǒng)算法呈多層結(jié)構(gòu)，且層與層之間還有數(shù)據(jù)流聯(lián)系，其執(zhí)行順序和數(shù)據(jù)流的走向較為復(fù)雜，不利于直接采用流水線技術(shù)進(jìn)行設(shè)計(jì)的特點(diǎn)，提出一種全新的“分層多級(jí)流水線”設(shè)計(jì)技術(shù)，有效地解決了復(fù)雜控制系統(tǒng)的流水線優(yōu)化設(shè)計(jì)問題。本文最后對芯片運(yùn)行穩(wěn)定性等問題進(jìn)行了初步研究。指出了設(shè)計(jì)中的“競爭冒險(xiǎn)”和飽受困擾之苦的“亞穩(wěn)態(tài)”問題，分析了產(chǎn)生機(jī)理，并給出了常用的解決措施。
上傳時(shí)間： 2013-05-28
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激光測距技術(shù)被廣泛應(yīng)用于現(xiàn)代工業(yè)測量、航空與大地的測量、國防及通信等諸多領(lǐng)域。本文從已獲得廣泛應(yīng)用的脈沖激光測距技術(shù)入手，重點(diǎn)分析了近年提出的自觸發(fā)脈沖激光測距技術(shù)(STPLR)特別是其中的雙自觸發(fā)脈沖激光測距技術(shù)(BSTPLR)，通過分析發(fā)現(xiàn)其核心部件之一就是用于測量激光脈沖飛行時(shí)間(周期)的高精度高速計(jì)數(shù)器，而目前一般的方式是采用昂貴的進(jìn)口高速計(jì)數(shù)器或?qū)Ｓ眉呻娐?ASIC)來完成，這使得激光測距儀在研發(fā)、系統(tǒng)的改造升級(jí)和自主知識(shí)產(chǎn)權(quán)保護(hù)等諸多方面受到制約，同時(shí)在其整體性能上特別是在集成化、小型化和高可靠性方面帶來阻礙。為此，本文研究了采用現(xiàn)場可編程門陣列(FPGA)來實(shí)現(xiàn)脈沖激光測距中的高精度高速計(jì)數(shù)及其他相關(guān)功能，基本解決了以上存在的問題。 論文通過對雙自觸發(fā)脈沖激光測距的主要技術(shù)要求和技術(shù)指標(biāo)進(jìn)行分析，對其中的信號(hào)處理單元采用了FPGA+單片機(jī)的設(shè)計(jì)形式。由FPGA主控芯片(EPF10K20TC144-4)作為周期測量模塊，在整個(gè)測距系統(tǒng)中是信號(hào)處理的核心部件，借助其用戶可編程特性及很高的內(nèi)部時(shí)鐘頻率，設(shè)計(jì)了專用于BSTPLR的高速高精度計(jì)數(shù)芯片，負(fù)責(zé)對測距信號(hào)產(chǎn)生電路中的時(shí)刻鑒別電路輸出信號(hào)進(jìn)行計(jì)數(shù)。數(shù)據(jù)處理模塊則主要由單片機(jī)(AT89C51)來實(shí)現(xiàn)。系統(tǒng)可以通過鍵盤預(yù)置門控信號(hào)的寬度以均衡測量的精度和速度，測量結(jié)果采用7位LED數(shù)碼管顯示。本設(shè)計(jì)在近距離(大尺寸)范圍內(nèi)實(shí)驗(yàn)測試時(shí)基本滿足設(shè)計(jì)要求。
標(biāo)簽： FPGA 自觸發(fā)脈沖 激光測距 關(guān)鍵技術(shù)
上傳時(shí)間： 2013-06-02
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隨著現(xiàn)代信息系統(tǒng)發(fā)展，網(wǎng)絡(luò)系統(tǒng)尤其是分布式系統(tǒng)日益廣泛地用于各個(gè)行業(yè)和領(lǐng)域，其中很多的關(guān)鍵應(yīng)用需要基于時(shí)間同步進(jìn)行。傳統(tǒng)采用精準(zhǔn)時(shí)鐘對設(shè)備物理時(shí)鐘進(jìn)行精準(zhǔn)調(diào)節(jié)以達(dá)到時(shí)鐘同步的方式，以及單純的在局域網(wǎng)內(nèi)部通過相關(guān)時(shí)間協(xié)議進(jìn)行時(shí)間同步的方式，由于受諸多限制，不能很好地解決分布式精確時(shí)鐘同步的問題。然而人們對分布式時(shí)間精準(zhǔn)度和時(shí)間同步的精確度要求越來越高，新型分布式網(wǎng)絡(luò)時(shí)間同步研究成為一個(gè)需要亟待解決的關(guān)鍵性問題。既有工程應(yīng)用價(jià)值，也有一定的理論意義。 首先從分布式系統(tǒng)應(yīng)用的角度出發(fā)，首先對GNSS衛(wèi)星授時(shí)、NTP協(xié)議、嵌入式系統(tǒng)及uClinux操作系統(tǒng)等理論和技術(shù)進(jìn)行了闡述。重點(diǎn)討論了如何解決分布式系統(tǒng)中的精確授時(shí)與同步問題的必要性和工程意義，分析了GNSS衛(wèi)星授時(shí)特點(diǎn)和NTP網(wǎng)絡(luò)協(xié)議的機(jī)制。 其次在充分考慮到網(wǎng)絡(luò)同步實(shí)時(shí)性要求高的特點(diǎn)的基礎(chǔ)上，提出了一種基于GNSS的嵌入式NTP授時(shí)服務(wù)器的設(shè)計(jì)架構(gòu)，對各主要模塊的功能、結(jié)構(gòu)和工作原理進(jìn)行了功能和性能分析。硬件具體以32位ARMS3C44B0X作為硬件控制核心的微處理器，開發(fā)了具有多通信端口的應(yīng)用電路主板，并集成了GNSS衛(wèi)星通信模塊。 再次在軟件方面具體對uClinux操作系統(tǒng)底層接口進(jìn)行了較為深入的分析，在所設(shè)計(jì)的服務(wù)器硬件平臺(tái)上移植了uClinux嵌入式操作系統(tǒng)及相關(guān)的驅(qū)動(dòng)程序，并采用模塊化的設(shè)計(jì)思想進(jìn)行了NTP應(yīng)用程序的設(shè)計(jì)與集成，實(shí)現(xiàn)了NTP協(xié)議的編譯和NTP授時(shí)服務(wù)，其中對NTP協(xié)議主要參數(shù)和具體工作過程進(jìn)行了系統(tǒng)性分析和設(shè)置應(yīng)用。 最后在獲取精準(zhǔn)的系統(tǒng)統(tǒng)一時(shí)鐘、通過NTP協(xié)議提供授時(shí)服務(wù)的基礎(chǔ)上，結(jié)合實(shí)際在人工影響天氣通信指揮系統(tǒng)中具體應(yīng)用，實(shí)現(xiàn)了分布式人工降雨火箭彈發(fā)射點(diǎn)按命令精確同步進(jìn)行發(fā)射的應(yīng)用集成。初步測試表明，本文所設(shè)計(jì)的授時(shí)服務(wù)器應(yīng)用情況良好，實(shí)現(xiàn)了不同層次分布式應(yīng)用對于時(shí)間精準(zhǔn)同步的高要求。
標(biāo)簽： ARMGNSS NTP 分布式 服務(wù)器
上傳時(shí)間： 2013-04-24
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非接觸式IC卡是IC卡領(lǐng)域的一項(xiàng)新興的技術(shù)，它是射頻識(shí)別技術(shù)和IC卡技術(shù)相結(jié)合的產(chǎn)物。由于非接觸式IC卡具有操作快捷、抗干擾性強(qiáng)、工作距離遠(yuǎn)、安全性高、便于一卡多用等優(yōu)點(diǎn)，在自動(dòng)收費(fèi)、身份識(shí)別和電子錢包等領(lǐng)域具有接觸式所無法比擬的優(yōu)越性，具有廣闊的市場前景。非接觸式IC卡讀卡器是非接觸式IC卡應(yīng)用系統(tǒng)的關(guān)鍵設(shè)備之一。基于實(shí)際項(xiàng)目的需要，本課題開發(fā)了一種讀寫距離在10cm左右的非接觸式IC卡讀卡器，它可以應(yīng)用于電子消費(fèi)場合，如公交和地鐵電子售票，食堂售飯等場合。 本文首先研究了用于本系統(tǒng)的基本理論，包括射頻識(shí)別技術(shù)、ARM處理器體系結(jié)構(gòu)和嵌入式系統(tǒng)，然后基于這些理論，給出了非接觸式IC卡讀卡器的設(shè)計(jì)方案。系統(tǒng)由三個(gè)部分組成：第一部分是讀卡器的收發(fā)模塊，選用Philips公司的高集成度非接觸式讀寫芯片MF RC500設(shè)計(jì)射頻收發(fā)模塊，對射頻芯片接口電路設(shè)計(jì)做了詳細(xì)的論述；第二部分是核心控制模塊，以Philips公司的ARM7芯片LPC2292為核心，對電源供應(yīng)電路、存儲(chǔ)器電路、通信接口電路、LED顯示電路等設(shè)計(jì)做了一定的描述，并給出了電路。第三部分是系統(tǒng)的程序設(shè)計(jì)，采用移植嵌入式系統(tǒng)并添加任務(wù)的模式來實(shí)現(xiàn)讀卡器的各功能。通過對軟硬件的調(diào)試實(shí)現(xiàn)了非接觸式IC卡讀卡器的硬件與軟件平臺(tái)的構(gòu)建。
上傳時(shí)間： 2013-04-24
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運(yùn)動(dòng)控制系統(tǒng)是機(jī)器人控制系統(tǒng)的重要組成部分。本文將ARM與CPLD技術(shù)應(yīng)用于機(jī)器人運(yùn)動(dòng)控制系統(tǒng)，使控制系統(tǒng)更加開放、更加模塊化，同時(shí)ARM芯片的高速大容量的數(shù)據(jù)處理能力以及CPLD的高集成度，可編程性，能夠逾越以往控制系統(tǒng)中實(shí)時(shí)、高速、高精度的技術(shù)瓶頸. 嵌入式技術(shù)是當(dāng)今最熱門的技術(shù)之一，由于簡潔、高效等優(yōu)點(diǎn)，使得其廣泛應(yīng)用在各個(gè)領(lǐng)域；所謂嵌入式系統(tǒng)就是以應(yīng)用為中心，以計(jì)算機(jī)技術(shù)為基礎(chǔ)，并且軟硬件可裁剪，適用于應(yīng)用系統(tǒng)對功能、可靠性、成本、體積、功耗有嚴(yán)格要求的專用計(jì)算機(jī)系統(tǒng)。它一般由嵌入式微處理器、外圍硬件設(shè)備、嵌入式操作系統(tǒng)以及用戶的應(yīng)用程序等四個(gè)部分組成，用于實(shí)現(xiàn)對其它設(shè)備的控制、監(jiān)視或管理等功能。 本文主要闡述了基于嵌入式處理器S3C44B0X的機(jī)器人控制器的設(shè)計(jì)過程。文章首先介紹了機(jī)器人本體規(guī)劃、嵌入式系統(tǒng)和嵌入式微處理器S3C44B0X的結(jié)構(gòu)特點(diǎn)；接著介紹了基于S3C44B0X的智能控制器的設(shè)計(jì)，包括硬件設(shè)計(jì)和CPLD軟件設(shè)計(jì)。其中控制器硬件平臺(tái)擴(kuò)展了外部存儲(chǔ)器、串行口，通過輸出PWM信號(hào)進(jìn)入驅(qū)動(dòng)電路模塊，從而實(shí)現(xiàn)控制機(jī)器人運(yùn)動(dòng)的目的。在CPLD設(shè)計(jì)過程中，引入JTAG調(diào)試接口，方便系統(tǒng)程序的下載和調(diào)試，通過自上而下、分塊設(shè)計(jì)的思想給出了QUARTUSⅡ設(shè)計(jì)環(huán)境下的軟件代碼。本系統(tǒng)利用不同任務(wù)間的切換來實(shí)現(xiàn)通信過程，而不再采用無操作系統(tǒng)的工程文件的形式，這樣不但有利于項(xiàng)目的調(diào)試，也有利于對其它接口的擴(kuò)展。最后對該控制器進(jìn)行了測試和分析。
標(biāo)簽： CPLD ARM 四足機(jī)器人 嵌入式控制器
上傳時(shí)間： 2013-07-19
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隨著通信產(chǎn)業(yè)的發(fā)展，尤其是今年3G牌照的發(fā)放，視頻業(yè)務(wù)在移動(dòng)多媒體方面將會(huì)有更加重要的地位，所以在移動(dòng)終端上實(shí)現(xiàn)支持高效視頻編碼標(biāo)準(zhǔn)的解碼功能就成為一項(xiàng)非常有實(shí)際意義的工作。 H．264作為新一代的高壓縮率的視頻標(biāo)準(zhǔn)，憑借其較高的壓縮率和優(yōu)秀圖像質(zhì)量，使得H．264只要利用較小的空間就能存儲(chǔ)更多的視頻數(shù)據(jù)，在更低的網(wǎng)絡(luò)帶寬條件下提供更優(yōu)質(zhì)量的視頻。然而高度的壓縮必然付出較高的硬件代價(jià)。如何能完成視頻良好解碼并能節(jié)約硬件資源成為研究熱點(diǎn)。 考慮到H．264視頻編解碼的計(jì)算復(fù)雜度，在硬件選擇上一般比較注重高性能處理器的選擇。計(jì)算目前主流的實(shí)現(xiàn)方式包括ASIC的專用集成芯片實(shí)現(xiàn)或者是DSP的軟件實(shí)現(xiàn)。ARM處理器伴隨技術(shù)的進(jìn)步，尤其是對支持?jǐn)?shù)字信號(hào)處理的功能加強(qiáng)后，在視頻編解碼領(lǐng)域的應(yīng)用也越來越廣泛。 本文以WindowsCE5．0和S3C2440A嵌入式平臺(tái)作為H．264解碼器的載體，研究的代碼版本是t264-src-0．14，主要進(jìn)行了以下幾個(gè)方面的工作： 研究了H．264視頻壓縮標(biāo)準(zhǔn)和它的體系結(jié)構(gòu)，尤其是對解碼器部分進(jìn)行了硬件要求的分析。 深入研究了WINCE5．0和ARM結(jié)合的平臺(tái)特性，根據(jù)實(shí)際的硬件平臺(tái)需要，定制了相應(yīng)的操作系統(tǒng)。 完成了基于T264代碼的解碼庫在WINCE5．0下的移植，并進(jìn)行了相應(yīng)的代碼和算法的優(yōu)化并完成了基于WINCE5．0操作系統(tǒng)下播放程序的編寫。 通過實(shí)驗(yàn)數(shù)據(jù)證明，在基于單核的ARM芯片中，主要靠軟件進(jìn)行QCIF格式的H．264視頻解碼從而獲得良好播放效果的方法是有效的。
標(biāo)簽： WindowsCE H264 ARM 解碼器
上傳時(shí)間： 2013-07-24
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汽車行駛記錄儀(文中也簡稱為記錄儀)，亦稱“汽車黑匣子”，是安裝在車輛上，對車輛行駛速度、時(shí)間、里程以及有關(guān)車輛行駛的其它狀態(tài)信息進(jìn)行監(jiān)控、記錄、存儲(chǔ)并可通過接口實(shí)現(xiàn)數(shù)據(jù)輸出的數(shù)字式電子記錄裝置。為分析和判斷汽車駕駛狀態(tài)和處理交通事故提供了可靠準(zhǔn)確的科學(xué)依據(jù)。本課題的來源是國家信息產(chǎn)業(yè)部下達(dá)的電子發(fā)展基金項(xiàng)目，與同類產(chǎn)品相比，增加了音/視頻功能，目前已通過信產(chǎn)部驗(yàn)收。 本文主要分析和設(shè)計(jì)了一種具有低成本高擴(kuò)展性的基于ARM與ARMLinux的汽車行駛記錄儀方案，該系統(tǒng)作為信產(chǎn)部項(xiàng)目中的主控模塊實(shí)現(xiàn)了記錄儀的標(biāo)準(zhǔn)功能。硬件方面分析了汽車行駛記錄儀的標(biāo)準(zhǔn)功能對應(yīng)ARM片內(nèi)外圍電路與外部器件的設(shè)計(jì)。軟件方面分析了基于YAFFS文件系統(tǒng)與Linux 2.6的軟件平臺(tái)在嵌入式應(yīng)用方面的高可用性，主要描述YAFFS的特點(diǎn)與基本原理，Linux中線程的實(shí)現(xiàn)機(jī)制與Linux Kernel 2.6在響應(yīng)時(shí)間上的改進(jìn)。并給出了該記錄儀基于Liinux的多線程結(jié)構(gòu)應(yīng)用程序的設(shè)計(jì)要點(diǎn)、流程圖和主要的數(shù)據(jù)結(jié)構(gòu)。 作為擴(kuò)展，為記錄儀增加了采集和處理音/視頻信號(hào)的DSP模塊。DSP采用TI公司的專用于數(shù)字媒體應(yīng)用的高性能DSP DM642。DSP模塊同時(shí)采集3路視頻并進(jìn)行壓縮，壓縮算法可以采用MPEG-2、MPEG-4、H．263、H．264等。論述了實(shí)現(xiàn)音/視頻功能的基本原理、DSP模塊的存儲(chǔ)器結(jié)構(gòu)、ARM與DSP的通信及一些實(shí)用性的考慮。
上傳時(shí)間： 2013-07-02
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