This is a timer using 24 hours max until the pc shuts down, it is tested in windows xp
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在 MAX+PLUS II開發環境下采用 VHDL語言 設計并實現了電表抄表器 討論了系統的四個 組成模塊的設計和 VHDL 的實現 每個模塊采用 RTL 級描述 整體的生成采用圖形輸入法 通過波形仿真 下載芯片測試 完成了抄表器的功能...
摘要: 本文介紹了基于FPGA 的出租車計價器系統的功能、設計思想和實現, 該設計采用模塊化自上而下的層次化設計,頂 層設計有5 個模塊,各模塊中子模塊采用VHDL 或圖形法設計。在Max+plusⅡ下實現編譯、仿真等,最后成功下載到FPGA 芯 片中。完成了可預置自動計費、自動計程、計時、空車...
max-plus2設計超級詳細的入門教程,全部圖解,能讓你快速入門!!!!絕對原創!...
MAX+PLUSII使用說明 很具體是初學者的必讀之物...