將VHDL設(shè)計(jì)轉(zhuǎn)換成Verilog設(shè)計(jì)的程式
標(biāo)簽： Verilog VHDL 程式
上傳時(shí)間： 2016-01-18
上傳用戶：wkchong
JPEG的硬體設(shè)計(jì)採用的是VHDL設(shè)計(jì),有源碼
標(biāo)簽： JPEG VHDL 有源
上傳用戶：agent
一個(gè)簡(jiǎn)單的游戲設(shè)計(jì)...好好玩的
標(biāo)簽：
上傳時(shí)間： 2013-12-31
上傳用戶：edisonfather
ADS操作影片,教我們?cè)觞Ntuning電路.中文發(fā)音,步驟清楚,非常適合初學(xué)入門者.希望對(duì)大家有幫助.
標(biāo)簽： tuning ADS 操作 家
上傳時(shí)間： 2016-02-25
上傳用戶：trepb001
最新程序最好的在線程序設(shè)計(jì) 建議同學(xué)們好好看看。最好的
標(biāo)簽： 程序
上傳時(shí)間： 2016-03-10
上傳用戶：zhuoying119
由遠(yuǎn)峰公司所設(shè)計(jì)的燒入flash軟體,歡迎使用2410/2440可用
標(biāo)簽： flash 2410 2440
上傳時(shí)間： 2014-01-10
上傳用戶：dyctj
UML 2 for Dummies ( UML 理想設(shè)計(jì)方案 )
標(biāo)簽： UML Dummies for 方案
上傳時(shí)間： 2014-01-17
上傳用戶：ommshaggar
TFT設(shè)計(jì)原理應(yīng)用設(shè)計(jì)
標(biāo)簽： TFT
上傳時(shí)間： 2014-01-13
上傳用戶：c12228
是一個(gè)用verilog寫成的加法器電路,可把七個(gè)元件加起來
標(biāo)簽： verilog 加法器 元件
上傳時(shí)間： 2014-01-07
上傳用戶：zhangzhenyu
圖形話介面顯示設(shè)計(jì), 主要透過Embedded Visual C
標(biāo)簽： Embedded Visual
上傳時(shí)間： 2016-04-25
上傳用戶：weiwolkt
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