基于遺傳算法的組合邏輯電路的自動設計，依據給出的真值表，利用遺傳算法自動生成符合要求的組合邏輯電路。由于遺傳算法本身固有的并行性，采用軟件實現的方法在速度上往往受到本質是串行計算的計算機制約，因此采用硬件化設計具有重要的意義。為了證明基于FPGA的遺傳算法的高效性，設計了遺傳算法的各個模塊，實現了基于FPGA的遺傳算法。
上傳時間： 2014-01-08
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以某高速實時頻譜儀為應用背景，論述了5 Gsps采樣率的高速數據采集系統的構成和設計要點，著重分析了采集系統的關鍵部分高速ADC（analog to digital，模數轉換器）的設計、系統采樣時鐘設計、模數混合信號完整性設計、電磁兼容性設計和基于總線和接口標準（PCI Express）的數據傳輸和處理軟件設計。在實現了系統硬件的基礎上，采用Xilinx公司ISE軟件的在線邏輯分析儀（ChipScope Pro）測試了ADC和采樣時鐘的性能，實測表明整體指標達到設計要求。給出上位機對采集數據進行處理的結果，表明系統實現了數據的實時采集存儲功能。
上傳時間： 2014-11-26
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The LT®6552 is a specialized dual-differencing 75MHzoperational amplifier ideal for rejecting common modenoise as a video line receiver. The input pairs are designedto operate with equal but opposite large-signal differencesand provide exceptional high frequency commonmode rejection (CMRR of 65dB at 10MHz), therebyforming an extremely versatile gain block structure thatminimizes component count in most situations. The dualinput pairs are free to take on independent common modelevels, while the two voltage differentials are summedinternally to form a net input signal.
上傳時間： 2014-12-23
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故障樣本數據的獲取是模擬電路故障診斷中最基本的步驟。為了實現短時間內多次進行故障注入、獲取大量樣本數據，提出了基于SLPS的樣本數據自動獲取技術。利用SLPS將PSpice與Matlab結合，采用Matlab編程，實現故障模擬電路仿真數據獲取的自動化。實際應用表明該方法操作簡便，自動化程度高。
上傳時間： 2013-10-23
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基于探索 RLC串聯電路諧振特性仿真實驗技術的目的，采用Multisim10仿真軟件對RLC串聯電路諧振特性進行了仿真實驗測試，給出了幾種Multisim仿真實驗方案，介紹了諧振頻率、上限頻率、下限頻率及品質因數的測試和計算方法，討論了電阻大小對品質因數的影響。結論是仿真實驗可直觀形象地描述RLC串聯電路的諧振特性，將電路的硬件實驗方式向多元化方式轉移，利于培養知識綜合、知識應用、知識遷移的能力，使電路分析更加靈活和直觀。
上傳時間： 2013-10-12
上傳用戶：Maple
由于CMOS器件靜電損傷90%是延遲失效，對整機應用的可靠性影響太大，因而有必要對CMOS器件進行抗靜電措施。本文描述了CMOS器件受靜電損傷的機理，從而對設計人員提出了幾種在線路設計中如何抗靜電，以保護CMOS器件不受損傷。
上傳時間： 2013-11-05
上傳用戶：yupw24
This note describes some of the unique IC design techniques incorporated into a fast, monolithic power buffer, the LT1010. Also, some application ideas are described such as capacitive load driving, boosting fast op amp output current and power supply circuits.
上傳時間： 2013-11-12
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A complete design for a data acquisition card for the IBM PC is detailed in this application note. Additionally, C language code is provided to allow sampling of data at speed of more than 20kHz. The speed limitation is strictly based on the execution speed of the "C" data acquisition loop. A "Turbo" XT can acquire data at speeds greater than 20kHz. Machines with 80286 and 80386 processors can go faster than 20kHz. The computer that was used as a test bed in this application was an XT running at 4.77MHz and therefore all system timing and acquisition time measurements are based on a 4.77MHz clock speed.
上傳時間： 2013-10-29
上傳用戶：BOBOniu
A tutorial on SAR type A/D converters, this note contains detailed information on several 12-bit circuits. Comparator, clocking, and preamplifier designs are discussed. A final circuit gives a 12-bit conversion in 1.8µs. Appended sections explain the basic SAR technique and explore D/A considerations.
上傳時間： 2014-01-21
上傳用戶：釣鰲牧馬
This application note describes a Linear Technology "Half-Flash" A/D converter, the LTC1099, being connected to a 256 element line scan photodiode array. This technology adapts itself to handheld (i.e., low power) bar code readers, as well as high resolution automated machine inspection applications..
上傳時間： 2013-11-21
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