本資料是關(guān)于基于Quartus II FPGA/CPLD數(shù)字系統(tǒng)設(shè)計實例（VHDL源代碼文件），需要的可以自己下載。
標(biāo)簽： Quartus FPGA CPLD VHDL
上傳時間： 2013-10-13
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FPGA-CPLD芯片設(shè)置方法
標(biāo)簽： FPGA-CPLD 芯片設(shè)置
上傳時間： 2013-10-28
上傳用戶：whymatalab2
FPGA與CPLD區(qū)別
標(biāo)簽： FPGA CPLD
上傳時間： 2013-11-24
上傳用戶：packlj
Altera FPGA CPLD設(shè)計 基礎(chǔ)篇 高清書簽版
標(biāo)簽： Altera FPGA CPLD
上傳時間： 2013-05-30
上傳用戶：eeworm
Altera FPGA CPLD設(shè)計 高級篇 高清書簽版
上傳時間： 2013-07-09
上傳時間： 2013-07-14
CPLD／FPGA嵌入式應(yīng)用開發(fā)技術(shù)白金手冊 高清書簽版
標(biāo)簽： CPLD FPGA 嵌入式應(yīng)用 開發(fā)技術(shù)
上傳時間： 2013-04-15
Altera FPGA／CPLD設(shè)計 高級篇
上傳時間： 2013-07-06
FPGA／CPLD設(shè)計工具——Xilinx ISE使用詳解
標(biāo)簽： Xilinx FPGA CPLD ISE
上傳時間： 2013-07-15
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