一、版權信息PCI-51XX系列智能CAN接口卡及相關軟件均屬廣州市周立功單片機發展有限公司所有，其產權受國家法律絕對保護，未經本公司授權，其他公司、單位、代理商及個人不得非法使用和拷貝，否則將受到國家法律的嚴厲制裁。您若需要我公司產品及相關信息，請及時與我們聯系，我們將熱情接待。廣州周立功單片機發展有限公司保留在任何時候修訂本用戶手冊且不需通知的權利。 二、功能特點PCI-51XX智能CAN接口卡是具有PCI接口的高性能CAN總線通訊適配卡，它使PC機方便地連接到CAN總線上，實現CAN2.0B協議的數據通訊。PCI-51XX智能CAN接口卡采用標準PCI接口，實現與主機PC的高速數據交換。接口卡上自帶光電隔離模塊，使PC機避免由于地環流的損壞，增強系統在惡劣環境中使用的可靠性。PCI-51XX智能CAN接口卡配有可在Win98/Me、Win2000/XP下工作的驅動程序，使用通用CAN接口庫，使開發簡單化，并包含在VC++、C++Builder、Delphi、VB下開發的詳細應用例程。
上傳時間： 2013-10-08
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摘 要:本文以日本東芝公司的線陣CCD器件TCD1206SUP為例,在研究了線陣CCD器件工作原理和驅動電路波形的基礎上,介紹了采用圖形式層次設計方法,用復雜可編程邏輯器件(CPLD)設計線陣CCD驅動脈沖的實現方法。用一片EPM7064設計出TCD1206SUP正常工作所需的驅動波形,減小了驅動器的體積。討論了電路的工作原理和設計特點,同時給出了電路原理圖和CPLD電路的時序仿真波形。關鍵詞:電荷耦合器件;復雜可編程邏輯器件;線陣CCD;驅動時序;驅動電路
上傳時間： 2013-11-04
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在單片機系統中使用CPLD，可使系統構成靈活，提高可靠性，縮短開發周期。介紹在MCS-51應用系統中的CPLD應用設計實例，詳細分析CPLD的應用和實現方法，提出設計中選用和使用CPLD的經驗。內容適用于嵌入式系統設計和智能化儀表設計。
上傳時間： 2014-01-22
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摘 要:針對單片機進行高頻測量存在的響應速度問題,利用CPLD適合精確、高速計數的特點,提出了一種基于單片機和CPLD的頻率測量電路,通過CPLD對被測信號分頻再與單片機計數值進行比較,實現了高精度、等精度測量,同時又解決了高頻測量中存在的問題,滿足了系統對響應時間的要求。該項研究成果已經在所設計信號源產品中得到了應用。關鍵詞:頻率測量;信號源;高頻測量;CPLD
上傳時間： 2013-10-15
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本文針對新型匝間耐壓測試儀中需要高速采集數據的問題提出了一種結合CPLD 與單片機的高速數據采集系統設計方案。CPLD 產生A/D 芯片的控制時序以及SRAM 的讀寫控制時序，單片機輸出給CPLD控制A/D 轉換的啟動信號，并通過CPLD 讀取SRAM 中的采樣數據。該系統具有較好的可移植性。
上傳時間： 2013-11-15
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復雜可編程邏輯器件（CPLD）結合了專用集成電路和DSP 的優勢，既具有很高的處理速度，又具有一定的靈活性。因此，基于CPLD 的數字調制系統的研究具有重要的實際意義。本文論述了如何用CPLD 實現PSK 數字調制系統的方法。
上傳時間： 2013-11-15
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在電子工程設計與測試中，常常需要一些復雜的、具有特殊要求的信號，要求其波形可任意產生，頻率方便可調。通常的信號產生器難以滿足要求，市場上出售的任意信號產生器價格昂貴。結合實際需要，我們設計了一種任意波形發生器。電路設計中充分利用MATLAB的仿真功能，將希望得到的波形信號在MATLAB中完成信號的產生、抽樣和模數轉換，并將得到的數字波形數據存放在數據存儲器中，通過單片機和CPLD控制，將波形數據讀出，送入后向通道進行A/D轉換和放大處理后得到所需的模擬信號波形。利用上述方法設計的任意波形發生器，信號產生靈活方便、功能擴展靈活、信號參數可調，實現了硬件電路的軟件化設計。具有電路結構簡單、實用性強、成本低廉等優點。
上傳時間： 2013-11-21
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關鍵詞 PCI的總線協議，數據傳輸摘 要本文檔介紹通過 Actel Flash 的FPGA 來實現PCI 的橋接芯片的功能
上傳時間： 2013-10-08
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In this document, the term Ô60xÕ is used to denote a 32-bit microprocessor from the PowerPC architecture family that conforms to the bus interface of the PowerPC 601ª, PowerPC 603ª, or PowerPC 604 microprocessors. Note that this does not include the PowerPC 602ª microprocessor which has a multiplexed address/data bus. 60x processors implement the PowerPC architecture as it is speciÞed for 32-bit addressing, which provides 32-bit effective (logical) addresses, integer data types of 8, 16, and 32 bits,and ßoating-point data types of 32 and 64 bits (single-precision and double-precision).1.1 Overview The MPC106 provides an integrated high-bandwidth, high-performance, TTL-compatible interface between a 60x processor, a secondary (L2) cache or additional (up to four total) 60x processors, the PCI bus,and main memory. This section provides a block diagram showing the major functional units of the 106 and describes brießy how those units interact.Figure 1 shows the major functional units within the 106. Note that this is a conceptual block diagram intended to show the basic features rather than an attempt to show how these features are physically implemented on the device.
上傳時間： 2013-10-08
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The Motorola MPC106 PCI bridge/memory controller provides a PowerPCªmicroprocessor common hardware reference platform (CHRPª) compliant bridgebetween the PowerPC microprocessor family and the Peripheral Component Interconnect(PCI) bus. In this document, the term Ô106Õ is used as an abbreviation for the phraseÔMPC106 PCI bridge/memory controllerÕ. This document contains pertinent physicalcharacteristics of the 106. For functional characteristics refer to theMPC106 PCI Bridge/Memory Controller UserÕs Manual.This document contains the following topics:Topic PageSection 1.1, ÒOverviewÓ 2Section 1.2, ÒFeaturesÓ 3Section 1.3, ÒGeneral ParametersÓ 5Section 1.4, ÒElectrical and Thermal CharacteristicsÓ 5Section 1.5, ÒPin AssignmentsÓ 17Section 1.6, ÒPinout Listings 18Section 1.7, ÒPackage DescriptionÓ 22Section 1.8, ÒSystem Design InformationÓ 24Section 1.9, ÒDocument Revision HistoryÓ 29Section 1.10, ÒOrdering InformationÓ 29
上傳時間： 2013-11-04
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