幾個關于CPLD和CAN總線的資料，和大家共享
標簽： CPLD CAN 總線
上傳時間： 2013-08-08
上傳用戶：hz07104032
目前市面上比較流行的can協議vhdl控制器，提供源碼參考設計，同仁可自行下載
標簽： vhdl can 協議 控制器
上傳時間： 2013-08-12
上傳用戶：非洲之星
RS譯碼的Euclid算法及其FPGA實現，并通過仿真器的出結果，對于設計ＲＳ譯碼很有幫助
標簽： Euclid FPGA 譯碼 算法
上傳時間： 2013-08-17
上傳用戶：leawon947
一個關于4CAN卡的硬件程序,用VHDL編寫.就是4路CAN總線
標簽： VHDL CAN 硬件 程序
上傳時間： 2013-08-20
上傳用戶：jiiszha
CAN總線，Ｉ２Ｃ，ＵＳＢ等的ＦＰＧＡ實現源碼
標簽： CAN 總線
上傳時間： 2013-08-24
上傳用戶：tzl1975
VxWorks下PC104-CAN驅動程序設計,系統的基本功能是通過CPLD 來實現PC/104 總線SPI 總線的數據交換
標簽： VxWorks 104 CAN PC
上傳用戶：小寶愛考拉
用CPLD驅動SJA1000 CAN控制器
標簽： CPLD 1000 CAN SJA
上傳時間： 2013-08-31
上傳用戶：壞壞的華仔
基于FPGA的can 總線設計，采用verilog語言編寫。在FPGA的開發環境下，新建一個工程，然后將本文件中的各個源代碼添加進工程里，即可運行仿真。
標簽： FPGA can 總線設計
上傳時間： 2013-09-03
上傳用戶：498732662
Can convert data file(txt format)to CAD(scr)file,and draw curve!
標簽： file convert format curve
上傳時間： 2013-09-11
上傳用戶：天空說我在
給出了具有置0、置1功能及不確定輸出狀態的同步RS觸發器的Multisim仿真方法，即用字組產生器產生所需的各類輸入信號，用四蹤示波器同步顯示輸入信號及狀態輸出信號的波形，可直觀描述觸發器的置0、置1過程及不確定狀態的產生過程。分析了同步RS觸發器不確定輸出狀態的Multisim仿真方案。所述方法的創新點是解決了同步RS觸發器的工作波形無法用電子實驗儀器進行分析驗證的問題。
標簽： Multisim 同步RS觸發器 仿真
上傳時間： 2013-10-12
上傳用戶：米卡
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