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  • 基于FPGA的QAM調(diào)制解調(diào)技術(shù)研究

    眾所周知，信息傳輸?shù)暮诵膯栴}是有效性和可靠性，調(diào)制解調(diào)技術(shù)的發(fā)展正是體現(xiàn)了這一思想。從最早的模擬調(diào)幅調(diào)頻技術(shù)的日益完善，到現(xiàn)在數(shù)字調(diào)制技術(shù)的廣泛運用，使得信息的傳輸更為有效和可靠。QAM調(diào)制作為一種新的調(diào)制技術(shù)，因其具有很高的頻帶利用率而得到了廣泛的應用。 本文對基于FPGA的16QAM調(diào)制解調(diào)進行了討論和研究。首先對16QAM調(diào)制解調(diào)原理進行了闡述，建立了16QAM調(diào)制解調(diào)系統(tǒng)的數(shù)學模型，然后通過分析提出了基于FPGA的16QAM調(diào)制解調(diào)系統(tǒng)的設計方案。最后編寫Verilog代碼實現(xiàn)了算法仿真。 FPGA芯片采用的是Altera公司的大規(guī)模集成電路芯片Cyclone系列的EPlC20F32417，并通過軟件編程對其進行了相關(guān)調(diào)試。文中詳細介紹了基帶成形濾波器、載波恢復和定時同步的基本原理及其設計方法。首先用Matlab對整個16QAM系統(tǒng)進行了軟件仿真；然后用硬件描述語言Verilog HDL在QuartusⅡ環(huán)境下完成了系統(tǒng)關(guān)鍵算法的編寫、行為仿真和綜合，最后詳細闡述了異步串口(UART)的FPGA實現(xiàn)，把我們編寫的Verilog程序下載到EPlC20F32417芯片上效果很好。

    標簽： FPGA QAM 調(diào)制解調(diào) 技術(shù)研究

    上傳時間： 2013-06-12

    上傳用戶：q123321

  • 基于FPGA的圖像處理算法及壓縮編碼

    本文以“機車車輛輪對動態(tài)檢測裝置”為研究背景，以改進提升裝置性能為目標，研究在Altera公司的FPGA(Field Programmable Gate Array)芯片Cyclone上實現(xiàn)圖像采集控制、圖像處理算法、JPEG(Joint Photographic Expert Group)壓縮編碼標準的基本系統(tǒng)。本文使用硬件描述語言Verilog，以RedLogic的RVDK開發(fā)板作為硬件平臺，在開發(fā)工具OUARTUS2 6.0和MODELSIM SE 6.1B環(huán)境中完成軟核的設計與仿真驗證。 數(shù)據(jù)采集部分完成的功能是將由模擬攝像機拍攝到的圖像信號進行數(shù)字化，然后從數(shù)據(jù)流中提取有效數(shù)據(jù)，加以適當裁剪，最后將奇偶場圖像數(shù)據(jù)合并成幀，存儲到存儲器中。數(shù)字化及碼流產(chǎn)生的功能由SAA7113芯片完成，由FPGA對SAA7113芯片初始化設置、控制，并對數(shù)字化后的數(shù)據(jù)進行操作。 圖像處理算法部分考慮到實時性與算法復雜度等因素，從裝置的圖像處理流程中有選擇性地實現(xiàn)了直方圖均衡化、中值濾波與邊緣檢測三種圖像處理算法。 壓縮編碼部分依據(jù)JPEG標準基本系統(tǒng)順序編碼模式，在FPGA上實現(xiàn)了DCT(Discrete Cosine Transform)變換、量化、Zig-Zag掃描、直流系數(shù)DPCM(Differential Pulse Code Modulation)編碼、交流系數(shù)RLC(Run Length code)編碼、霍夫曼編碼等主要步驟，最后用實際的圖像數(shù)據(jù)塊對系統(tǒng)進行了驗證。

    標簽： FPGA 圖像處理 壓縮編碼 算法

    上傳時間： 2013-04-24

    上傳用戶：qazwsc

  • 基于FPGA實現(xiàn)DVBS信道編碼及調(diào)制

    DVB-S(Digital Video Broadcasting bv Satellite)調(diào)制器是符合DVB-S協(xié)議的數(shù)字電視前端設備之一，也滿足我國數(shù)字電視衛(wèi)星廣播標準，該設備可以廣泛應用于數(shù)字電視衛(wèi)星業(yè)務和相關(guān)數(shù)字電視業(yè)務。本文主要闡述了基于FPGA實現(xiàn)DVB-S調(diào)制器的信道編碼和調(diào)制，按功能對DVB-S信道編碼過程進行模塊分解、模塊接口定義，針對每個模塊進行工作原理分析、算法分析、HDL描述、時序仿真及FPGA實現(xiàn)；DVB-S調(diào)制器的核心是信道編碼和調(diào)制部分，利用FPGA在數(shù)字信號處理方面的優(yōu)勢，本文重點對其中的幾個關(guān)鍵模塊，包括RS編碼、卷積交織器和卷積穿孔編碼等的實現(xiàn)算法進行了比較詳細的分析，并通過HDL描述和時序仿真來驗證算法正確性；對FPGA各模塊的資源進行了估計、利用Altera公司的Cyclone器件的內(nèi)部鎖相環(huán)實現(xiàn)ASI信號的接收；最后對整機進行了測試，測試結(jié)果表明，本文設計的DVB-S調(diào)制器技術(shù)指標滿足設計要求。

    標簽： FPGA DVBS 信道編碼 調(diào)制

    上傳時間： 2013-04-24

    上傳用戶：gmh1314

  • 自適應濾波器算法設計及其FPGA實現(xiàn)

    自適應濾波器是智能天線技術(shù)中核心部分-自適應波束成形器的關(guān)鍵技術(shù)，算法的高效穩(wěn)定性及硬件時鐘速率的快慢是判斷波束成形器性能優(yōu)劣的主要標準。 首先選取工程領(lǐng)域最常用的自適應橫向LMS濾波算法作為研究對象，提出了利用最小均方誤差意義下自適應濾波器的輸出信號與主通道噪聲信號的等效關(guān)系，得到濾波器最佳自適應參數(shù)的方法。并分析了在平穩(wěn)和非平穩(wěn)環(huán)境噪聲下，濾波器的收斂速度、權(quán)系數(shù)穩(wěn)定性、跟蹤輸入信號的能力和信噪比的改善等特性。 在分析梯度自適應格型算法的基礎(chǔ)上，提出利用最佳反射系數(shù)的收斂性和穩(wěn)定性，得到了梯度自適應格型濾波器的定步長改進方法；并以改進的梯度自適應格型和線性組合器組成梯度自適應格型聯(lián)合處理算法，在同樣環(huán)境噪聲下，相比自適應橫向LMS算法，其各項性能指標都得到了極大地改善，而且有利于節(jié)省硬件資源。 設計了自適應橫向LMS濾波器和梯度自適應格型聯(lián)合處理濾波器的電路模型，并用馳豫超前技術(shù)對兩類濾波器進行了流水線優(yōu)化。利用Altera公司的CycloneⅡ系列EP2C5T144C6芯片和多種EDA工具，完成了濾波器的FPGA硬件設計與仿真實現(xiàn)。并以FPGA實現(xiàn)的3節(jié)梯度自適應格型聯(lián)合處理器為核心，設計了一種TD-SCDMA系統(tǒng)的自適應波束成形器，分析表明可以很好地利用系統(tǒng)提供的參考信號對下行波束進行自適應成形。

    標簽： FPGA 自適應濾波器 算法設計

    上傳時間： 2013-07-16

    上傳用戶：xyipie

  • 基于FPGA的I2C總線控制器的設計

    本文利用Verilog HDL語言在FPGA上實現(xiàn)IC總線的規(guī)范，又簡要介紹了Quartus Ⅱ設計環(huán)境和設計方法，以及FPGA的設計流程。在此基礎(chǔ)上，重點介紹了I

    標簽： FPGA I2C 總線控制器

    上傳時間： 2013-04-24

    上傳用戶：ajaxmoon

  • 基于FPGA的調(diào)制解調(diào)器

    當今電子系統(tǒng)的設計是以大規(guī)模FPGA為物理載體的系統(tǒng)芯片的設計，基于FPGA的片上系統(tǒng)可稱為可編程片上系統(tǒng)(SOPC)。SOPC的設計是以知識產(chǎn)權(quán)核(IPCore)為基礎(chǔ)，以硬件描述語言為主要設計手段，借助以計算機為平臺的EDA工具進行的。 本文在介紹了FPGA與SOPC相關(guān)技術(shù)的基礎(chǔ)上，給出了SOPC技術(shù)開發(fā)調(diào)制解調(diào)器的方案。在分析設計軟件Matlab/DSP(Digital Signal Processing)。builder以及Quartus Ⅱ開發(fā)軟件進行SOPC(System On a Programmable Chip)設計流程后，依據(jù)調(diào)制解調(diào)算法提出了一種基于DSP Builder調(diào)制解調(diào)器的SOPC實現(xiàn)方案，模塊化的設計方法大大縮短了調(diào)制解調(diào)器的開發(fā)周期。 在SOPC技術(shù)開發(fā)調(diào)制解調(diào)器的過程中，用MATLAB/Simulink的圖形方式調(diào)用Altera DSP Builder和其他Simulink庫中的圖形模塊(Block)進行系統(tǒng)建模，在Simulink中仿真通過后，利用DSP Builder將Simulink的模型文件(．mdl)轉(zhuǎn)化成通用的硬件描述語言VHDL文件，從而避免了VHDL語言手動編寫系統(tǒng)的煩瑣過程，將精力集中于算法的優(yōu)化上。 基于DSP Builder的開發(fā)功能，調(diào)制解調(diào)器電路中的低通濾波器可直接調(diào)用FIRIP Core，進一步提高了開發(fā)效率。 在進行編譯、仿真調(diào)試成功后，經(jīng)過QuartusⅡ?qū)⒕幾g生成的編程文件下載到ALTERA公司Cyclone Ⅱ系列的FPGA芯片EP2C5F256C6，完成器件編程，從而給出了一種調(diào)制解調(diào)器的SOPC系統(tǒng)實現(xiàn)方案。

    標簽： FPGA 調(diào)制解調(diào)器

    上傳時間： 2013-05-28

    上傳用戶：koulian

  • 基于FPGA全數(shù)字OFDM收發(fā)信機

    正交頻分復用(OFDM，Orthogonal Frequency Division Multiplexing)技術(shù)作為一種可以有效對抗信號波形間干擾的高速傳輸技術(shù)，引起了廣泛關(guān)注。它利用許多并行的、傳輸?shù)退俾蕯?shù)據(jù)的子載波來實現(xiàn)高速率的通信。它的特點是各子載波相互正交，所以擴頻調(diào)制后的頻譜可以相互重疊，不但減小了子載波問的相互干擾，還大大提高了頻譜利用率。由于OFDM的高頻譜利用率、易于硬件實現(xiàn)、對抗頻率選擇性衰落和窄帶干擾的能力突出等優(yōu)點，它成為第四代移動通信的首選技術(shù)，是當前移動通信技術(shù)研究的熱點問題。 本文概括的介紹了OFDM系統(tǒng)的基本概念、基本工作原理和關(guān)鍵技術(shù)，重點討論了如何在FPGA上實現(xiàn)OFDM低中頻收發(fā)信機。基于這些理論知識，確定了OFDM低中頻收發(fā)信機系統(tǒng)實現(xiàn)方案，并選擇ALTERA公司的Cyclone

    標簽： FPGA OFDM 全數(shù)字 收發(fā)信機

    上傳時間： 2013-06-29

    上傳用戶：水瓶kmoon5

  • FPGA實現(xiàn)的直接數(shù)字頻率合成器

    FPGA實現(xiàn)的直接數(shù)字頻率合成器，本文基于DDS的基本原理,利用Altera公司的FPGA芯片F(xiàn)LEX10系列器件完成了一個DDS系統(tǒng)的設計。

    標簽： FPGA 數(shù)字頻率合成器

    上傳時間： 2013-08-06

    上傳用戶：wangzhen1990

  • 用FPGA實現(xiàn)的8點32 位FFT 處理器方案

    :文章針對目前數(shù)字信號處理中大量采用的快速傅立葉變換[FFT] 算法采用軟件編程來處理的應用現(xiàn)狀,在對FFT 算法進行\(zhòng)\\\\\\\r\\\\\\\\n分析的基礎(chǔ)上,給出了用FPGA[Field Programmable Gate Array] 實現(xiàn)的8 點32 位FFT 處理器方案,并得到了系統(tǒng)的仿真結(jié)果。\\\\\\\\r\\\\\\\\n最后在Altera 公司FLEX10K系列FPGA 芯片上成功地實現(xiàn)了綜合。

    標簽： FPGA FFT 處理器 方案

    上傳時間： 2013-08-09

    上傳用戶：yangzhiwei

  • FPGA開發(fā)板

    FPGA開發(fā)板，提供ALTERA公司多款FPGA的開發(fā)板。

    標簽： FPGA 開發(fā)板

    上傳時間： 2013-08-12

    上傳用戶：chenhr

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