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DAc

數(shù)模轉(zhuǎn)換器，又稱D/A轉(zhuǎn)換器，簡稱DAc，它是把數(shù)字量轉(zhuǎn)變成模擬的器件。D/A轉(zhuǎn)換器基本上由4個部分組成，即權(quán)電阻網(wǎng)絡(luò)、運(yùn)算放大器、基準(zhǔn)電源和模擬開關(guān)。模數(shù)轉(zhuǎn)換器中一般都要用到數(shù)模轉(zhuǎn)換器，模數(shù)轉(zhuǎn)換器即A/D轉(zhuǎn)換器，簡稱ADC，它是把連續(xù)的模擬信號轉(zhuǎn)變?yōu)殡x散的數(shù)字信號的器件。

  • 16bit音頻過采樣DAc的FPGA設(shè)計(jì)實(shí)現(xiàn).rar

    基于∑-△噪聲整形技術(shù)和過采樣技術(shù)的數(shù)模轉(zhuǎn)換器(DAc)可以可靠地把數(shù)字信號轉(zhuǎn)換成為高精度的模擬信號。采用這一結(jié)構(gòu)進(jìn)行數(shù)模轉(zhuǎn)換具有諸多優(yōu)點(diǎn),例如極低的失配噪聲和高的可靠性,便于作為IP模塊嵌入到其他芯片系統(tǒng)中等,更重要的是可以得到其他DAc結(jié)構(gòu)所無法達(dá)到的精度和動態(tài)范圍。在高精度測量、音頻轉(zhuǎn)換、汽車電子等領(lǐng)域有著廣泛的應(yīng)用價值。 由于非線性和不穩(wěn)定性的存在,高階∑-△調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn)存在較大的難度。本設(shè)計(jì)綜合大量文獻(xiàn)中的經(jīng)驗(yàn)原則和方法,首先闡述了∑-△調(diào)制器的一般原理,并討論了一般結(jié)構(gòu)調(diào)制器的設(shè)計(jì)過程,然后描述了穩(wěn)定的高階高精度調(diào)制器的設(shè)計(jì)流程。根據(jù)市場需求,設(shè)定了整個設(shè)計(jì)方案的性能指標(biāo),并據(jù)此設(shè)計(jì)了達(dá)到16bit精度和滿量程輸入范圍的三階128倍過采樣調(diào)制器。 本設(shè)計(jì)采用∑-△結(jié)構(gòu),根據(jù)系統(tǒng)要求設(shè)計(jì)了量化器位數(shù)、調(diào)制器過采樣比和階數(shù)。在分析高階單環(huán)路調(diào)制器穩(wěn)定性的基礎(chǔ)上,成功設(shè)計(jì)了六位量化三階單環(huán)路調(diào)制器結(jié)構(gòu)。在16比特的輸入信號下,達(dá)到了90dB左右的信噪比。該設(shè)計(jì)已經(jīng)在Cyclone系列FPGA器件下得到硬件實(shí)現(xiàn)和驗(yàn)證,并實(shí)現(xiàn)了實(shí)時音頻驗(yàn)證。測試表明,該DAc模塊輸出信號的信噪比能滿足16比特?cái)?shù)據(jù)轉(zhuǎn)換應(yīng)用的分辨率要求,并具備良好的兼容性和通用性。 本設(shè)計(jì)可作為IP核廣泛地在其他系統(tǒng)中進(jìn)行復(fù)用,具有很強(qiáng)的應(yīng)用性和一定的創(chuàng)新性。

    標(biāo)簽： FPGA bit DAc

    上傳時間： 2013-07-10

    上傳用戶：chuandalong

  • 可重構(gòu)24bit音頻過采樣DAc的FPGA

    基于過采樣和∑-△噪聲整形技術(shù)的DAc能夠可靠地把數(shù)字信號轉(zhuǎn)換為高精度的模擬信號(大于等于16位)。采用這一架構(gòu)進(jìn)行數(shù)模轉(zhuǎn)換具有諸多優(yōu)點(diǎn)，例如極低的失配噪聲和更高的可靠性，便于實(shí)現(xiàn)嵌入式集成等，最重要的是可以得到其他DAc結(jié)構(gòu)所無法達(dá)到的精度和動態(tài)范圍。在高精度測量，音頻轉(zhuǎn)換，汽車電子等領(lǐng)域有著廣泛的應(yīng)用價值。 本文采用∑-△結(jié)構(gòu)以FPGA方式實(shí)現(xiàn)了一個具有高精度的數(shù)模轉(zhuǎn)換器，在24比特的輸入信號下，達(dá)到了約150dB的信噪比。作為一個靈活的音頻DAc實(shí)現(xiàn)方案。該DAc可以對CD/DVD/HDCD/SACD等多種制式下的音頻信號進(jìn)行處理，接受并轉(zhuǎn)換采樣率為32/44.1/48/88.2/96/192kHz，字長為16/18/20/24比特的PCM數(shù)據(jù)，具備良好的兼容性和通用性。 由于非線性和不穩(wěn)定性的存在，高階∑-△調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn)存在較大的難度。本文綜合大量文獻(xiàn)中的經(jīng)驗(yàn)原則和方法，闡述了穩(wěn)定的高階高精度調(diào)制器的設(shè)計(jì)流程；并據(jù)此設(shè)計(jì)了達(dá)到24bit精度和滿量程輸入范圍的的5階128倍調(diào)制器。本文創(chuàng)新性地提出了∑-△調(diào)制器的一種高效率流水線實(shí)現(xiàn)結(jié)構(gòu)。分析表明，與其他常見的∑-△調(diào)制器實(shí)現(xiàn)結(jié)構(gòu)相比，本方案具有結(jié)構(gòu)簡單、運(yùn)算單元少等優(yōu)點(diǎn)；此外在同樣信號采樣率下，調(diào)制器所需的時鐘頻率大大降低。 文中的過采樣濾波模塊采用三級半帶濾波器和一個可變CIC濾波器級聯(lián)組成，可以達(dá)到最高128倍的過采樣比，同時具有良好的通帶和阻帶特性。在半帶濾波器的設(shè)計(jì)中采用了CSD編碼，使結(jié)構(gòu)得到了充分的簡化。 本文提出的過采樣DAc方案具有可重配置結(jié)構(gòu)，讓使用者能夠方便地控制過采樣比和調(diào)制器階數(shù)。通過積分梳狀濾波器的配置，能夠獲得32/64/128倍的不同過采樣比，從而實(shí)現(xiàn)對于32～192kHz多種采樣率輸入的處理。在不同輸入字長情況下，通過調(diào)制器的重構(gòu)，則可以將調(diào)制器由高精度的5階模式改變?yōu)楣母偷?階模式，滿足不同分辨率信號輸入時的不同精度要求。這是本文的另一創(chuàng)新之處。 目前，該過采樣DAc已經(jīng)在XilinxVirtexⅡ系列FPGA器件下得到硬件實(shí)現(xiàn)和驗(yàn)證。測試表明，對于從32kHz到192kHz的不同輸入信號，該DAc模塊輸出1比特碼流的帶內(nèi)信噪比均能滿足24比特?cái)?shù)據(jù)轉(zhuǎn)換應(yīng)用的分辨率要求。

    標(biāo)簽： FPGA bit DAc 24

    上傳時間： 2013-07-08

    上傳用戶：從此走出陰霾

  • freescale k40/k60 12bit DAc 例程

    freescale k40/k60 cortex m4 12bit DAc 例程

    標(biāo)簽： freescale bit DAc 40

    上傳時間： 2013-05-23

    上傳用戶：luominghua

  • FPGA控制AD程序,ADC,DAc轉(zhuǎn)換接口

    FPGA控制AD程序,ADC,DAc轉(zhuǎn)換接口.rar 有限狀態(tài)機(jī)控制AD采樣.rar

    標(biāo)簽： FPGA ADC DAc 控制

    上傳時間： 2013-08-10

    上傳用戶：zhuyibin

  • 運(yùn)放與ADC和DAc連接(Walt Jung)

    運(yùn)放與ADC和DAc連接

    標(biāo)簽： Walt Jung ADC DAc

    上傳時間： 2013-10-10

    上傳用戶：zhqzal1014

  • MT-019 DAc接口基本原理

    本教程概述與內(nèi)置基準(zhǔn)電壓源、模擬輸出、數(shù)字輸入和時鐘驅(qū)動器的DAc接口電路相關(guān)的 一些重要問題。由于ADC也需要基準(zhǔn)電壓源和時鐘，因此本教程中與這些主題相關(guān)的大多 數(shù)概念同樣適用于ADC。

    標(biāo)簽： 019 DAc MT 接口

    上傳時間： 2014-09-10

    上傳用戶：1406054127

  • MT-018 有意為之的非線性DAc

    通常，我們都是在強(qiáng)調(diào)數(shù)據(jù)轉(zhuǎn)換器中保持良好微分和積分線性度的重要性。不過，在一些 情況下，有意為之的非線性ADC和DAc(但保持良好的微分線性度)會非常有用，尤其是在 處理具有寬動態(tài)范圍的信號時。

    標(biāo)簽： 018 DAc MT 非線性

    上傳時間： 2014-12-23

    上傳用戶：gaome

  • MT-017 過采樣插值DAc

    過采樣和數(shù)字濾波有助于降低對ADC前置的抗混疊濾波器的要求。重構(gòu)DAc可以通過類似的方式運(yùn)用過采樣和插值原理。

    標(biāo)簽： 017 DAc MT 過采樣

    上傳時間： 2014-12-23

    上傳用戶：561596

  • MT-016 DAc基本架構(gòu)III：分段DAc

    當(dāng)我們需要設(shè)計(jì)一個具有特定性能的DAc時，很可能沒有任何一種架構(gòu)是理想的。這種情況下，可以將兩個或更多DAc組合成一個更高分辨率的DAc，以獲得所需的性能。這些DAc可以是同一類型，也可以是不同類型，各DAc的分辨率無需相同

    標(biāo)簽： DAc 016 III MT

    上傳時間： 2014-12-23

    上傳用戶：daoyue

  • MT-015 DAc基本架構(gòu)II：二進(jìn)制DAc

    雖然串DAc和溫度計(jì)DAc是迄今最為簡單的DAc架構(gòu)，但需要高分辨率時，它們絕不是 最有效的。二進(jìn)制加權(quán)DAc每位使用一個開關(guān)，首創(chuàng)于1920年代(參見參考文獻(xiàn)1、2和3)。 自此以后一直頗受歡迎，成為現(xiàn)代精密和高速DAc的支柱架構(gòu)。

    標(biāo)簽： DAc 015 MT 架構(gòu)

    上傳時間： 2013-11-12

    上傳用戶：CSUSheep

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