這是一個(gè)關(guān)于dds理論和系統(tǒng)設(shè)計(jì)方法的論文 內(nèi)容詳細(xì) 來自南開大學(xué)
標(biāo)簽: dds 大學(xué) 設(shè)計(jì)方法
上傳時(shí)間: 2013-12-05
上傳用戶:teddysha
Picasa 是Google提供的一個(gè)圖片管理程序;用戶可以借助于該程序,在數(shù)秒鐘內(nèi)找到自己計(jì)算機(jī)上的圖片,加以編輯并進(jìn)行欣賞。有了 Picasa,您只需借助于快速單次點(diǎn)擊式修正,即可實(shí)現(xiàn)高級修改操作和圖片共享。【請點(diǎn)擊下圖免費(fèi)下載使
標(biāo)簽: Picasa Google 程序 用戶
上傳時(shí)間: 2014-12-01
上傳用戶:kikye
本程序功能: DDS文件夾內(nèi)的程序,完成直接數(shù)字頻率合成功能,有正弦,三角,方波三種波形,并能掃頻. 可通過鍵盤操作設(shè)置頻率參數(shù)和選擇波形種類和控制運(yùn)行. 由兩部分組成,"C"文件夾內(nèi),是用于在 51 單片機(jī)上運(yùn)行的 C語言程序, "Verilog"文件夾內(nèi),是用Verilog語言編寫的 FPGA 程序.
標(biāo)簽: DDS 程序
上傳時(shí)間: 2014-12-06
上傳用戶:cazjing
鑒于傳統(tǒng)波形發(fā)生器的不足,采用數(shù)字合成技術(shù)構(gòu)成任意波形發(fā)生器,此波形發(fā)生器可以產(chǎn)生任意波形的周期信號,能靈活控制信號的頻率幅值,相位,并在很寬的范圍內(nèi)快速切換頻率,具有高分辨輸出,運(yùn)用DDS技術(shù)構(gòu)建頻率信號源,可獲得連續(xù)精確調(diào)整的信號頻率,幅值相位控制方便,存儲容量大;AWG占微機(jī)系統(tǒng)資源少,通用性好,具有較強(qiáng)的移植性和很高的性能價(jià)格比。 研究的內(nèi)容是利用數(shù)字頻率合成技術(shù)構(gòu)成任意波形發(fā)生器,且通過RS232串行接口傳到PC,供PC機(jī)管理。
標(biāo)簽: 波形發(fā)生器
上傳時(shí)間: 2013-12-29
上傳用戶:lo25643
DDS的FPGA實(shí)現(xiàn)文章 做FPGA和DDS的一參拷
標(biāo)簽: FPGA DDS
上傳時(shí)間: 2013-12-23
上傳用戶:253189838
DDS技術(shù)在軟件無線電中的應(yīng)用,軟件無線電和DDs都是很好參考
標(biāo)簽: DDS 軟件無線電 中的應(yīng)用
上傳用戶:hakim
系統(tǒng)特點(diǎn): 1、可自設(shè)網(wǎng)站欄目、文章分類; 2、提供用戶注冊、審核模塊(可選是否開放); 3、提供HTML和Ajax兩種版本;Ajax版本子頁面不含Google廣告欄。 4、主頁文章分類采用Ajax技術(shù),無刷新頁面,速度更快; 5、提供留言模塊,以及游客留言(均可選); 6、新增用戶站長Mail通知; 7、用戶訪問記錄以及用戶下載記錄,在線人數(shù)顯示,在線會員瀏覽; 8、文章、分類、欄目日、月、總瀏覽計(jì)數(shù); 9、來訪者IP來源查詢、更新(請到本站主頁下載IP數(shù)據(jù)庫放到Data目錄下); 10、熱門文章展示(admin/showTopArtics.asp)可選排序方式(時(shí)間,點(diǎn)擊數(shù)); 11、熱門文章置頂功能; 12、用戶注冊、留言、發(fā)文安全字符過濾; 13、廣告顯示設(shè)置; 14、提供多款免費(fèi)模板;
標(biāo)簽: Ajax Google HTML 分類
上傳時(shí)間: 2013-12-17
上傳用戶:thesk123
只顯示在第一個(gè)文件中出現(xiàn)而未在第二個(gè)文件中出現(xiàn)的行;
標(biāo)簽:
上傳時(shí)間: 2015-10-27
上傳用戶:zhuyibin
VHDL 實(shí)現(xiàn)DDS的數(shù)字移相信號發(fā)生器的設(shè)計(jì)代碼.直接解壓打開就可以運(yùn)行..自己寫的代碼
標(biāo)簽: VHDL DDS 代碼 數(shù)字移相
上傳時(shí)間: 2014-01-08
上傳用戶:xcy122677
摘要:介紹了基于可編程邏輯器件CPLD和直接數(shù)字頻率合成技術(shù)(DDS)的三相多波形函數(shù)發(fā)生器的基本原理,并在此基礎(chǔ)上給出了基于CPLD的各模塊設(shè)計(jì)方法及其VHDL源程序
標(biāo)簽: CPLD DDS 可編程邏輯器件 三相
上傳時(shí)間: 2015-10-28
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