設(shè)計(jì)了一種新型的機(jī)載過(guò)壓保護(hù)電路。該電路以芯片LT4356和APL502L為主要器件,簡(jiǎn)單可靠,能夠滿足防80 V/50 ms浪涌電壓要求。介紹了該防浪涌電壓保護(hù)電路主要特點(diǎn)和參數(shù)設(shè)計(jì),并對(duì)該電路進(jìn)行了仿真分析。相應(yīng)實(shí)驗(yàn)結(jié)果表明,該電路是一種可靠有效的機(jī)載過(guò)壓保護(hù)電路。
標(biāo)簽: 機(jī)載 保護(hù) 防浪涌 電壓
上傳時(shí)間: 2013-10-10
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開(kāi)關(guān)電源設(shè)計(jì)筆記-幾分鐘搞定一款LED電源
標(biāo)簽: LED 開(kāi)關(guān)電源設(shè)計(jì) 分 電源
上傳時(shí)間: 2013-10-14
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一款開(kāi)關(guān)電源設(shè)計(jì)筆記(含參數(shù)選取,設(shè)計(jì)原理圖)
標(biāo)簽: 開(kāi)關(guān)電源設(shè)計(jì) 參數(shù) 設(shè)計(jì)原理
上傳時(shí)間: 2013-10-16
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電路如果存在不穩(wěn)定性因素,就有可能出現(xiàn)振蕩。本文對(duì)比分析了傳統(tǒng)LDO和無(wú)片電容LDO的零極點(diǎn),運(yùn)用電流緩沖器頻率補(bǔ)償設(shè)計(jì)了一款無(wú)片外電容LDO,電流緩沖器頻率補(bǔ)償不僅可減小片上補(bǔ)償電容而且可以增加帶寬。對(duì)理論分析結(jié)果在Cadence平臺(tái)基上于CSMC0.5um工藝對(duì)電路進(jìn)行了仿真驗(yàn)證。本文無(wú)片外電容LDO的片上補(bǔ)償電容僅為3 pF,減小了制造成本。它的電源電壓為3.5~6 V,輸出電壓為3.5 V。當(dāng)在輸入電源電壓6 V時(shí)輸出電流從100 μA到100 mA變化時(shí),最小相位裕度為830,最小帶寬為4.58 MHz
標(biāo)簽: LDO 無(wú)片外電容 穩(wěn)定性分析
上傳時(shí)間: 2014-12-24
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PT4115是一款連續(xù)電感電流導(dǎo)通模式的降壓恒流源,用于驅(qū)動(dòng)一顆或者多顆串聯(lián)LED。根據(jù)不同外部器件,芯片可以驅(qū)動(dòng)高達(dá)數(shù)十瓦的LED。PT4115具有調(diào)光功能,通過(guò)DIM引腳實(shí)現(xiàn)模擬調(diào)光和寬范圍PWM調(diào)光。當(dāng)VDIM低于0.3V時(shí),功率開(kāi)關(guān)關(guān)斷,芯片進(jìn)入低功耗待機(jī)狀態(tài) 主要技術(shù)參數(shù) ? 輸入電壓范圍:6V to 40V ? 最大輸出LED電流1.2A ? 5%的輸出電流精度 ? 高達(dá)97%的效率 ? 極少的外部器件 ? 復(fù)用DIM引腳進(jìn)行LED開(kāi)關(guān)、模擬調(diào)光和PWM調(diào)光 ? LED開(kāi)路保護(hù) ? LED過(guò)熱保護(hù) ? 輸出電流可調(diào)節(jié) ? 具有輸入欠壓保護(hù)功能 應(yīng)用 ? 低壓LED射燈代替鹵素?zé)?? 車(chē)載LED燈 ? LED備用燈 ? LED信號(hào)燈
上傳時(shí)間: 2014-12-24
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DU1763是一款兼容可控硅調(diào)光器的高壓線性恒流控制器,可直接驅(qū)動(dòng)多通道LED燈串。其電源系統(tǒng)結(jié)構(gòu)簡(jiǎn)單,只需很少的外圍元件就可以實(shí)現(xiàn)優(yōu)秀的恒流特性的調(diào)光特性。主要應(yīng)用于對(duì)體積、成本要求苛刻的非隔離兼容可控硅調(diào)光器的LED恒流驅(qū)動(dòng)電源系統(tǒng)。同時(shí)由于無(wú)需電解電容及磁性元件等特點(diǎn),可以實(shí)現(xiàn)很長(zhǎng)的電源壽命。 DU1763可以根據(jù)實(shí)際應(yīng)用情況去選擇三通道或二勇斗。DU1763還可以多芯片并聯(lián)或串聯(lián)應(yīng)用:其輸出電流可通過(guò)電流采樣電阻進(jìn)行編程。可自適輸出LED燈串的電壓大小。 DU1763集成了專利的防過(guò)沖技術(shù)和過(guò)溫補(bǔ)償功能。DU1763還集成了各種保護(hù)功能,包括輸出短路、輸出開(kāi)路、過(guò)溫保護(hù)。從而提高了LED恒流電源的可靠性。
標(biāo)簽: 1763 DU 兼容 可控硅調(diào)光器
上傳時(shí)間: 2013-11-06
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為了滿足實(shí)時(shí)跟蹤的需求,在分析了3種配電網(wǎng)拓?fù)涓櫵惴ǖ幕A(chǔ)上,提出了一種電網(wǎng)全局以母線為節(jié)點(diǎn)遍歷和設(shè)備單元局部更新相結(jié)合的新型實(shí)時(shí)跟蹤算法。為了便于說(shuō)明算法的應(yīng)用,文中還對(duì)電網(wǎng)拓?fù)渥兓透櫵惴ㄟM(jìn)行了闡述。最后在一個(gè)大型鋼鐵企業(yè)的配電網(wǎng)仿真系統(tǒng)中進(jìn)行了實(shí)際的應(yīng)用,該仿真說(shuō)明了該跟蹤算法是有效的。
標(biāo)簽: 配電網(wǎng) 上傳時(shí)間: 2013-11-06
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介紹一種基于CSMC0.5 μm工藝的低溫漂高電源抑制比帶隙基準(zhǔn)電路。本文在原有Banba帶隙基準(zhǔn)電路的基礎(chǔ)上,通過(guò)采用共源共柵電流鏡結(jié)構(gòu)和引入負(fù)反饋環(huán)路的方法,大大提高了整體電路的電源抑制比。 Spectre仿真分析結(jié)果表明:在-40~100 ℃的溫度范圍內(nèi),輸出電壓擺動(dòng)僅為1.7 mV,在低頻時(shí)達(dá)到100 dB以上的電源抑制比(PSRR),整個(gè)電路功耗僅僅只有30 μA。可以很好地應(yīng)用在低功耗高電源抑制比的LDO芯片設(shè)計(jì)中。
標(biāo)簽: CMOS 高電源抑制 帶隙基準(zhǔn) 電壓源
上傳時(shí)間: 2013-10-27
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諸如電信設(shè)備、存儲(chǔ)模塊、光學(xué)繫統(tǒng)、網(wǎng)絡(luò)設(shè)備、服務(wù)器和基站等許多復(fù)雜繫統(tǒng)都采用了 FPGA 和其他需要多個(gè)電壓軌的數(shù)字 IC,這些電壓軌必須以一個(gè)特定的順序進(jìn)行啟動(dòng)和停機(jī)操作,否則 IC 就會(huì)遭到損壞。
上傳時(shí)間: 2014-12-24
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一種單相電路無(wú)功電流實(shí)時(shí)檢測(cè)新方法的研究
標(biāo)簽: 單相 電路 無(wú)功電流 實(shí)時(shí)檢測(cè)
上傳時(shí)間: 2013-10-28
上傳用戶:穿著衣服的大衛(wèi)
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