運動控制卡是數(shù)控系統(tǒng)的重要組成部分，是上位機與驅(qū)動執(zhí)行部件的之間的一座橋梁。數(shù)控加工中的定位控制的精度、速度調(diào)節(jié)的性能等重要指標(biāo)都與運動控制卡密切相關(guān)。目前，國內(nèi)研制的運動控制卡與國外專業(yè)性公司研制的先進的開放式運動控制卡相比還有較大差距。因此，對于運動控制卡的研究與開發(fā)具有很大的現(xiàn)實意義。 本文對運動控制卡的各種實現(xiàn)方案作了深入的比較，對于運動控制卡的發(fā)展趨勢進行了探討。在分析數(shù)控系統(tǒng)對于運動控制卡需求的基礎(chǔ)上，提出了一種基于DSP的PCI總線運動控制卡的實現(xiàn)方案。該方案具有通用性好、軟件易于修改升級、調(diào)試方便等特點。 文中對這一方案的具體實現(xiàn)做了詳細的分析，給出了系統(tǒng)的整體結(jié)構(gòu)設(shè)計，軟硬件組成情況。詳盡闡述了運動控制電路、總線接口電路、驅(qū)動器接口電路等硬件電路的設(shè)計過程，以及運動控制卡的制作過程。論述了DSP上的程序結(jié)構(gòu)，并具體分析了插補算法、速度控制算法等在DSP上的實現(xiàn)方法。對PC機上的運動控制卡的驅(qū)動程序的模型以及編寫方法做了介紹。 通過對制成樣板的調(diào)試表明，運動控制卡具有良好的性能。
上傳時間： 2013-07-29
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上傳時間： 2013-06-12
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數(shù)字信息時代帶來了“信息大爆炸”，使數(shù)據(jù)量大增，而數(shù)字圖像數(shù)據(jù)更是如此，如果不對圖像數(shù)據(jù)進行有效的壓縮，那么圖像信息的存儲與傳輸將無法進行。顯然，尋求一種高效的圖像壓縮系統(tǒng)具有很大的現(xiàn)實意義。 本文基于大規(guī)模現(xiàn)場可編程邏輯陣列(FPGA)和高速數(shù)字信號處理器(DSP)協(xié)同作業(yè)，來完成實時圖像處理的系統(tǒng)設(shè)計。出于對系統(tǒng)設(shè)計上的性能和功耗方面的考慮，系統(tǒng)中FPGA 選用的是ALTERA公司的Cyclone系列芯片EP1C12Q240C8，DSP選用的是TI公司的55x系列芯片TMS320VC5502。該系統(tǒng)集圖像采集、壓縮、顯示和存儲功能于一體，其中DSP為主處理器負責(zé)圖像處理，F(xiàn)PGA為協(xié)處理器負責(zé)系統(tǒng)的所有數(shù)字邏輯控制。FPGA和DSP的工作之間形成流水，并且借助于一片雙口RAM(CY7C025AV-15AI)完成兩者的通訊。結(jié)合FPGA和DSP自身的特點，本文提出一種新穎的信息通信方式，借助于一片雙口RAM，其內(nèi)部按其存儲空間等分兩塊，利用乒乓技術(shù)完成對高速實時的圖像數(shù)據(jù)緩沖。 該系統(tǒng)從視頻采集、傳輸、壓縮到圖像存儲等整個過程的工作，分別由FPGA和DSP承擔(dān)。充分考慮到它們自身的優(yōu)缺點，在滿足系統(tǒng)實時性要求的同時，結(jié)構(gòu)靈活，便于以后的擴展與升級。結(jié)果表明，在TMS320VC5502實現(xiàn)了對采集圖像的JPEG壓縮，效果良好且滿足了實時性的要求，因此系統(tǒng)的功能得到了總體上的驗證。 關(guān)鍵詞：圖像處理；FPGA；DSP；JPEG
上傳時間： 2013-06-11
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GSM是全球使用最為廣泛的一種無線通信標(biāo)準(zhǔn)，不僅在民用領(lǐng)域，也在鐵路GSM-R等專用領(lǐng)域發(fā)揮著極為重要的作用。由于無線信道具有瑞利衰落和延時效應(yīng)，在通信系統(tǒng)的收發(fā)兩端也存在不完全匹配等未知因素，因此接收的信號疊加有各種誤差因素的影響。GSM接收機的實現(xiàn)離不開系統(tǒng)的同步，為了得到更好的同步質(zhì)量，就必須對GSM基帶同步技術(shù)進行研究，選擇一種最合適的同步算法。GSM的同步既有時間同步，也有頻率同步。 @@ 軟件無線電是當(dāng)前通信領(lǐng)域引入注目的熱點之一。長期以來，GSM的接收和解調(diào)都是由專用的ASIC芯片來完成的，通過軟件來實現(xiàn)GSM接收機的基帶算法，體現(xiàn)了軟件無線電技術(shù)的思想，選擇用它們來實現(xiàn)的GSM接收機具有靈活、可靠、擴展性好的優(yōu)點。 @@ 論文主要討論GSM接收機同步算法與基于FPGA和DSP的GSM接收機設(shè)計， @@ 主要內(nèi)容包括： @@ 通過相關(guān)理論知識的學(xué)習(xí)，設(shè)計驗證了GSM基帶同步算法。對FB時間同步，討論了包絡(luò)檢測和FFT變換兩種不同的方法；對SB時間同步，介紹實相關(guān)和復(fù)相關(guān)兩種方法；對頻率同步，給出了一種對FB運用相關(guān)運算來精確估計頻率誤差的算法。 @@ 設(shè)計了使用GSM射頻收發(fā)芯片RDA6210并通過實驗室的ALTERA EP3C25FPGA開發(fā)板進行控制的GSM射頻端的解決方案，論文對RDA6210的性能和控制方式進行了詳細的介紹，設(shè)計了芯片的控制模塊，得到了下變頻后的GSM基帶信號。 @@ 設(shè)計了基于RF前端+FPGA的GSM接收機方案。利用ALTERA EP2S180開發(fā)平臺來完成基帶數(shù)據(jù)的處理。針對ALTERA EP2S180開發(fā)平臺模數(shù)轉(zhuǎn)換器AD9433的特點使用THS4501設(shè)計了單獨的差分運算放大器模塊；設(shè)計了平臺的數(shù)據(jù)存儲方案并將該平臺得到的基帶采樣數(shù)據(jù)用于同步算法的仿真。 @@ 設(shè)計了基于RF前端+DSP的GSM接收機方案。利用模數(shù)轉(zhuǎn)換器AD9243、FPGA芯片和TMS320C6416TDSP芯片來完成基帶數(shù)據(jù)的處理。設(shè)計了McBSP+EDMA傳輸?shù)臄?shù)據(jù)存儲方案。 @@ 給出了接收機硬件測試的結(jié)果，從多方面驗證了所設(shè)計硬件平臺的可靠性。 @@關(guān)鍵詞：GSM接收機；同步；RF； FPGA；DSP；
上傳時間： 2013-07-01
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信號與信息處理是信息科學(xué)中近幾年來發(fā)展最為迅速的學(xué)科之一,隨著片上系統(tǒng)(SOC,System On Chip)時代的到來,FPGA正處于革命性數(shù)字信號處理的前沿。基于FPGA的設(shè)計可以在系統(tǒng)可再編程及在系統(tǒng)調(diào)試,具有吞吐量高,能夠更好地防止授權(quán)復(fù)制、元器件和開發(fā)成本進一步降低、開發(fā)時間也大大縮短等優(yōu)點。然而,FPGA器件是基于SRAM結(jié)構(gòu)的編程工藝,掉電后編程信息立即丟失,每次加電時,配置數(shù)據(jù)都必須重新下載,并且器件支持多種配置方式,所以研究FPGA器件的配置方案在FPGA系統(tǒng)設(shè)計中具有極其重要的價值,這也給用于可編程邏輯器件編程的配置接口電路和實驗開發(fā)設(shè)備提出了更高的要求。 本論文基于IEEE1149.1標(biāo)準(zhǔn)和USB2.0技術(shù),完成了FPGA配置接口電路及實驗開發(fā)板的設(shè)計與實現(xiàn)。作者在充分理解IEEE1149.1標(biāo)準(zhǔn)和USB技術(shù)原理的基礎(chǔ)上,針對Altcra公司專用的USB數(shù)據(jù)配置電纜USB-Blaster,對其內(nèi)部工作原理及工作時序進行測試與詳細分析,完成了基于USB配置接口的FPGA芯片開發(fā)實驗電路的完整軟硬件設(shè)計及功能時序仿真。作者最后進行了軟硬件調(diào)試,完成測試與驗證,實現(xiàn)了對Altera系列PLD的配置功能及實驗開發(fā)板的功能。 本文討論的USB下載接口電路被驗證能在Altera的QuartusII開發(fā)環(huán)境下直接使用,無須在主機端另行設(shè)計通信軟件,其兼容性較現(xiàn)有設(shè)計有所提高。由于PLD(Programmable Logic Device)廠商對其知識產(chǎn)權(quán)嚴(yán)格保密,使得基于USB接口的配置電路應(yīng)用受到很大限制,同時也加大了自行對其進行開發(fā)設(shè)計的難度。 與傳統(tǒng)的基于PC并口的下載接口電路相比,本設(shè)計的基于USB下載接口電路及FPGA實驗開發(fā)板具有更高的編程下載速率、支持熱插拔、體積小、便于攜帶、降低對PC硬件傷害,且具備其它下載接口電路不具備的SignalTapII嵌入式邏輯分析儀和調(diào)試NiosII嵌入式軟核處理器等明顯優(yōu)勢。從成本來看,本設(shè)計的USB配置接口電路及FPGA實驗開發(fā)板與其同類產(chǎn)品相比有較強的競爭力。
上傳時間： 2013-04-24
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在仿真環(huán)境下實現(xiàn)TMS320C6000系列DSP的程序自引導(dǎo)
上傳時間： 2013-08-03
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隨著電網(wǎng)中非線性負載的迅速增加，電能質(zhì)量日趨惡化，這不僅嚴(yán)重影響電網(wǎng)安全高效的運行，而且對經(jīng)典的電力測量理論、方法和儀表的設(shè)計都提出了新的挑戰(zhàn)。電力檢測系統(tǒng)的發(fā)展和應(yīng)用，對電力系統(tǒng)的安全運行有重要意義，并且具有明顯的經(jīng)濟效益和社會效益。 本文講述了諧波測量的基本理論，著重對傅里葉變換進行說明，使用PSIM軟件對諧波信號進行仿真，并給出仿真結(jié)果。以電力監(jiān)控領(lǐng)域現(xiàn)階段的技術(shù)為參考，提出并研制了一種基于ARM和DSP的嵌入式平臺的電力監(jiān)控系統(tǒng)。該系統(tǒng)為了能滿足實時諧波分析算法運算量大的要求，它采用模塊化設(shè)計，核心CPU按數(shù)據(jù)處理和控制兩種功能分別采用美國TI公司生產(chǎn)的TMS320LF2407芯片和Samsung公司基于ARM920T內(nèi)核的16/32位S3C2410A微處理器，兩個核心芯片各自在不同的電路板上獨立運行，充分發(fā)揮DSP芯片的數(shù)字信號處理優(yōu)勢和ARM的控制功能，以實現(xiàn)系統(tǒng)中的復(fù)雜軟件算法，運算速度也能得以提高。 系統(tǒng)硬件設(shè)計包括DSP數(shù)據(jù)采集模塊、實時時鐘電路和ARM的時鐘電路、存儲器接口電路、SDRAM電路、串行接口電路、通信模塊接口電路、LCD顯示等電路的設(shè)計。 系統(tǒng)軟件設(shè)計主要包括操作系統(tǒng)的移植以及應(yīng)用程序的設(shè)計，應(yīng)用程序設(shè)計由ARM主控程序設(shè)計、網(wǎng)絡(luò)通訊程序、ARM與DSP通訊程序設(shè)計以及DSP數(shù)據(jù)處理程序設(shè)計組成。
標(biāo)簽： ARM DSP 電能質(zhì)量 在線監(jiān)控系統(tǒng)
上傳時間： 2013-04-24
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智能繡花機是當(dāng)代最先進的繡花機械，廣泛應(yīng)用于刺繡行業(yè)，國產(chǎn)繡花機著重于中低端產(chǎn)品的開發(fā)，而隨著電子、計算機技術(shù)的快速發(fā)展，用戶對高性能繡花機的需求日益增大。本文在詳細分析智能繡花機工作原理的基礎(chǔ)上，結(jié)合智能繡花機的功能需求與當(dāng)前嵌入式領(lǐng)域的最新技術(shù)，設(shè)計了一種基于ARM和DSP為處理器的控制系統(tǒng)解決方案，主要研究工作和成果如下： (1)制定了系統(tǒng)總體方案和具體實驗方案，設(shè)計了信息處理和機電控制分離的結(jié)構(gòu)。 (2)研制了基于S3C2410X為核心的主控制模塊，設(shè)計了用于外圍擴展的FLASH、SDRAM、USB數(shù)據(jù)存儲、以太網(wǎng)通信、UART接口、LCD觸摸屏顯示器等硬件電路。 (3)研制了基于TMS320LF2407A為核心的機電控制模塊，設(shè)計了繡框電機和主軸電機等硬件控制模塊。 (4)設(shè)計了基于CY7C027的雙口RAM通信模塊，實現(xiàn)ARM和DSP之間的高速數(shù)據(jù)通信。 (5)采用虛擬機技術(shù)建立了ARM的Linux交叉編譯環(huán)境和DSP的CCS共存的系統(tǒng)開發(fā)環(huán)境，節(jié)約了使用資源。 (6)研究了DST繡花花樣文件存儲格式以及解碼方法，采用MiniGUI編程實現(xiàn)了一個友好的圖形用戶界面，簡要介紹SVPWM技術(shù)的DSP實現(xiàn)。
上傳時間： 2013-06-24
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設(shè)計一種基于數(shù)字信號處理器DSP 的無刷直流電動機控制系統(tǒng)。充分利用TMS320C240 DSP 外設(shè)接口豐富、運算速度快的特點, 采用PWM方式, 以霍爾傳感器作為位置和速度傳感器, 實現(xiàn)對無刷直流
標(biāo)簽： DSP 無刷直流電動機 控制系統(tǒng)
上傳時間： 2013-04-24
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機械手是自動裝配生產(chǎn)線上必不可少的設(shè)備，它可以模擬人手臂的部分動作，按預(yù)定的程序、軌跡和要求，實現(xiàn)抓取、搬運和裝配等工作。在減輕人的勞動強度和提高裝配質(zhì)量和在惡劣環(huán)境下作業(yè)等方面，起到了積極的作用。嵌入式系統(tǒng)是近年來發(fā)展起來的以應(yīng)用為中心并且軟硬件可裁剪的實時系統(tǒng)，它的特點是高度自動化，響應(yīng)速度快等，非常適合于要求實時的和多任務(wù)的場合。 本文分析了機械手控制系統(tǒng)的功能要求，研究設(shè)計了一種基于ARM和DSP的機械手數(shù)控系統(tǒng)的方案。嵌入式ARM處理器，具有運行速度快、功耗低、程序設(shè)計靈活、外圍硬件資源豐富等優(yōu)點，但其很難在處理大數(shù)據(jù)量、復(fù)雜算法時保證系統(tǒng)的靈活性和實時性。DSP作為數(shù)字信號處理的核心器件，能夠?qū)崟r快速的完成控制算法運算，由于DSP普通輸入輸出口的高低電平變化周期最快只能到1微秒左右，不適合高速輸入輸出；FPGA芯片高速輸入輸出數(shù)據(jù)，時間可縮短至幾十納秒。另外利用FPGA可以方便的實現(xiàn)各種接口的邏輯時序，豐富的接口使得該系統(tǒng)能夠方便的進行移植，擴展了該系統(tǒng)的應(yīng)用領(lǐng)域，從而提升了其性價比，通過ARM處理器和DSP以及FPGA技術(shù)的有機結(jié)合，發(fā)揮各自的優(yōu)勢，使系統(tǒng)具有程序設(shè)計靈活、以太網(wǎng)通信、大容量存儲、高速數(shù)據(jù)輸出、可移植等特點，既滿足高速機械手自動控制的要求，同時又具有一定的通用性。 通過本課題實踐表明，基于ARM和DSP構(gòu)建嵌入式數(shù)控系統(tǒng)的應(yīng)用方案全可行、合理，同傳統(tǒng)的人機交互系統(tǒng)設(shè)計相比，能大量地減輕研發(fā)任務(wù)，提高發(fā)速度，能夠在短時間內(nèi)得到控制性能優(yōu)秀的數(shù)控系統(tǒng)。
標(biāo)簽： ARM DSP 數(shù)控 系統(tǒng)研究
上傳時間： 2013-06-11
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