Verilog編寫基于FPGA的Dds實現。適合感興趣的學習者學習，可以提高自己的能力，大家可以多交流哈
上傳時間： 2022-05-18
上傳用戶：zhaiyawei
1、 設計任務（1） 正弦波、三角波、方波、鋸齒波輸出頻率范圍：1KHZ~1MHZ（2） 具有頻率設置功能，頻率步驟：100HZ;（3） 輸出信號頻率定度：優于10 ^4（4） 輸出電壓幅度：在5K負載電阻上的電壓峰——峰值Vopp≧1V;（5） 失真度：用示波器觀察使無明顯失真。 2、 基本要求：（1） 掌握采用FPGA硬件特性、及軟件開發工具MAXPLUSII的使用。（2） 掌握Dds函數信號發生器的原理，并采用VIIDL語言設計Dds內核單元。（3） 掌握單片機與Dds單無連接框圖原理，推導出頻率控制字、相位控制字的算法。（4） 設計鍵盤輸入電路和程序并調試。掌握鍵盤和顯示（LCD1602）配合使用的方法和技巧。（5） 掌握硬件和軟件聯合調試的方法。（6） 完成系統硬件電路的設計和制作。（7） 完成系統程序的設計。（8） 完成整個系統的設計、調試和制作。（9） 完成課程設計報告。
上傳時間： 2022-05-30
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【資源描述】:Dds AD9854產生各種波形程序集
上傳時間： 2022-06-16
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【資源描述】:2001年全國大學生電子設計競賽一等獎基于Dds技術的任意波形發生器.rar
上傳時間： 2022-06-17
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摘要：論述了利用FPGA的系統級設計工具DSP Builder開發Dds函數發生器的總體設計思路，討論了改變輸出信號頻率、幅度、相位的設計方法。系統基于Ahera公司的Cyclone系列FPGA，配合Silicon Labs公司高性能C8051F340單片機實現，給出了系統的軟件仿真結果并完成了整個系統的硬件驗證。結果證明了設計的正確性，同時表明采用DSPBuilder使Dds任意函數發生器的FPGA硬件實現更加簡單，速度更快。
上傳時間： 2022-07-11
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基于Dds的實用信號發生器設計
上傳時間： 2022-07-25
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此程序為AD9850（Dds）直接數字頻率合成器C語言源碼。用125M的有源晶振，頻率無失真輸出可達到40M。該程序包括FYD12864LCD顯示程序加4X4矩陣鍵盤掃描，可步進1M，1K，和任意頻率輸入。及相位設置。
上傳時間： 2013-07-09
上傳用戶：wfl_yy
隨著微電子和計算機技術的迅速發展，傳統的金屬探測系統也正向著新的方向進行快速更新和發展。金屬探測器最初主要應用于工礦探測和軍用探雷，現在已經廣泛應用于旅行安檢以及食品、紡織、木材、玩具、藥品等生產加工行業的質量安全檢測。在科學技術不斷進步及金屬探測器在社會生活中的作用不斷凸現的時代背景下，怎樣提升和完善金屬探測儀器的性能，已經成為本領域一個亟待解決的課題。 本課題的目的是設計一種雙頻率工作的數字式金屬探測系統，可以同時以較高的精度檢測到鐵磁性和非鐵磁性金屬，從工作模式上徹底改變普通金屬探測器檢測種類單一和精度不高的現狀。該檢測系統采用多通道同步數字頻率合成(Dds)技術產生正弦信號源，通過電渦流傳感器檢測金屬異物。系統以TMS320LF2407為數據處理中心，利用自學習算法來實現系統參數的自動調整，并設計了良好的人機對話界面，提高金屬探測器的可讀性和可操作性。 本文從金屬檢測的理論分析和雙頻金屬探測器的設計兩個方面做了具體闡述。理論分析部分從電磁場的角度論述了金屬物質的幅度和相位特性，并得出了檢測頻率與不同金屬的檢測靈敏度存在相關性的結論。文中把系統設計分為三大部分：檢測系統的工作原理和總體構造、系統硬件設計、系統軟件設計。第一部分主要闡述了整個系統的工作原理以及實現方案；硬件設計部分從檢測電路和控制電路兩個方面入手，詳細敘述了發射、接收、解調電路以及電渦流傳感器的設計過程，并著重介紹了DSP、單片機等主要芯片的接口電路設計，包括基于RS-485的SCI串口通信的硬件電路設計；軟件設計部分主要闡述了在CCS、u-Visin集成環境下DSP系統和人機對話系統的程序流程，并敘述了系統自學習方法的實現過程，最后著重分析了SCI串口通信的軟件實現方法。 文中最后整理了系統測試的實驗結果。通過實驗分析可知，采用雙頻工作的金屬探測器對鐵磁性和非鐵磁性金屬都有較高的檢測精度。整個系統的可讀性與可操作性較好，易于擴展升級、性價比高，具有良好的應用前景。
上傳時間： 2013-04-24
上傳用戶：bruce
隨著計算機和微電子技術的飛速發展，基于數字信號處理的示波器、信號發生器、邏輯分析儀和頻譜分析儀等測量儀器已經應用到各個領域并且發揮著重要作用，但這些儀器昂貴的價格阻礙了它們的普遍使用。 本文針對電子測量儀器技術發展和普及的情況，結合用FPGA實現數字信號處理的優勢，研究一種基于FPGA的輔助性獨立電予測量儀器的軟件系統。這種儀器可以作為數?；旌想娐窚y試和驗證的工具，用來觀察模擬信號波形、數字信號時序波形、模擬信號的幅度頻譜，也可以用來產生Dds信號。在硬件選擇上，使用具有Altera公司CycloneⅡ器件的平臺來實現單片DSP系統，這種芯片成本低廉、工作速度快、技術兼容性好；在軟件設計上，采用基于FPGA的可編程數字邏輯設計方法，這種方法具有開發難度小、功能擴展簡單等優點。設計中采用的關鍵技術包括：基于FPGA和IP Core的Verilog HDL設計、數據采集、數據存儲、數據處理以及數據波形的實時顯示。對這些技術的研究探討不僅有理論研究價值，在科學實驗和產品設計中同樣具有重要的實用價值。系統的設計以低資源、高性能為目標，設計中采用了科學的模塊劃分、設計與集成的方法，在保持原四種信號處理功能不變的前提下，盡量多的節約各種FPGA資源，為實現低成本的輔助電子測量儀器提供了可能。
上傳時間： 2013-06-05
上傳用戶：love_stanford
函數發生器又名任意波形發生器，是一種常用的信號源，廣泛應用于通信、雷達、導航等現代電子技術領域。信號發生器的核心技術是頻率合成技術，主要方法有：直接模擬頻率合成、鎖相環頻率合成（PLL）、直接數字合成技術（Dds）。Dds是開環系統，無反饋環節，輸出響應速度快，頻率穩定度高。因此直接數字頻率合成技術是目前頻率合成的主要技術之一，其輸出信號具有相對較大的帶寬、快速的相位捷變、極高的相位分辨率和相位連續等優點。本文的主要工作是采用SOPC結合虛擬儀器技術，進行Dds智能函數發生器的研制。 本文介紹了虛擬儀器技術的基本理論，簡要闡述了儀器驅動程序、VISA等相關技術。對SOPC技術進行了深入的研究：SOPC技術是基于可編程邏輯器件的可重構片上系統，它作為SOC和CPLD/FPGA相結合的一項綜合技術，結合了兩者的優點，集成了硬核或軟核CPU、DSP、鎖相環、存儲器、I/O接口及可編程邏輯，可以靈活高效地解決SOC方案，而且設計周期短，設計成本低，非常適合本設計的應用。本文還對基于Dds原理的設計方案進行了分析，介紹了Dds的基本理論以及數學綜合，在研究Dds原理的基礎上，利用SOPC技術，在一片FPGA芯片上實現了整個函數發生器的硬件集成。 本文就函數發生器的設計制定了整體方案，對軟硬件設計原理及實現方法進行了具體的介紹，包括整個系統的硬件電路，SOPC片上系統和PC端軟件的設計。在設計中，LabVIEW波形編輯軟件和函數發生器二者采用異步串口進行通信。利用LabVIEW的強大功能，把波形的編輯，系統的設置放到計算機上完 成，具有人機界面友好、系統升級方便、節約硬件成本等諸多優勢。同時充分利用了FPGA內部大量的邏輯資源，將Dds模塊和微處理器模塊集成到一個單片FPGA上，改變了傳統的系統設計思路。通過對系統仿真和實際測試，結果表明該智能型函數發生器不僅能產生理想的輸出信號，還具有集成度高、穩定性好和擴展性強等優點。關鍵詞：智能型函數發生器，虛擬儀器，可編程片上系統，直接數字合成技術，NiosⅡ處理器。
上傳時間： 2013-07-09
上傳用戶：zw380105939
