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Dds

Dds信號發生器采用直接數字頻率合成(DirectDigitalSynthesis,簡稱Dds)技術,把信號發生器的頻率穩定度、準確度提高到與基準頻率相同的水平,并且可以在很寬的頻率范圍內進行精細的頻率調節。采用這種方法設計的信號源可工作于調制狀態,可對輸出電平進行調節,也可輸出各種波形。
  • 基于FPGA和CMX589A的GMSK調制器設計與實現

    GMSK信號具有很好的頻譜和功率特性,特別適用于功率受限和信道存在非線性、衰落以及多普勒頻移的移動突發通信系統。根據GMSK調制的特點,提出 亍一種以FPGA和CMX589A為硬件裁體的GMSK調制器的設計方案,并給出了方案的具體實現,包括系統結構、利用CMX589A實現的高斯濾波器、 FPGA實現的調制指數為O.5的FM調制器以及控制器。對系統功能和性能測試結果表明,指標符合設計要求,工作穩定可靠。 關鍵詞:GMSK;Dds;FM調制器;FPGAl 引 言 由于GMSK調制方式具有很好的功率頻譜特性,較優的誤碼性能,能夠滿足移動通信環境下對鄰道干擾的嚴格要求,因此成為GSM、ETS HiperLANl以及GPRS等系統的標準調制方式。目前GMSK調制技術主要有兩種實現方法,一種是利用GMSK ASIC專用芯片來完成,典型的產品如FX589或CMX909配合MC2833或FX019來實現GMSK調制。這種實現方法的特點是實現簡單、基帶信 號速率可控,但調制載波頻率固定,沒有可擴展性。另外一種方法是利用軟件無線電思想采用正交調制的方法在FPGA和DSP平臺上實現。其中又包括兩種實現 手段,一種是采用直接分解將單個脈沖的高斯濾波器響應積分分成暫態部分和穩態部分,通過累加相位信息來實現;另一種采用頻率軌跡合成,通過采樣把高斯濾波 器矩形脈沖響應基本軌跡存入ROM作為查找表,然后通過FM調制實現。這種利用軟件無線電思想實現GMSK調制的方法具有調制參數可變的優點,但由于軟件 設計中涉及到高斯低通濾波、相位積分和三角函數運算,所以調制器參數更改困難、實現復雜。綜上所述,本文提出一種基于CMX589A和FPGA的GMSK 調制器設計方案。與傳統實現方法比較具有實現簡單、調制參數方便可控和軟件剪裁容易等特點,適合于CDPD、無中心站等多種通信系統,具有重要現實意義。

    標簽: FPGA 589A GMSK CMX

    上傳時間: 2013-10-24

    上傳用戶:thesk123

  • 毫米波低相噪捷變頻高分辨率雷達頻率源設計

    設計了一種由直接數字頻率合成(Dds)、倍頻鏈構成的三次變頻直接頻率合成方案,實現了低相噪捷變頻高分辨率毫米波雷達頻率合成器設計。利用直接頻率合成器的倍頻輸出取代傳統三次變頻毫米波頻率源的鎖相環(PLL),同時提供線性調頻(LFM)信號,優化Dds和變頻方案的頻率配置關系。利用FPGA電路進行高速控制,較好地解決了毫米波頻率合成器各技術指標之間的矛盾。實測結果表明,采用該方案的毫米波頻率合成器在本振跳頻帶寬為160 MHz時,線性調頻頻率分辨率可達0.931 Hz,最大頻率轉換時間小于2 ?滋s,最大雜散低于-60 dBc,相位噪聲優于-90 dBc/Hz。

    標簽: 毫米波 捷變 高分辨率 雷達

    上傳時間: 2014-01-06

    上傳用戶:brain kung

  • 一種軟件無線電與認知引擎的接口實現方法

    為了研制一種鎖定時間短、相位噪聲低、雜散抑制度高的頻率合成技術,采用了直接數字式頻率合成器(Dds)驅動鎖相環(PLL)的結構。該頻率合成器綜合了Dds頻率轉換速度快、頻率分辨率高和PLL輸出頻帶寬、輸出雜散低的優點。基于該結構研制實現了輸出頻率范圍為700~800 MHz的寬帶頻率合成器,實驗結果表明該頻率合成器掃描模式Δf=1 MHz鎖定時間不超過20 μs,跳頻模式Δf=50 MHz的定時間不超過30 μs,近端雜散抑制度優于-50 dBc。

    標簽: 軟件無線電 認知引擎 接口 實現方法

    上傳時間: 2014-12-28

    上傳用戶:assef

  • 基于FPGA的Dds波形信號發生器的設計

    設計采用Altera公司CycloneII系列EP2C5Q208作為核心器件,采用直接數字頻率合成技術實現了一個頻率、相位可控的基本信號發生器。該信號發生器可以產生正弦波、方波、三角波和鋸齒波四種波形。仿真及硬件驗證的結果表明,該信號發生器精度高,抗干擾性好,此設計方案具有一定的實用性。

    標簽: FPGA Dds 波形 信號發生器

    上傳時間: 2013-12-18

    上傳用戶:kz_zank

  • FPGA數字存儲掃頻儀(源代碼+電路圖+PCB圖)

      頻率特征測試儀是用來測量電路傳輸特性和阻抗特性的儀器,簡稱掃頻儀。掃頻信號源是掃頻儀的主要功能部件,作用是產生測量用的正弦掃頻信號,其 掃頻范圍可調,輸出信號幅度等幅。本設計采用Dds(數字頻率合成技術)產生掃頻信號,以Xilinx FPGA為控制核心,通過A/D和D/A等接口電路,實現掃頻信號頻率的步進調整、幅度與相位的測量,創新的使用了計算機軟件作為儀器面板來顯示被測網絡 幅頻特性與相頻特性,并且測試結果可保存到各種存儲介質中。

    標簽: FPGA PCB 數字存儲 掃頻儀

    上傳時間: 2013-11-03

    上傳用戶:w50403

  • Dds信號源的設計和制作

    。。。

    標簽: Dds 信號源

    上傳時間: 2013-10-26

    上傳用戶:z1191176801

  • 采用Dds技術的波形發生器(FPGA實現)

    FPGA

    標簽: FPGA Dds 波形發生器

    上傳時間: 2013-11-24

    上傳用戶:plsee

  • FPGA+Dds實現數控信號源的設計

    該信號源可輸出正弦波、方波和三角波,輸出信號的頻率以數控方式調節,幅度連續可調。與傳統信號源相比,該信號源具有波形質量好、精度高、設計方案簡潔、易于實現、便于擴展與維護的特點。

    標簽: FPGA Dds 數控 信號源

    上傳時間: 2013-10-17

    上傳用戶:asaqq

  • 基于FPGA的LVDS高速數據通信卡設計

    基于FPGA、PCI9054、SDRAM和Dds設計了用于某遙測信號模擬源的專用板卡。PCI9054實現與上位機的數據交互,FPGA實現PCI本地接口轉換、數據接收發送控制及Dds芯片的配置。通過WDM驅動程序設計及MFC交互界面設計,最終實現了10~200 Mbit·s-1的LVDS數據接收及10~50 Mbit·s-1任意速率的LVDS數據發送。

    標簽: FPGA LVDS 高速數據 通信卡

    上傳時間: 2013-12-24

    上傳用戶:zhangchu0807

  • 擴頻通信芯片STEL-2000A的FPGA實現

    針對傳統集成電路(ASIC)功能固定、升級困難等缺點,利用FPGA實現了擴頻通信芯片STEL-2000A的核心功能。使用ISE提供的Dds IP核實現NCO模塊,在下變頻模塊調用了硬核乘法器并引入CIC濾波器進行低通濾波,給出了DQPSK解調的原理和實現方法,推導出一種簡便的引入?仔/4固定相移的實現方法。采用模塊化的設計方法使用VHDL語言編寫出源程序,在Virtex-II Pro 開發板上成功實現了整個系統。測試結果表明該系統正確實現了STEL-2000A的核心功能。 Abstract:  To overcome drawbacks of ASIC such as fixed functionality and upgrade difficulty, FPGA was used to realize the core functions of STEL-2000A. This paper used the Dds IP core provided by ISE to realize the NCO module, called hard core multiplier and implemented CIC filter in the down converter, described the principle and implementation detail of the demodulation of DQPSK, and derived a simple method to introduce a fixed phase shift of ?仔/4. The VHDL source code was designed by modularity method , and the complete system was successfully implemented on Virtex-II Pro development board. Test results indicate that this system successfully realize the core function of the STEL-2000A.

    標簽: STEL 2000 FPGA 擴頻通信

    上傳時間: 2013-11-19

    上傳用戶:neu_liyan

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